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FPGA設計論壇

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一文詳解AXI DMA技術

AXI直接數值存?。―rect Memory Access,DMA)IP核在AXI4內存映射和AXI....
的頭像 FPGA設計論壇 發表于 04-03 09:32 ?797次閱讀
一文詳解AXI DMA技術

一文詳解Video In to AXI4-Stream IP核

Video In to AXI4-Stream IP核用于將視頻源(帶有同步信號的時鐘并行視頻數據,....
的頭像 FPGA設計論壇 發表于 04-03 09:28 ?1010次閱讀
一文詳解Video In to AXI4-Stream IP核

FPGA在數字化時代的主要發展趨勢

隨著數字化時代的飛速發展,人工智能(AI)、大數據分析、自動駕駛等新興領域的需求不斷攀升。FPGA作....
的頭像 FPGA設計論壇 發表于 04-02 09:49 ?611次閱讀
FPGA在數字化時代的主要發展趨勢

詳解Zynq中的SPI控制器

本文簡單介紹Zynq中的SPI控制器。本文將“master”稱為“主機”;將“slave”稱為“從機....
的頭像 FPGA設計論壇 發表于 03-31 10:35 ?416次閱讀
詳解Zynq中的SPI控制器

Zynq7000處理器的配置詳解

添加好ZYNQ7 Processing System IP核后,需要對其進行配置,雙擊彈出如下窗口。....
的頭像 FPGA設計論壇 發表于 03-27 09:37 ?933次閱讀
Zynq7000處理器的配置詳解

FPGA學習筆記

線網類型表示硬件電路元件之間實際存在的物理連線,有很多種:wire、tri、wor等等,當然日常使用....
的頭像 FPGA設計論壇 發表于 03-27 09:34 ?659次閱讀
FPGA學習筆記

基于Verilog語言實現CRC校驗

CRC即循環冗余校驗碼:是數據通信領域中最常用的一種查錯校驗碼,其特征是信息字段和校驗字段的長度可以....
的頭像 FPGA設計論壇 發表于 03-24 10:36 ?1189次閱讀
基于Verilog語言實現CRC校驗

一文詳解Vivado時序約束

Vivado的時序約束是保存在xdc文件中,添加或創建設計的工程源文件后,需要創建xdc文件設置時序....
的頭像 FPGA設計論壇 發表于 03-24 09:44 ?2741次閱讀
一文詳解Vivado時序約束

一文詳解Verilog HDL

Verilog HDL(Hardware Description Language)是一種硬件描述語....
的頭像 FPGA設計論壇 發表于 03-17 15:17 ?1912次閱讀
一文詳解Verilog HDL

千兆網絡PHY芯片RTL8211E的實踐應用

以太網MAC模塊負責實現以太網MAC子層的功能,完成802.3ab的數據封裝與解封。其同時負責適配硬....
的頭像 FPGA設計論壇 發表于 03-17 13:56 ?3383次閱讀
千兆網絡PHY芯片RTL8211E的實踐應用

基于FPGA的DS18B20數字溫度傳感器測溫實例

本文將使用三段式狀態機(Moore型)的寫法來對DS18B20進行測溫操作,以便了解DS18B20和....
的頭像 FPGA設計論壇 發表于 03-17 11:06 ?1307次閱讀
基于FPGA的DS18B20數字溫度傳感器測溫實例

AXI接口FIFO簡介

AXI接口FIFO是從Native接口FIFO派生而來的。AXI內存映射接口提供了三種樣式:AXI4....
的頭像 FPGA設計論壇 發表于 03-17 10:31 ?860次閱讀
AXI接口FIFO簡介

如何使用FPGA驅動并行ADC和DAC芯片,使用不同編碼方式的ADC與DAC時的注意事項

ADC和DAC是FPGA與外部信號的接口,從數據接口類型的角度劃分,有低速的串行接口和高速的并行接口....
的頭像 FPGA設計論壇 發表于 03-14 13:54 ?1034次閱讀
如何使用FPGA驅動并行ADC和DAC芯片,使用不同編碼方式的ADC與DAC時的注意事項

復位電路的作用、控制方式和類型

復位電路也是數字邏輯設計中常用的電路,不管是 FPGA 還是 ASIC 設計,都會涉及到復位,一般 ....
的頭像 FPGA設計論壇 發表于 03-12 13:54 ?1952次閱讀
復位電路的作用、控制方式和類型

AXI握手時序優化—pipeline緩沖器

skid buffer(pipeline緩沖器)介紹 ??解決ready/valid兩路握手的時序困....
的頭像 FPGA設計論壇 發表于 03-08 17:10 ?473次閱讀
AXI握手時序優化—pipeline緩沖器

DDR內存控制器的架構解析

DDR內存控制器是一個高度集成的組件,支持多種DDR內存類型(DDR2、DDR3、DDR3L、LPD....
的頭像 FPGA設計論壇 發表于 03-05 13:47 ?1389次閱讀
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FPGA設計調試流程

調試,即Debug,有一定開發經驗的人一定會明確這是設計中最復雜最磨人的部分。對于一個龐大復雜的FP....
的頭像 FPGA設計論壇 發表于 03-04 11:02 ?1114次閱讀
FPGA設計調試流程

增量式編碼器原理介紹

增量式編碼器是一種將位移信息轉換成周期性電信號,再將電信號轉換成脈沖計數的裝置。
的頭像 FPGA設計論壇 發表于 03-03 10:21 ?780次閱讀
增量式編碼器原理介紹

Vivado FIR IP核實現

Xilinx的FIR IP核屬于收費IP,但是不需要像 Quartus那樣通過修改license文件....
的頭像 FPGA設計論壇 發表于 03-01 14:44 ?1464次閱讀
Vivado FIR IP核實現

Verilog中signed和$signed()的用法

1、在verilog中有時會用signed修飾符來修飾定義的數據,運算的時候也會用$signed()....
的頭像 FPGA設計論壇 發表于 02-17 17:47 ?532次閱讀
Verilog中signed和$signed()的用法

根據波形圖編寫Verilog代碼

根據下面的時序圖實現這個組合邏輯電路。
的頭像 FPGA設計論壇 發表于 02-17 14:38 ?446次閱讀
根據波形圖編寫Verilog代碼

FPGA上的圖像處理算法集成與優化

本文詳細介紹了多種圖像處理技術,包括RG/GB單通道提取、亮度和對比度調整、圖像反轉、均值濾波、高斯....
的頭像 FPGA設計論壇 發表于 02-14 13:46 ?515次閱讀
FPGA上的圖像處理算法集成與優化

基于FPGA的DVP協議實現標準圖像數據流轉換

DVP(Digital Video Port) 是傳統的sensor輸出接口,采用并行輸出方式,d數....
的頭像 FPGA設計論壇 發表于 02-11 14:22 ?1454次閱讀
基于FPGA的DVP協議實現標準圖像數據流轉換

一文詳解JESD204B協議

其實使用到ADI的東西,基本也就沒有太去關注協議這些東西,只是簡簡單單的有個了解就行,在實際調試的時....
的頭像 FPGA設計論壇 發表于 02-08 13:45 ?2184次閱讀
一文詳解JESD204B協議

SPI通信總線概述和Verilog實現

SPI = Serial Peripheral Interface,是串行外圍設備接口,是一種高速,....
的頭像 FPGA設計論壇 發表于 02-07 14:28 ?1287次閱讀
SPI通信總線概述和Verilog實現

FPGA圖像處理基礎----實現緩存卷積窗口

像素行與像素窗口 一幅圖像是由一個個像素點構成的,對于一幅480*272大小的圖片來說,其寬度是48....
的頭像 FPGA設計論壇 發表于 02-07 10:43 ?721次閱讀
FPGA圖像處理基礎----實現緩存卷積窗口

高速接口7系列收發器GTP介紹

1. 前言 最近在做以太網相關的東西,其中一個其中想要使用MAC通過光電轉換模塊來完成數據的收發。在....
的頭像 FPGA設計論壇 發表于 01-24 11:53 ?859次閱讀
高速接口7系列收發器GTP介紹

FPGA實現AXI4總線的讀寫

AWID[3:0]與ARID[3:0]:對于只有一個主機從機設備,該值可設置為任意。
的頭像 FPGA設計論壇 發表于 01-22 15:04 ?2933次閱讀
FPGA實現AXI4總線的讀寫

RAM-Based Shift Register Xilinx IP核的使用

一般來講,如果要實現移位寄存器的話,通常都是寫RTL用reg來構造,比如1bit變量移位一個時鐘周期....
的頭像 FPGA設計論壇 發表于 01-21 15:42 ?2383次閱讀
RAM-Based Shift Register Xilinx IP核的使用

XILINX FPGA CLB單元之移位寄存器

一、移位寄存器 SLICEM函數發生器也可以配置為32位移位寄存器,而無需使用slice中可用的觸發....
的頭像 FPGA設計論壇 發表于 01-16 17:45 ?667次閱讀
XILINX FPGA CLB單元之移位寄存器