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      FPGA之家

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      基于FPGA的直方圖線性拉伸的解決方案與對比分析

      但是實際應用中并不會直接采用上述的A和B，這是由于圖像中可能存在噪聲的原因。想象如果圖像中存在幾個純....
      的頭像 FPGA之家 發(fā)表于 07-02 10:38 ?2463次閱讀
      基于FPGA的直方圖線性拉伸的解決方案與對比分析

      剖析FPGA灰度直方圖線性拉伸

      純工程師社群 直方圖線性拉伸相對于直方圖均衡化來說就更好理解一些了，即用線性變化將灰度直方圖較窄的部....
      的頭像 FPGA之家 發(fā)表于 07-02 10:37 ?3483次閱讀
      剖析FPGA灰度直方圖線性拉伸

      SoC設(shè)計AHB高級高性能總線的詳細介紹

      AHB（高級高性能總線）：用于高性能高時鐘頻率的系統(tǒng)模塊，AHB 擔當高性能系統(tǒng)的中樞總線。AHB ....
      的頭像 FPGA之家 發(fā)表于 07-02 10:35 ?3691次閱讀
      SoC設(shè)計AHB高級高性能總線的詳細介紹

      如何基于DDS IP實現(xiàn)線性調(diào)頻信號

      利用DDS IP實現(xiàn)線性調(diào)頻信號 1 DDS技術(shù)簡介隨著電子技術(shù)的不斷發(fā)展，傳統(tǒng)的頻率合成技術(shù)逐漸不....
      的頭像 FPGA之家 發(fā)表于 07-02 10:27 ?4468次閱讀
      如何基于DDS IP實現(xiàn)線性調(diào)頻信號

      基于FPGA的DDS IP實現(xiàn)線性調(diào)頻信號的設(shè)計方案

      利用DDS IP實現(xiàn)線性調(diào)頻信號1 DDS技術(shù)簡介隨著電子技術(shù)的不斷發(fā)展，傳統(tǒng)的頻率合成技術(shù)逐漸不能....
      的頭像 FPGA之家 發(fā)表于 07-02 10:27 ?8017次閱讀
      基于FPGA的DDS IP實現(xiàn)線性調(diào)頻信號的設(shè)計方案

      Verilog HDL語言中任務與函數(shù)的比較

      其中，返回值的類型和位寬是可選項，如果缺省會返回一位寄存器類型數(shù)據(jù)。Verilog HDL認為函數(shù)的....
      的頭像 FPGA之家 發(fā)表于 07-02 10:24 ?2581次閱讀

      什么是零點和極點？時域上系統(tǒng)穩(wěn)定性和S域的穩(wěn)定性有什么關(guān)系？

      PID是十分優(yōu)美的控制算法，在工業(yè)控制應用地十分廣泛，有的時候，無需知道系統(tǒng)模型的情況下，只要經(jīng)驗法....
      的頭像 FPGA之家 發(fā)表于 07-01 09:14 ?13304次閱讀
      什么是零點和極點？時域上系統(tǒng)穩(wěn)定性和S域的穩(wěn)定性有什么關(guān)系？

      Verilog HDL語言的數(shù)據(jù)類型和運算符與表達式解析

      標識符可以是一組字母、數(shù)字、下劃線和$符號的組合，且標識符的第一個字符必須是字母或者下劃線。另外，標....
      的頭像 FPGA之家 發(fā)表于 06-30 11:18 ?7019次閱讀
      Verilog HDL語言的數(shù)據(jù)類型和運算符與表達式解析

      如何利用Vivado集成開發(fā)環(huán)境進行FPGA的應用開發(fā)

      隨著5G、AI、航天等領(lǐng)域迅猛發(fā)展，高速信號處理需求日益突出，硬件加速勢在必行。異構(gòu)多核架構(gòu)近年來得....
      的頭像 FPGA之家 發(fā)表于 06-30 11:11 ?3123次閱讀
      如何利用Vivado集成開發(fā)環(huán)境進行FPGA的應用開發(fā)

      利用3D Layout解決PCB設(shè)計流程集成到機電設(shè)計的難題

      Xpedition/PADS Professional Layout 為 PCB 設(shè)計人員提供了通過....
      的頭像 FPGA之家 發(fā)表于 06-30 11:05 ?4014次閱讀
      利用3D Layout解決PCB設(shè)計流程集成到機電設(shè)計的難題

      你們知道always，assign和always@(*)之間的區(qū)別嗎

      1.always@后面內(nèi)容是敏感變量，always@（*）里面的敏感變量為*，意思是說敏感變量由綜合....
      的頭像 FPGA之家 發(fā)表于 06-27 11:47 ?15764次閱讀

      XILINX FPGA的硬件設(shè)計總結(jié)之PCIE硬件設(shè)計避坑指南

      隨著FPGA的不斷發(fā)展，F(xiàn)PGA本身自帶的PCIE硬核的數(shù)量越來越多，本文以ZU11EG為例介紹，如....
      的頭像 FPGA之家 發(fā)表于 06-27 11:20 ?7121次閱讀
      XILINX FPGA的硬件設(shè)計總結(jié)之PCIE硬件設(shè)計避坑指南

      簡述FPGA的圖像高斯濾波

      在知乎上看到一個比較有意思的話題，卷積為什么叫”卷“積？哈哈哈哈哈 其中有個動圖用卷毛巾生動形象的比....
      的頭像 FPGA之家 發(fā)表于 06-27 11:08 ?2360次閱讀
      簡述FPGA的圖像高斯濾波

      常用的Linux常用操作命令及其技巧必看

      IC設(shè)計是在linux環(huán)境下，很多操作需要在Terminal中進行，因此想要學習IC設(shè)計，就必須先需....
      的頭像 FPGA之家 發(fā)表于 06-26 10:39 ?2222次閱讀
      常用的Linux常用操作命令及其技巧必看

      怎樣利用modelsim仿真波形圖案來顯示字符？

      這個小工程利用modelsim仿真波形圖案來顯示字符。
      的頭像 FPGA之家 發(fā)表于 06-26 10:26 ?3401次閱讀
      怎樣利用modelsim仿真波形圖案來顯示字符？

      如何更好地去掌握I2C通信？

      雖然每個器件對IIC通信的波形要求不是太相同，但IIC的通信時序容忍度非常高，基本上相關(guān)參數(shù)和驅(qū)動都....
      的頭像 FPGA之家 發(fā)表于 06-26 10:13 ?1602次閱讀
      如何更好地去掌握I2C通信？

      深度解讀AMBA、AHB、APB、AXI總線介紹及對比

      什么是AMBA？ 現(xiàn)如今，集成電路芯片的規(guī)模越來越大。數(shù)字IC從基于時序驅(qū)動的設(shè)計方法，發(fā)展到基于I....
      的頭像 FPGA之家 發(fā)表于 06-25 11:22 ?11166次閱讀

      Verilog設(shè)計過程中狀態(tài)機的設(shè)計方法

      “本文主要分享了在Verilog設(shè)計過程中狀態(tài)機的一些設(shè)計方法。 關(guān)于狀態(tài)機 狀態(tài)機本質(zhì)是對具有邏輯....
      的頭像 FPGA之家 發(fā)表于 06-25 11:04 ?2893次閱讀

      分享可應用于單片機的內(nèi)存管理模塊mem_malloc

      本次給大家分享一位大佬寫的應用于單片機內(nèi)存管理模塊mem_malloc，這個mem_malloc的使....
      的頭像 FPGA之家 發(fā)表于 06-25 08:54 ?3274次閱讀
      分享可應用于單片機的內(nèi)存管理模塊mem_malloc

      如何在VScode中自動生成Verilog仿真文件

      一、實現(xiàn)功能 1、可以自動創(chuàng)建文件夾 2、根據(jù)Verilog文件自動生成測試文件模板（TB文件名字是....
      的頭像 FPGA之家 發(fā)表于 06-23 17:48 ?3883次閱讀

      Verilog進行組合邏輯設(shè)計時有哪些注意事項

      一、邏輯設(shè)計 （1）組合邏輯設(shè)計 下面是一些用Verilog進行組合邏輯設(shè)計時的一些注意事項： ①組....
      的頭像 FPGA之家 發(fā)表于 06-23 17:45 ?5627次閱讀
      Verilog進行組合邏輯設(shè)計時有哪些注意事項

      SPI、UART、IIC總線之間有什么區(qū)別與聯(lián)系

      SPI 總線 SPI（Serial Peripheral Interface，串行外設(shè)接口）是一種高....
      的頭像 FPGA之家 發(fā)表于 06-21 16:46 ?5235次閱讀

      Linux中的軟鏈接、硬鏈接都用在哪些場合？

      最近，看到很多文章都在介紹 Linux 中的文件系統(tǒng)，其中就包括：inode 節(jié)點、軟鏈接、硬鏈接等....
      的頭像 FPGA之家 發(fā)表于 06-21 16:33 ?1876次閱讀

      高速信號處理時片間信號傳輸?shù)撵o態(tài)時許分析

      之前做的一個超寬帶非均勻采樣系統(tǒng)中遇到的一些問題，雖然本文所述方法并未實際用到并解決遇到的問題，但也....
      的頭像 FPGA之家 發(fā)表于 06-18 16:22 ?1655次閱讀
      高速信號處理時片間信號傳輸?shù)撵o態(tài)時許分析

      Zynq-7000系列可編程邏輯PL是什么？

      剛學ZYNQ的時候，看到里面反復提到PS和PL，還以為PS是PhotoShop的意思，PL是哪種型號....
      的頭像 FPGA之家 發(fā)表于 06-18 16:09 ?9972次閱讀

      芯片技術(shù)中就有了“層”的概念是什么？

      前言：集成電路(芯片)是用光刻為特征的制造工藝，一層一層制造而成。所以,芯片技術(shù)中就有了“層”的概念....
      的頭像 FPGA之家 發(fā)表于 06-18 16:04 ?10181次閱讀

      芯片能屯一堆十年后暴漲再賣掉嗎？

      何止?jié)q 5 倍，聽說有的 MCU 都漲了幾十倍。所以有人建議多囤點芯片，十年后再賣。酒越存越香，股票....
      的頭像 FPGA之家 發(fā)表于 06-18 15:31 ?4141次閱讀

      時序問題常見的跨時鐘域亞穩(wěn)態(tài)問題

      今天寫一下時序問題常見的跨時鐘域的亞穩(wěn)態(tài)問題。 先說明一下亞穩(wěn)態(tài)問題： D觸發(fā)器有個明顯的特征就是建....
      的頭像 FPGA之家 發(fā)表于 06-18 15:28 ?3248次閱讀

      Verilog的兩種塊語句解析

      1. 塊語句有兩種，一種是 begin-end 語句， 通常用來標志（）執(zhí)行的語句；一種是 fork....
      的頭像 FPGA之家 發(fā)表于 06-18 15:16 ?3244次閱讀

      將FPGA集成進SoC的好處顯而易見

      FPGA以其強大的靈活性和適應性見長。系統(tǒng)設(shè)計師在設(shè)計大容量復雜應用時，越來越多的考慮使用SoC中集....
      的頭像 FPGA之家 發(fā)表于 06-18 15:11 ?2922次閱讀