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FPGA之家

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Flash讀寫控制方案 Altera似乎“沒有”開放配置Flash的Pin的控制

自行設(shè)計Flash讀寫控制器的優(yōu)點(diǎn)在于可控性很高,缺點(diǎn)在于需要花費(fèi)時間設(shè)計并進(jìn)行穩(wěn)定性測試。相應(yīng)的,....
的頭像 FPGA之家 發(fā)表于 07-27 09:29 ?6521次閱讀

D觸發(fā)器的幾種表示形式同步復(fù)位、同步釋放

首選我們來聊聊時序邏輯中最基礎(chǔ)的部分D觸發(fā)器的同步異步,同步復(fù)位即復(fù)位信號隨系統(tǒng)時鐘的邊沿觸發(fā)起作用....
的頭像 FPGA之家 發(fā)表于 07-26 10:17 ?27026次閱讀
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SDN領(lǐng)域的傳奇人物——Nick McKeown一直在網(wǎng)絡(luò)架構(gòu)領(lǐng)域的浪潮之巔

一般來說,每一個領(lǐng)域必然有那么幾個的先驅(qū)人物,而Nick教授就是網(wǎng)絡(luò)領(lǐng)域尤其是SDN領(lǐng)域的先驅(qū)。但N....
的頭像 FPGA之家 發(fā)表于 07-26 10:10 ?11363次閱讀

VIO比chipscope有多大優(yōu)勢?

debug,尤其是通信芯片的debug,可以有很多的方法。一個數(shù)據(jù)幀從進(jìn)入到輸出,可以在通路上的關(guān)鍵....
的頭像 FPGA之家 發(fā)表于 07-19 10:19 ?7326次閱讀
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TTE和TSN業(yè)務(wù)的保障方式及分析問題

歡迎FPGA工程師加入官方微信技術(shù)群第一次看到以太網(wǎng)物理地址格式時,感覺很平淡。像看到IPV4和IP....
的頭像 FPGA之家 發(fā)表于 07-19 10:16 ?6349次閱讀

電腦是如何識別你插上了USB設(shè)備

次當(dāng)插上鼠標(biāo)或者U盤的時候,電腦是怎么知道是什么設(shè)備的呢?這里用到的就是枚舉了。枚舉,其實(shí)就是讓HO....
的頭像 FPGA之家 發(fā)表于 07-14 10:25 ?22927次閱讀
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vLUT表:寫 讀地址輸入、數(shù)據(jù)輸出 入這里面包括

最近的項目邏輯資源不夠,因?yàn)閼?yīng)用需求,要一組256個四輸入的模塊,后來改吧改吧,改成了一組165個6....
的頭像 FPGA之家 發(fā)表于 07-13 09:24 ?4051次閱讀
vLUT表:寫 讀地址輸入、數(shù)據(jù)輸出 入這里面包括

基于FPGA的橫向FIR濾波器設(shè)計詳解

在理論的基礎(chǔ)上詳細(xì)闡述了如何基于Verilog HDL搭建的數(shù)字電路,來完成來完成FIR橫向?yàn)V波器的....
的頭像 FPGA之家 發(fā)表于 07-08 08:33 ?6190次閱讀

如何在Vivado中實(shí)現(xiàn)邏輯鎖定和增量編譯工程實(shí)例說明

本文針對Vivado中實(shí)現(xiàn)的邏輯鎖定和增量編譯進(jìn)行的工程實(shí)例介紹,文中有對應(yīng)工程的下載地址。友情提示....
的頭像 FPGA之家 發(fā)表于 07-06 10:32 ?7390次閱讀
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采用FPGA對VGA圖形控制器的Verilog設(shè)計方法

VGA(視頻圖形陣列)作為一種標(biāo)準(zhǔn)的顯示接口得到廣泛的應(yīng)用。依據(jù)VGA顯示原理,介紹了利用FPGA實(shí)....
的頭像 FPGA之家 發(fā)表于 06-29 10:05 ?5419次閱讀
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Verilog的基本設(shè)計單元模塊介紹

Verilog的基本設(shè)計單元是“模塊”(block)。一個模塊是由兩部分組成的,一部分描述接口,另一....
的頭像 FPGA之家 發(fā)表于 06-26 15:30 ?12676次閱讀
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總線的操作時序和操作方式詳解

操作時序(timing):各信號有效的先后順序及配合關(guān)系
的頭像 FPGA之家 發(fā)表于 06-24 16:21 ?11802次閱讀
總線的操作時序和操作方式詳解