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Cadence楷登

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Cadence推出Tensilica NeuroEdge 130 AI協處理器

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Celestial AI 在 Virtuoso Studio 環境中采用Cadence方案進行智能RC調試、優化和簽核

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V2-f湍流模型在復雜流動中的應用研究

在高速空氣動力學中,利用二階矩閉合來研究沖擊/邊界層相互作用的研究很少。究其原因,是雷諾應力方程缺乏....
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在技術和連通性主宰一切的時代,電子和機械設計的融合將徹底改變用戶體驗。獨立開發器件的時代已經過去;市....
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Cadence UCIe IP在Samsung Foundry的5nm汽車工藝上實現流片成功

我們很高興能在此宣布,Cadence 基于 UCIe 標準封裝 IP 已在 Samsung Foun....
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Cadence邀您共赴DVCon China 2025

2025 年 4 月 16 日,DVCon China 2025 將在上海淳大萬麗酒店召開。DVCo....
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Cadence亮相2025國際集成電路展覽會暨研討會

此前,3 月 27 日 - 28 日,2025 國際集成電路展覽會暨研討會(IIC Shanghai....
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AI驅動半導體與系統設計 Cadence開啟設計智能化新時代

近日,楷登電子(Cadence)亞太區資深技術總監張永專先生受邀于上海參加了 SEMICON CHI....
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近日,由全球電子技術領域知名媒體集團 ASPENCORE 主辦的“2025 中國 IC 領袖峰會暨中....
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InspireSemi借助Cadence解決方案為下一代AI鋪路

InspireSemi 致力于為 HPC、AI、圖形分析和其他計算密集型應用開發和提供卓越的加速計算....
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Cadence顛覆AI數據中心設計

日前舉辦的英偉達 GTC 2025 開發者大會匯聚了眾多行業精英,共同探討人工智能的未來。而人工智能....
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Imagination利用Cadence系統設計與驗證工具開發節能半導體IP

Imagination Technologies 成立于 1985 年,現已鞏固了其作為半導體知識產....
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隨機化在PCIe IDE驗證中的重要性

本文將探討隨機化在 PCIe IDE 驗證中的重要性,重點介紹它如何在確保數據完整性和加密可靠性方面....
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詳解PCIe 6.0中的FLIT模式

PCIe 6.0 規范于 2021 年發布,采用 PAM4 調制(即 4 電平脈沖幅度調制),使數據....
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生成式 AI 日益普及,托管和訓練這些算法所消耗的能源也隨之增加。光子技術以光子為主要計算源,基于光....
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如何使用Python API創建自定義函數

Cadence 統一調試平臺 Verisium Debug 提供多種調試功能,如 RTL 調試、UV....
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