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LP38841-ADJ 具有啟用功能的 800mA、低 VIN (0.635V)、可調(diào)超低壓差穩(wěn)壓器數(shù)據(jù)手冊(cè)

科技綠洲 ? 2025-03-11 09:43 ? 次閱讀

LP38841-ADJ 是一種大電流、快速響應(yīng)穩(wěn)壓器,可以保持輸出 電壓調(diào)節(jié),輸入至輸出電壓降最小。采用 CMOS 工藝制造, 器件采用兩種輸入電壓工作:Vbias 提供電壓以驅(qū)動(dòng) N-MOS 的柵極 功率晶體管,而 Vin 是為負(fù)載供電的輸入電壓。使用 外部偏置軌允許該器件在超低 Vin 電壓下工作。與雙相情感障礙不同 穩(wěn)壓器,CMOS 架構(gòu)在任何輸出負(fù)載下消耗極低的靜態(tài)電流 當(dāng)前。使用 N-MOS 功率晶體管可實(shí)現(xiàn)寬帶寬,但外部 需要電容來保持環(huán)路穩(wěn)定性。
*附件:LP38841-ADJ 0.8A 超低 Drpout Adj Lnr Reg 穩(wěn)定,帶陶瓷輸出帽數(shù)據(jù)表.pdf

這些器件的快速瞬態(tài)響應(yīng)使其適合用于為 DSP微控制器內(nèi)核電壓和開關(guān)模式電源后置穩(wěn)壓器。零件可用 在 SO 包中。

壓差電壓: 75 mV(典型值)@ 0.8A 負(fù)載電流。

靜態(tài)電流: 滿載時(shí)為 30 mA(典型值)。

關(guān)斷電流: S/D 引腳為 30 nA(典型值) 低。

精準(zhǔn)基準(zhǔn)電壓: 1.5% 室溫 準(zhǔn)確性。

特性

  • 非常適合從 1.8V 或 1.5V 輸入進(jìn)行轉(zhuǎn)換
  • 設(shè)計(jì)用于低 ESR 陶瓷電容器
  • 超低壓差電壓 (75mV @ 0.8A 典型值)
  • 0.56V 至 1.5V 可調(diào)輸出范圍
  • 負(fù)載調(diào)整率為 0.1%/A(典型值)
  • 關(guān)斷時(shí) 30nA 靜態(tài)電流 (典型值)
  • 所有負(fù)載下的低接地引腳電流
  • 過溫/過流保護(hù)
  • 采用 8 引腳 SO 封裝
  • ?40°C 至 +125°C 結(jié)溫范圍
  • UVLO 在 V 偏見 < 3.8V

參數(shù)
image.png

方框圖

image.png

1. 產(chǎn)品概述

  • ?型號(hào)?:LP38841-ADJ
  • ?類型?:0.8A 超低壓差可調(diào)線性穩(wěn)壓器,帶陶瓷輸出帽
  • ?特點(diǎn)?:
    • 高電流,快速響應(yīng)
    • 超低壓差電壓(75mV @ 0.8A 典型值)
    • 輸出電壓可調(diào)范圍:0.56V 至 1.5V
    • 低靜態(tài)電流(30nA 在關(guān)斷模式下)
    • 低地引腳電流
    • 過溫/過流保護(hù)
    • 適用于DSP、微控制器核心電壓和開關(guān)模式電源后級(jí)穩(wěn)壓器等應(yīng)用

2. 封裝信息

  • ?封裝類型?:8引腳SO封裝

3. 引腳配置與功能

  • ?引腳功能?:
    • ?ADJ?:調(diào)整引腳,用于設(shè)置輸出電壓
    • ?OUTPUT?:穩(wěn)壓輸出電壓引腳
    • ?BIAS?:提供低電流偏置電壓,驅(qū)動(dòng)內(nèi)部電路和N-MOS功率晶體管
    • ?GND?:電源和模擬
    • ?INPUT?:高電流輸入電壓引腳
    • ? SHUTDOWN (S/D) ?:提供低功率關(guān)斷功能,若未使用,應(yīng)連接到V_BIAS
    • ?N/C?:不連接引腳
    • ?DAP?:熱連接,連接到PCB銅板以散熱

4. 電氣特性

  • ?輸出電壓調(diào)整率?:
    • 線路調(diào)整率:0.01%/V
    • 負(fù)載調(diào)整率:0.1%/A 典型值
  • ?壓差電壓?:75mV @ 0.8A 典型值
  • ?靜態(tài)電流?:
    • 從V_IN抽取:30mA 典型值(滿載)
    • 從V_BIAS抽取:2mA 典型值
    • 關(guān)斷模式下:30nA 典型值
  • ?過溫保護(hù)?:內(nèi)置
  • ?短路電流?:2.6A(V_OUT = 0V)

5. 熱特性

  • ?熱阻?:SO-8封裝,RθJA = 43°C/W
  • ?工作溫度范圍?:-40°C 至 +125°C

6. 功能描述

  • ?輸出電壓調(diào)整?:通過外部電阻R1和R2設(shè)置輸出電壓
  • ?關(guān)斷功能?:通過拉低S/D引腳關(guān)斷輸出
  • ? 欠壓鎖定(UVLO) ?:當(dāng)V_BIAS低于約3.8V時(shí),禁用輸出

7. 應(yīng)用信息

  • ?典型應(yīng)用?:ASIC電源供應(yīng)、DSP和FPGA電源供應(yīng)、SMPS后級(jí)穩(wěn)壓器等
  • ?設(shè)計(jì)要求?:
    • V_BIAS供應(yīng)電壓:4.5V 至 5.5V
    • 輸出電流:最大0.8A

8. 外部電容

  • ?輸入電容?:至少10μF陶瓷電容
  • ?輸出電容?:
    • 若使用鉭電容,最小4.7μF
    • 若使用陶瓷電容,最小22μF
  • ?偏置電容?:0.1μF電容(推薦陶瓷)
  • ?前饋電容?(可選):用于改善瞬態(tài)響應(yīng)

9. 布局與散熱

  • ?布局建議?:所有電容應(yīng)盡可能靠近相應(yīng)引腳放置,以減少寄生電感和電阻
  • ?散熱?:通過SO封裝的底部DAP連接到PCB上的銅平面進(jìn)行散熱
聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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