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OpenFPGA

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探究晶體管發展歷程

晶體管之路 可以夸張地說,沒有他們的發明就沒有現在計算機的科學,所以我們非常有必要去了解這些東西(晶....
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支持jesd204b協議高速DAC芯片AD9144配置

背景 AD9144是一款支持jesd204b協議高速DAC芯片。AD9144-FMC-EBZ是基于A....
的頭像 OpenFPGA 發表于 10-08 17:40 ?3444次閱讀

最長命Z80 CPU的前世今生

穿越時空的愛戀-Z80 CPU的前世今生 它是1976年推出時,與6502 CPU 一起,引發了一系....
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204B實戰應用-LMK04821代碼詳解(二)

大俠好,阿Q來也,今天是第二次和各位見面,請各位大俠多多關照。今天給各位大俠帶來一篇項目開發經驗分享....
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Intel FPGA系列產品介紹

概述 自從Altera被Intel收購后,似乎放棄了整個中國市場,Altera市場占有率被其他FPG....
的頭像 OpenFPGA 發表于 09-30 14:55 ?4712次閱讀
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高速串行通信常用的編碼方式-8b/10b編碼/解碼解析

? 論序 8b/10b編碼/解碼是高速串行通信,如PCle SATA(串行ATA),以及Fiber ....
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深入探究Xilinx Multiboot實例

原理 關于Multiboot的原理參考《 Xilinx 7系列FPGA Multiboot介紹-遠程....
的頭像 OpenFPGA 發表于 09-26 09:37 ?4146次閱讀
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教你們如何使用Verilog HDL在FPGA上進行圖像處理

該FPGA項目旨在詳細展示如何使用Verilog處理圖像,從Verilog中讀取輸入位圖圖像(.bm....
的頭像 OpenFPGA 發表于 09-23 16:17 ?4801次閱讀

Vivado之VIO原理及應用

虛擬輸入輸出(Virtual Input Output,VIO)核是一個可定制的IP核,它可用于實時....
的頭像 OpenFPGA 發表于 09-23 16:11 ?10009次閱讀
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FPGA中如何使用Verilog處理圖像

該FPGA項目旨在詳細展示如何使用Verilog處理圖像,從Verilog中讀取輸入位圖圖像(.bm....
的頭像 OpenFPGA 發表于 09-23 15:50 ?6522次閱讀

Verilog HDL-同步技術你了解多少

同步技術 在芯片設計中,數據同步和在不同時鐘域之間進行數據傳輸會經常出現。為避免任何差錯、系統故障和....
的頭像 OpenFPGA 發表于 09-18 10:58 ?2490次閱讀
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深度解讀Abstract Shell流程

為便于說明,這里我們給出一個應用案例。DFX設計中有兩個RP:count和shift。每個RP下分別....
的頭像 OpenFPGA 發表于 09-01 09:36 ?2506次閱讀
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DFX極大地提高了Xilinx FPGA芯片的靈活性

DFX(DynamicFunction eXchange,動態功能切換,就是之前的部分可重配置)技術....
的頭像 OpenFPGA 發表于 08-11 09:12 ?4647次閱讀

一文解析Vivado的三種封裝IP的方式

Vivado提供了三種封裝IP的方式:(1)將當前工程封裝為IP;(2)將當前工程中的BD(IPI ....
的頭像 OpenFPGA 發表于 08-10 18:09 ?7875次閱讀
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簡述HLS中的數組初始化遇到的那些個問題

在HLS中使用數組時,尤其是對數組初始化時,盡可能加上關鍵字static,這樣C++中數組的行為才能....
的頭像 OpenFPGA 發表于 07-21 09:36 ?4190次閱讀
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FPGA動態可重構技術是什么,局部動態可重構的時序問題解決方案

所謂FPGA動態可重構技術,就是要對基于SRAM編程技術的FPGA實現全部或部分邏輯資源的動態功能變....
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FPGA應用中部分重配置的操作過程

Partial Reconfiguration(部分重配置)在現在的FPGA應用中越來越常見,我們這....
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FPGA的重構是什么,具有哪些要點

術語“重構”是指FPGA已經配置后的重新編程。FPGA的重構有兩種類型:完全的和部分的。完全重構將整....
的頭像 OpenFPGA 發表于 07-02 17:39 ?2966次閱讀

FPGA的配置模式的分類及應用分析

所有現代FPGA的配置分為兩類:基于SRAM的和基于非易失性的。其中,前者使用外部存儲器來配置FPG....
的頭像 OpenFPGA 發表于 07-02 16:01 ?3888次閱讀
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果里果氣的Windows11兼容安卓App終于來了

Windows11悄悄地來了! 沒熱搜,沒熱議。六年磨一升級,還真有點小悲涼。 新系統嘛。。。。。。....
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講一講Xilinx家的MIPI方案

這里以普通7系列作為討論的對象, X家高端的KU+/MPSOC+有已經可以直接支持MIPI接口的IO....
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怎么搭建WSL+Vivado?又如何去使用?

???????根據自己系統選擇相應版本,本人下載的圖示箭頭版本,解壓、給權限,記住文件夾路徑,將交叉....
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這篇文章就和大家分享一下利用ZYNQ(需ZYNQ010以上芯片)+AD936X搭建一個低成本的Ope....
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什么是Setup和Holdup時間?如何解決亞穩態?

Setup/hold time 是測試芯片對輸入信號和時鐘信號之間的時間要求。
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發展歷史 1984年,Verilog開始作為一種專用的硬件建模語言使用,取得了相當大的成功。1990....
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淺析Vivado在非工程模式下的FPGA設計流程

參考:UG892 UG835 Vivado集成開發工具為設計者提供了非工程模式下的FPGA設計流程。....
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剖析具有挑戰性的設計時鐘方案

時鐘設計方案在復雜的FPGA設計中,設計時鐘方案是一項具有挑戰性的任務。設計者需要很好地掌握目標器件....
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Win10安裝Ubuntu子系統及圖形化界面詳細教程(WSL) 在準備進行安裝之前,推薦C盤上至少有....
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隨著現代科技的高速發展,機器視覺技術在無人機、安防監控、工業檢測、ADAS高級駕駛輔助系統、醫療診斷....
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Vivado中電路結構的網表描述

我們都知道FPGA的實現過程分為2步:分析綜合與布局布線后就可以產生目標文件,這兩個步驟中間有個非常....
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