概述
[ADuM6210]/[ADuM6211]/ADuM6212 均為集成isoPower ^?^ 隔離式DC/DC轉換器的四通道數字隔離器,基于ADI公司的iCoupler?技術,能夠提供可在3.15 V和5.25 V之間調節的穩壓隔離電源。輸入電源電壓可以略低于所需輸出,也可以遠高于所需輸出。
在低功耗隔離設計中,這樣就無需使用單獨的隔離式DC/DC轉換器。利用iCoupler芯片級變壓器技術,能夠隔離邏輯信號和DC/DC轉換器的磁性元件。因此,可提供小尺寸、完全隔離的解決方案。
ADuM6210/ADuM6211/ADuM6212隔離器提供兩個隔離數字數據通道,支持多種定向配置和數據速率(更多信息請參考訂購指南)。
isoPower 利用高頻開關元件,通過其變壓器傳輸功率。設計印刷電路板(PCB)布局時應特別小心,必須符合相關輻射標準。
數據表:*附件:ADuM6210 ADuM6211 ADuM6212集成DC DC轉換器的雙通道隔離器技術手冊.pdf
應用
特性
- isoPower 集成隔離式DC/DC轉換器
- 3.15 V至5.25 V穩壓輸出
- 最高150 mW輸出功率
- 兩個DC至100 Mbps (NRZ)信號隔離通道
- 軟啟動電源
- 20引腳SSOP封裝,爬電距離為5.3 mm
- 支持最高15 MHz的SPI
- 工作溫度最高可達:105℃
- 高共模瞬變抗擾度:>25 kV/μs
框圖
引腳配置描述
典型性能特征
應用信息
ADuM6210/ADuM6211/ADuM6212 的直流 - 直流轉換器部分基于與大多數現代非隔離式穩壓器通用的原理運行。它采用分離控制器架構,具備隔離式脈沖寬度調制(PWM)反饋。功率通過片上空氣芯變壓器傳輸,在次級側進行整流和調節,電壓值在 3.15V 至 5.25V 之間,具體取決于由外部分壓器提供的次級側電壓(V_{ISO} )(見公式 1 )。通過創建編碼控制信號并將其發送到初級側的 PWM 振蕩器,可調節輸出(V_{DD2} )。PWM 調制振蕩器的頻率,以控制傳輸到次級側的功率。反饋可實現顯著更高的功率和效率。
其中:
- R1 是 V_{SEL} 和 GND_{ISO} 之間的電阻。
- R2 是 V_{SEL} 和 V_{ISO} 之間的電阻。
由于輸出電壓可連續調節,理論上存在無數種工作條件。本數據手冊的“規格”部分介紹了許多離散的輸入和輸出操作條件。“溫度”部分介紹了受支持的固定組合范圍。圖 15 展示了通過在每個周期固定 V_{DD2} 并降低輸入電壓,直到 PWM 占空比達到運行所需的最小 80% 電壓,所獲得的最大電流。例如,如果應用在 30mA 時需要 3.3V,圖 15 還展示了為何 V_{DD1} = 3.3 text{V} 輸入和 V_{DD2} = 5 text{V} 配置不建議采用。即使在 10mA 輸出電流下,PWM 也無法維持低于 80% 的占空比,無法為負載或溫度變化留出余量。
通常,ADuM6210/ADuM6211/ADuM6212 的功耗約為 17%;因此,20% 的 PWM 裕量和最大溫度之間的溫差涵蓋了溫度變化。
ADuM6210/ADuM6211/ADuM6212 在初級和次級側實現了欠壓鎖定(UVLO)及遲滯功能,同時也適用于 V_{DD2} 電源輸入的 I/O 引腳。此功能可防止因輸入電源噪聲或緩慢上電斜坡導致轉換器出現誤振蕩。
印刷電路板布局
ADuM6210/ADuM6211/ADuM6212 數字隔離器集成了 0.15W 功率的直流 - 直流轉換器,用于邏輯接口,無需外部接口電路。電源去耦需要低等效串聯電阻(ESR)電容,由于芯片焊盤有限,建議使用多個無源元件來有效去耦功率,并設置輸出電壓,同時旁路核心電壓調節器(見圖 24 至圖 26 )。
ADuM6210/ADuM6211/ADuM6212 的電源部分采用 125MHz 振蕩器頻率,通過其片上規模變壓器高效傳輸功率。去耦電容對于抑制芯片轉換器產生的開關噪聲是必需的。噪聲抑制需要低電感、高頻特性的電容;因此,建議使用多層陶瓷電容(MLCC)。這些電容最方便的連接位置是:在引腳 9 和引腳 10 之間(針對 V_{DD1} ),以及在引腳 11 和引腳 12 之間(針對 V_{ISO} )。為抑制噪聲和減少紋波,至少應并聯兩個電容,推薦組合為 0.1μF(用于 V_{DD1} )和 10μF(用于 V_{ISO} )的陶瓷電容。例如,小型 X5R 陶瓷電容的等效串聯電阻較低。對于 10μF 額定電容,也建議使用陶瓷電容。若需進一步降低電磁干擾(EMI),可額外并聯一個 10nF 電容。
請注意,低等效串聯電阻電容兩端與輸入電源引腳之間的總引線長度不得超過 2mm 。
在涉及高共模瞬態的應用中,務必使隔離柵兩側的電路板耦合降至最低。此外,電路板布局必須設計為:任何確實發生的耦合會平等地影響給定組件側的所有引腳。若未做到這一點,可能會使引腳之間出現超出器件絕對最大額定值的電壓差,進而導致器件閂鎖或永久性損壞。
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