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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)技術(shù)

如何優(yōu)化FPGA HLS設(shè)計(jì)呢？

用工具用 C 生成 RTL 的代碼基本不可讀。以下是如何在不更改任何 RTL 的情況下提高設(shè)計(jì)性能。

2023-10-30 標(biāo)簽：arm 濾波器 FPGA設(shè)計(jì) 1330 0

異步電路的跨時(shí)鐘域處理

異步電路不能根據(jù)時(shí)鐘是否同源來界定，時(shí)鐘之間沒有確定的相位關(guān)系是唯一準(zhǔn)則。

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)芯片設(shè)計(jì)異步電路 1327 0

總結(jié)一下在時(shí)序分析中的基本概念及基本術(shù)語

下圖是一個(gè)經(jīng)典時(shí)序分析模型，無論寄存器A與寄存器B是否在同一個(gè)芯片中，下列概念均適用。

2023-07-03 標(biāo)簽：FPGA設(shè)計(jì)寄存器時(shí)序分析 1324 0

FPGA Vivado-TLC549驅(qū)動(dòng)設(shè)計(jì)介紹

在生活中，數(shù)模轉(zhuǎn)換的例子到處可見。但是在我們做FPGA設(shè)計(jì)時(shí)，需要對(duì)數(shù)字信號(hào)進(jìn)行處理，但是，不是所有的信號(hào)都是以數(shù)字信號(hào)的形式體現(xiàn)的，比如光信號(hào)、聲信號(hào)...

2023-07-27 標(biāo)簽：fpga FPGA設(shè)計(jì)寄存器 1306 1

論工業(yè)控制系統(tǒng)的FPGA設(shè)計(jì)方法（2）

上次博文簡(jiǎn)要介紹了人們研究使用FPGA來進(jìn)行工業(yè)控制的驅(qū)動(dòng)力與FPGA器件與工具的介紹，本次介紹FPGA設(shè)計(jì)方法論中的FPGA體系及其開發(fā)工具介紹。

2017-02-11 標(biāo)簽：FPGA FPGA設(shè)計(jì)工業(yè)控制 1290 0

FPGA數(shù)字圖像顯示原理與實(shí)現(xiàn)設(shè)計(jì)

視頻圖像經(jīng)過數(shù)十年的發(fā)展，已形成了一系列的規(guī)范，以VGA和HDMI為主的視頻圖像接口協(xié)議也得到定義與推廣。

2023-09-06 標(biāo)簽：FPGA設(shè)計(jì)VGA 編解碼芯片 1278 0

論工業(yè)控制系統(tǒng)的FPGA設(shè)計(jì)方法（3）

上次博文簡(jiǎn)要分析了人們研究使用FPGA來進(jìn)行工業(yè)控制的驅(qū)動(dòng)力，并介紹了FPGA器件與開發(fā)工具。隨著器件成本的降低和器件性能的上升，F(xiàn)PGA必將在工業(yè)控制...

2017-02-11 標(biāo)簽：FPGA FPGA設(shè)計(jì)工業(yè)控制 1278 0

FPGAer淺入淺出DDR

對(duì)于DDR的理解，最初簡(jiǎn)單的以為無非一個(gè)大的數(shù)組，我會(huì)接口使用就OK了。

2023-06-28 標(biāo)簽：FPGA設(shè)計(jì)DDR DRAM芯片 1276 0

ASIC的clock gating在FPGA里面實(shí)現(xiàn)是什么結(jié)果呢？

首先，ASIC芯片的clock gating絕對(duì)不能采用下面結(jié)構(gòu)，原因是會(huì)產(chǎn)生時(shí)鐘毛刺

2023-08-25 標(biāo)簽：轉(zhuǎn)換器 FPGA設(shè)計(jì)寄存器 1258 0

求一種FPGA實(shí)現(xiàn)圖像去霧的實(shí)現(xiàn)設(shè)計(jì)方案

本文詳細(xì)描述了FPGA實(shí)現(xiàn)圖像去霧的實(shí)現(xiàn)設(shè)計(jì)方案，采用暗通道先驗(yàn)算法實(shí)現(xiàn)，并利用verilog并行執(zhí)行的特點(diǎn)對(duì)算法進(jìn)行了加速；

2023-06-05 標(biāo)簽：HDMI FPGA設(shè)計(jì)RGB 1258 0

Mojo v3 FPGA板與16x2 LCD模塊是如何進(jìn)行連接的呢？

在本教程中，我們將使用Verilog HDL設(shè)計(jì)一個(gè)數(shù)字電路，該電路與基于HD44780 LCD控制器/驅(qū)動(dòng)芯片的通用LCD模塊連接。Mojo V3 F...

2023-09-20 標(biāo)簽：FPGA設(shè)計(jì)LCD控制器多路復(fù)用器 1255 0

在RTL編碼書寫中如何考慮時(shí)延與布線的問題呢？

分if-else,case 的各種情況分開討論,主要目的是將分支支路中晚到的信號(hào)放到離輸出最近的一級(jí)中

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)比較器 RTL 1247 0

FPGA零基礎(chǔ)之Vivado-超聲波驅(qū)動(dòng)設(shè)計(jì)

聲音是我們?nèi)粘Ｉ钪胁豢扇鄙俚囊环N信號(hào)，在傳遞信息的同時(shí)，也在生活中的各個(gè)領(lǐng)域有較多的應(yīng)用。

2023-10-18 標(biāo)簽：驅(qū)動(dòng)器 FPGA設(shè)計(jì)接收器 1246 0

FPGA設(shè)計(jì)的五個(gè)主要任務(wù)

FPGA設(shè)計(jì)的五個(gè)主要任務(wù)：邏輯綜合、門級(jí)映射、整體功能邏輯布局、邏輯資源互連布線，最后生成FPGA的bit流

2023-04-06 標(biāo)簽：FPGA設(shè)計(jì)EDA工具 SoC芯片 1235 0

跨時(shí)鐘域的解決方案

在很久之前便陸續(xù)談過亞穩(wěn)態(tài)，F(xiàn)IFO，復(fù)位的設(shè)計(jì)。本次亦安做一個(gè)簡(jiǎn)單的總結(jié)，從宏觀上給大家展示跨時(shí)鐘域的解決方案。

2024-01-08 標(biāo)簽：FPGA設(shè)計(jì)fifo CDC 1234 0

IP庫(kù)新增10多個(gè)功能IP簡(jiǎn)介

一直想做一個(gè)可以供大家學(xué)習(xí)、使用的開源IP庫(kù)，類似OpenCores，OC上IP在領(lǐng)域內(nèi)的IP很少，通用性強(qiáng)一點(diǎn)，所以作為OC的“補(bǔ)充”，所以做了一個(gè)開...

2023-05-06 標(biāo)簽：FPGA設(shè)計(jì)接收器 FIR 1232 0

基于Xilinx K7-410T的高速DAC之AD9129開發(fā)筆記（一）

本文開始，我們介紹下項(xiàng)目中設(shè)計(jì)的并行LVDS高速DAC接口設(shè)計(jì)，包括DAC與FPGA硬件接口設(shè)計(jì)、軟件設(shè)計(jì)等。

2023-06-07 標(biāo)簽：FPGA設(shè)計(jì)dac 數(shù)模轉(zhuǎn)換器 1228 0

FPGA原型驗(yàn)證系統(tǒng)的時(shí)鐘資源設(shè)計(jì)

如果SoC設(shè)計(jì)規(guī)模小，在單個(gè)FPGA內(nèi)可以容納，那么只要系統(tǒng)中的FPGA具有所SoC所設(shè)計(jì)需要時(shí)鐘的數(shù)量

2023-04-07 標(biāo)簽：FPGA設(shè)計(jì)分頻器 SoC芯片 1213 0

為保證數(shù)字電路時(shí)序裕量所做的努力

由于以太網(wǎng)測(cè)試使用的開發(fā)板是淘寶購(gòu)買的某款開發(fā)板，開發(fā)人員在電路設(shè)計(jì)時(shí)沒有考慮到將以太網(wǎng)芯片的接收時(shí)鐘、發(fā)送時(shí)鐘通過FPGA的專用時(shí)鐘管腳接入到到全局時(shí)鐘網(wǎng)絡(luò)

2023-06-19 標(biāo)簽：FPGA設(shè)計(jì)以太網(wǎng)寄存器 1207 0

FPGA設(shè)計(jì)是否需要學(xué)習(xí)SystemVerilog

Verilog和System Verilog是同一硬件描述語言（HDL）的同義名稱。

2023-10-26 標(biāo)簽：FPGA設(shè)計(jì)仿真器 HDL語言 1201 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

識(shí)別

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FPGA開發(fā)板

FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫(kù)

PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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