時(shí)序

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這里所說(shuō)的時(shí)序其實(shí)就是指時(shí)序圖，又名序列圖、循序圖、順序圖，是一種UML交互圖。它通過(guò)描述對(duì)象之間發(fā)送消息的時(shí)間順序顯示多個(gè)對(duì)象之間的動(dòng)態(tài)協(xié)作。

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時(shí)序技術(shù)

詳解時(shí)序路徑的相關(guān)概念

reg2reg路徑約束的對(duì)象是源寄存器（時(shí)序路徑的起點(diǎn)）和目的寄存器（時(shí)序路徑的終點(diǎn)）都在FPGA內(nèi)部的路徑。

2023-06-26 標(biāo)簽：fpga 寄存器時(shí)序 1362 0

淺談DC綜合工具的工作流程

在電路設(shè)計(jì)自動(dòng)化的時(shí)代，綜合工具的作用不言而喻，通過(guò)綜合，設(shè)計(jì)人員能夠獲得自己所設(shè)計(jì)模塊的規(guī)模、時(shí)序性能和關(guān)鍵路徑等有用信息，進(jìn)而指導(dǎo)自己優(yōu)化設(shè)計(jì)結(jié)構(gòu)。...

2023-06-19 標(biāo)簽：電路設(shè)計(jì)HDL DC 3164 0

如何讀懂Vivado時(shí)序報(bào)告

FPGA開(kāi)發(fā)過(guò)程中，vivado和quartus等開(kāi)發(fā)軟件都會(huì)提供時(shí)序報(bào)告，以方便開(kāi)發(fā)者判斷自己的工程時(shí)序是否滿足時(shí)序要求。

2023-06-23 標(biāo)簽：fpga 寄存器時(shí)序 1931 0

有關(guān)FPGA的問(wèn)答集錦

FPGA做IC的原型驗(yàn)證，速度大概跑多少？很多ASIC運(yùn)行主頻遠(yuǎn)遠(yuǎn)高于FPGA，仿真能cover住嗎？

2023-06-19 標(biāo)簽：fpga 原型驗(yàn)證 lvds 1349 0

STM32管理程序的時(shí)間觸發(fā)時(shí)序

自從 CubeMX 等圖像配置軟件的出現(xiàn)，同學(xué)們往往點(diǎn)幾下鼠標(biāo)就解決了單片機(jī)的配置問(wèn)題。對(duì)于追求開(kāi)發(fā)速度的業(yè)務(wù)場(chǎng)景下，使用快速配置軟件是合理的，高效的，...

2023-06-22 標(biāo)簽：STM32 軟件時(shí)序 1043 0

什么是全局中斷？

什么是全局中斷？全局中斷使能位控制著“所有”中斷，它如果關(guān)閉的話會(huì)屏蔽其它中斷，有人經(jīng)常關(guān)閉它，防止其它中斷帶來(lái)干擾，比如在使用GPIO模擬某個(gè)時(shí)序時(shí)，...

2023-06-14 標(biāo)簽：中斷時(shí)序 keil 3716 0

IIC時(shí)序問(wèn)題的解決方法

最近硬件測(cè)試工程師反饋一個(gè)BUG，和IIC的時(shí)序有關(guān)，這個(gè)BUG目前沒(méi)有帶來(lái)使用方面的影響，但是不符合規(guī)范，要求整改。我們使用的單片機(jī)是cortex-m...

2023-06-14 標(biāo)簽：單片機(jī)內(nèi)核 IIC 3978 0

FPGA的數(shù)字信號(hào)處理：重寫(xiě)FIR邏輯以滿足時(shí)序要求

在上一篇文章中（FPGA 的數(shù)字信號(hào)處理：Verilog 實(shí)現(xiàn)簡(jiǎn)單的 FIR 濾波器）演示了在 Verilog 中編寫(xiě)自定義 FIR 模塊的初始demo...

2023-06-09 標(biāo)簽：fpga 存儲(chǔ)器數(shù)字信號(hào)處理 1159 0

PSRAM避坑指南-關(guān)鍵知識(shí)點(diǎn)講解

以上分享了PSRAM接口一些關(guān)鍵的知識(shí)點(diǎn)，大部分是容易理解錯(cuò)誤，且導(dǎo)致問(wèn)題的點(diǎn)，基本上理解這些點(diǎn)就能解決大部分問(wèn)題了，作為入門(mén)參考也可以先看這篇，先有個(gè)...

2023-06-08 標(biāo)簽：嵌入式接口 PSRAM 8115 0

Vivado Schematic中的實(shí)線和虛線有什么區(qū)別？

2023-06-06 標(biāo)簽：fpga 時(shí)序 Schematic 1483 0

LVDS、接口和時(shí)序講解

這種接口電路中，采用單路方式傳輸，每個(gè)基色信號(hào)采用6位數(shù)據(jù)，共18位RGB數(shù)據(jù)，因此，也稱18位或18bit LVDS接口。此，也稱18位或18bit ...

2023-06-02 標(biāo)簽：芯片接口 RGB 9842 0

FPGA設(shè)計(jì)中經(jīng)常犯的10個(gè)錯(cuò)誤

本文列出了FPGA設(shè)計(jì)中常見(jiàn)的十個(gè)錯(cuò)誤。我們收集了 FPGA 工程師在其設(shè)計(jì)中犯的 10 個(gè)最常見(jiàn)錯(cuò)誤，并提供了解決方案的建議和替代方案。本文假定讀者已...

2023-05-31 標(biāo)簽：fpga FPGA設(shè)計(jì)RTL 1403 1

Vivado增量編譯的基本概念、優(yōu)點(diǎn)、使用方法以及注意事項(xiàng)

隨著FPGA設(shè)計(jì)的復(fù)雜度不斷提高，設(shè)計(jì)人員需要選擇更為高效的設(shè)計(jì)流程來(lái)保證開(kāi)發(fā)效率和減少開(kāi)發(fā)成本。其中，Vivado增量編譯是一種非常重要的設(shè)計(jì)流程。本...

2023-05-25 標(biāo)簽：fpga FPGA設(shè)計(jì)時(shí)序 5588 0

TFT-LCD電容觸摸屏模塊(RGB接口)驅(qū)動(dòng)時(shí)序設(shè)計(jì)

上兩篇已經(jīng)總結(jié)和分享了RGB接口TFT-LCD觸摸屏的相關(guān)內(nèi)容。本篇使用Verilog語(yǔ)言實(shí)現(xiàn)RGB的驅(qū)動(dòng)時(shí)序。

2023-05-25 標(biāo)簽：lcd 接口觸摸屏 4500 0

Quartus中的邏輯鎖定與增量編譯

邏輯鎖定功能可以將FPGA中的代碼模塊在固定區(qū)域?qū)崿F(xiàn)，優(yōu)化時(shí)序性能，提升設(shè)計(jì)可靠性。增量編譯功能，可以使設(shè)計(jì)更快速時(shí)序收斂，加快編譯速度。

2023-05-25 標(biāo)簽：fpga 布線時(shí)序 2257 0

Lesson38 圖像傳感器介紹與設(shè)計(jì)架構(gòu)

? 圖1 實(shí)驗(yàn)平臺(tái) 視頻內(nèi)容： Lesson38 圖像傳感器介紹與設(shè)計(jì)架構(gòu)（本節(jié)視頻） ??? ● 介紹CCD與CMOS圖像傳感器 ??? ● 圖像傳感...

2023-05-22 標(biāo)簽：接口圖像傳感器時(shí)序 880 0

FPGA時(shí)序邏輯電路寄存器講解

時(shí)序邏輯電路會(huì)復(fù)雜很多，強(qiáng)烈推薦mooc上華中科技大學(xué)的數(shù)字電路與邏輯設(shè)計(jì)，是我看過(guò)講得最清楚的數(shù)電課。

2023-05-14 標(biāo)簽：fpga 寄存器時(shí)序邏輯電路 2930 0

Verilog邊沿檢測(cè)的基本原理和代碼實(shí)現(xiàn)

本文將從Verilog和邊沿檢測(cè)的基本概念入手，介紹Verilog邊沿檢測(cè)的原理和應(yīng)用代碼示例。

2023-05-12 標(biāo)簽：Verilog 數(shù)字信號(hào)時(shí)序 4858 0

一個(gè)典型的流水線設(shè)計(jì)

流水線設(shè)計(jì)通常可以在一定程度上提升系統(tǒng)的時(shí)鐘頻率，因此常常作為時(shí)序性能優(yōu)化的一種常用技巧。如果某個(gè)原本單個(gè)時(shí)鐘周期完成的邏輯功能塊可以進(jìn)一步細(xì)分為若干個(gè)...

2023-05-08 標(biāo)簽：寄存器 Xilinx 流水線 1773 0

FPGA中的fast corner和slow corner介紹

在FPGA的時(shí)序分析頁(yè)面，我們經(jīng)常會(huì)看到`Max at Slow Process Corner`和`Min at Fast Process Corner...

2023-05-05 標(biāo)簽：fpga 時(shí)序 2544 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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庫(kù)文件是計(jì)算機(jī)上的一類文件，提供給使用者一些開(kāi)箱即用的變量、函數(shù)或類。庫(kù)文件分為靜態(tài)庫(kù)和動(dòng)態(tài)庫(kù)，靜態(tài)庫(kù)和動(dòng)態(tài)庫(kù)的區(qū)別體現(xiàn)在程序的鏈接階段：靜態(tài)庫(kù)在程序的鏈接階段被復(fù)制到了程序中；動(dòng)態(tài)庫(kù)在鏈接階段沒(méi)有被復(fù)制到程序中，而是程序在運(yùn)行時(shí)由系統(tǒng)動(dòng)態(tài)加載到內(nèi)存中供程序調(diào)用。使用動(dòng)態(tài)庫(kù)系統(tǒng)只需載入一次，不同的程序可以得到內(nèi)存中相同的動(dòng)態(tài)庫(kù)的副本，因此節(jié)省了很多內(nèi)存，而且使用動(dòng)態(tài)庫(kù)也便于模塊化更新程序。
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Altium Designer 是原Protel軟件開(kāi)發(fā)商Altium公司推出的一體化的電子產(chǎn)品開(kāi)發(fā)系統(tǒng)，主要運(yùn)行在Windows操作系統(tǒng)。這套軟件通過(guò)把原理圖設(shè)計(jì)、電路仿真、PCB繪制編輯、拓?fù)溥壿嬜詣?dòng)布線、信號(hào)完整性分析和設(shè)計(jì)輸出等技術(shù)的完美融合
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感應(yīng)式

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導(dǎo)熱硅脂

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導(dǎo)熱硅脂俗稱散熱膏，導(dǎo)熱硅脂以有機(jī)硅酮為主要原料，添加耐熱、導(dǎo)熱性能優(yōu)異的材料，制成的導(dǎo)熱型有機(jī)硅脂狀復(fù)合物，用于功率放大器、晶體管、電子管、CPU等電子元器件的導(dǎo)熱及散熱，從而保證電子儀器、儀表等的電氣性能的穩(wěn)定。

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