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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>GRNN在FPGA中實現方法研究

      GRNN在FPGA中實現方法研究

      2016-06-22 | pdf | 770KB | 次下載 | 免費

      資料介紹

      為了提高腦機接口（Brain-computer interface ，BCI）中分類算法運行速度，以及減小BCI數字信號處理設備體積，將腦機接口中用于腦電信號分類的廣義回歸神經網絡（General regression neural network ，GRNN）算法經MATLAB仿真之后，在Quartus II 13.0中使用Verilog HDL編程實現基于二進制浮點數運算的GRNN算法，并下載
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