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如何在印制電路設(shè)計(jì)中檢測(cè)丟失的走線和不完整的走線?

PCB打樣 ? 2020-10-30 19:41 ? 次閱讀

不幸的是,電子設(shè)計(jì)程序在生成以下內(nèi)容的Gerber文件之前不會(huì)生成警報(bào):軌道錯(cuò)誤未完成或軌道丟失的卡。在很多情況下,由于其極其簡(jiǎn)單,我們?cè)谠O(shè)計(jì)PCB時(shí)并未將其鏈接到原理圖。如果我們?cè)诓徊扇∪魏晤A(yù)防措施的情況下選擇此程序,則有可能在設(shè)計(jì)結(jié)束時(shí)發(fā)現(xiàn)一些線索,這些線索可能由于遺忘或由于我們刪除了一個(gè)組件而將其替換為另一個(gè)組件或由于某種原因而中止了繪制軌跡的過(guò)程而留下了線索一個(gè)沒(méi)有連接的情況,后來(lái)我們從另一層繼續(xù)跟蹤,忘記了程序不會(huì)在跟蹤開(kāi)始時(shí)自動(dòng)插入跟蹤。

使用以下實(shí)用方法,可以檢測(cè)并糾正一端沒(méi)有連接到任何東西但其末端與位于另一層的另一條軌道的起點(diǎn)重合的軌道,這導(dǎo)致了一個(gè)假設(shè),即它是同一信號(hào)并且連接它們的路徑丟失了。以同樣的方式,我們將能夠檢測(cè)到一條未在任何軌道或墊上結(jié)束且在另一層上沒(méi)有對(duì)應(yīng)關(guān)系的軌道,這使我們認(rèn)為只有該軌道丟失了。在這種情況下,我們肯定會(huì)檢查卡的整個(gè)設(shè)計(jì),因?yàn)榭隙ㄓ腥鄙倬€索可以完成您的生產(chǎn)線。

說(shuō)明:

l我們?cè)谠O(shè)計(jì)程序中為卡片的TOPBOTTOMPads層選擇黑色。

l根據(jù)電路的大小,我們以兩倍或更大的比例在紙的TOP面(包括焊盤和走線)上打印。

l在電路的底部(包括焊盤和走線)以相同的比例在另一張紙上打印。

l如果我們目視檢查,我們可以輕松地檢測(cè)到?jīng)]有終止的軌跡,即它們沒(méi)有連接到另一條軌跡,墊或銅質(zhì)平面。

l讓我們疊加兩個(gè)打印件,如果可能,在光源的幫助下,翻閱紙張以確認(rèn)信號(hào)的對(duì)應(yīng)關(guān)系。在說(shuō)明前一個(gè)圖表的示例中,很明顯,該電路的TOP電路中標(biāo)有紅色指示器的點(diǎn)沒(méi)有連接到指示端的任何一側(cè)。

l動(dòng)畫顯示了當(dāng)重疊兩層時(shí),標(biāo)記為“缺少軌跡”的錯(cuò)誤包含的筆畫在另一點(diǎn)開(kāi)始于另一層的同一點(diǎn)處結(jié)束,這表明僅缺少連接它們的軌跡。

l我們還觀察到,標(biāo)記為“未完成的磁道”的錯(cuò)誤沒(méi)有相同的對(duì)應(yīng)關(guān)系,這表明該磁跡不完整或已遺留,應(yīng)將其擦除以避免混淆。

注意:

強(qiáng)烈建議再次運(yùn)行電氣設(shè)計(jì)規(guī)則(DRC)分析,以檢測(cè)由于在卡上插入新元素而產(chǎn)生的錯(cuò)誤,并另外再次生成所有Gerber文件。

結(jié)論:盡管該程序可以很好地工作,但是建議在設(shè)計(jì)印刷電路時(shí)不從原理圖開(kāi)始,還是花一些時(shí)間在我們要連接的焊盤之間繪制電網(wǎng)并保持其各自的層可見(jiàn),只要有可能,我們就應(yīng)該花時(shí)間設(shè)計(jì)原理圖并在PCB上運(yùn)行設(shè)計(jì)規(guī)則的實(shí)用程序,該程序無(wú)疑會(huì)根據(jù)程序自動(dòng)生成的網(wǎng)絡(luò)來(lái)檢測(cè)不完整的連接,并另外使數(shù)據(jù)層在PCB上可見(jiàn)。尚未如上所述跟蹤的連接。

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