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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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與ASIC相比較,F(xiàn)PGA的競爭優(yōu)勢是什么
日前賽靈思推出最大容量FPGA芯片,阿里達(dá)摩院也發(fā)布了關(guān)于AI語音的FPGA芯片技術(shù)。FPGA芯片有何特別之處?
基于FPGA的全新DSC并行譯碼器設(shè)計(jì)及理論
采用易于FPGA實(shí)現(xiàn)的歸一化最小和算法,通過選取合適的歸一化因子,將乘法轉(zhuǎn)化成移位和加法運(yùn)算。在高斯白噪聲信道下,仿真該譯碼算法得出最佳的譯碼迭代次數(shù),...
至芯科技為中電51所實(shí)施FPGA企業(yè)內(nèi)訓(xùn)
2020年9月,上海。至芯科技受邀為中國電子科技集團(tuán)公司第五十一研究所的新員工實(shí)施了為期一個(gè)月的FPGA企業(yè)內(nèi)訓(xùn)。 中國電子科技集團(tuán)公司第五十一研究所(...
FPGA動(dòng)態(tài)可重構(gòu)技術(shù)是什么,局部動(dòng)態(tài)可重構(gòu)的時(shí)序問題解決方案
所謂FPGA動(dòng)態(tài)可重構(gòu)技術(shù),就是要對(duì)基于SRAM編程技術(shù)的FPGA實(shí)現(xiàn)全部或部分邏輯資源的動(dòng)態(tài)功能變換。根據(jù)實(shí)現(xiàn)重構(gòu)的面積不同,動(dòng)態(tài)可重構(gòu)技術(shù)又可分為全...
比科奇ORANIC板卡獲行業(yè)大獎(jiǎng),5G小基站部署即將進(jìn)入高性價(jià)比時(shí)代
ORANIC板卡集成了四顆即將上市的PC802芯片,可提供四個(gè)25G以太網(wǎng)SFP連接器,從而可以通過eCPRI/Open Fronthaul前傳來支持多...
利用AN3485模塊實(shí)現(xiàn)RS422接口數(shù)據(jù)傳輸
本章利用AN3485模塊實(shí)現(xiàn)RS422接口數(shù)據(jù)傳輸。關(guān)于模塊,在前面的RS232實(shí)驗(yàn)中已經(jīng)介紹過,本實(shí)驗(yàn)不再贅述。RS422與RS232在與FPGA的連...
2022-02-09 標(biāo)簽:fpga 3603 0
如何在Altera FPGA中使用FIFO實(shí)現(xiàn)功能設(shè)計(jì)?
一:fifo是什么 FIFO的完整英文拼寫為FirstIn First Out,即先進(jìn)先出。FPGA或者ASIC中使用到的FIFO一般指的是對(duì)數(shù)據(jù)的存儲(chǔ)...
要做一名合格的FPGA工程師,需要從底層做起,從語法、模塊編寫、工程搭建、系統(tǒng)開發(fā)與驗(yàn)證、資源評(píng)估和性能優(yōu)化、平臺(tái)和架構(gòu)設(shè)計(jì),到系統(tǒng)級(jí)的軟硬件全棧能力,...
基于FPGA的短波通信接收機(jī)及其具體實(shí)現(xiàn)方案詳解
短波通信又稱高頻通信,是利用HF波段(3-30MHz)電磁波進(jìn)行的無線電通信。短波通信主要靠天波傳播,可經(jīng)電離層一次或數(shù)次反射,最遠(yuǎn)可傳至上萬里,如按氣...
2018-10-30 標(biāo)簽:FPGA 3593 0
FPGA設(shè)計(jì)示例:多電源系統(tǒng)的監(jiān)控和時(shí)序控制
現(xiàn)今,電子系統(tǒng)往往具有許多不同的電源軌。在采用模擬電路和微處理器、DSP、ASIC、FPGA的系統(tǒng)中,尤其如此。為實(shí)現(xiàn)可靠、可重復(fù)的操作,必須監(jiān)控各...
2012-04-20 標(biāo)簽:FPGA電源監(jiān)控時(shí)序控制 3592 0
FPGA龍頭公司日益強(qiáng)大 需堅(jiān)持走自主可控+自主創(chuàng)新這條路
在英特爾于最近發(fā)布10納米Agilex,加上Xilinx早前推出7nm ACAP平臺(tái)之后,F(xiàn)PGA兩大龍頭已經(jīng)不約而同跨入了一個(gè)不同的世代。這種不同不僅...
Vivado中DDRX控制器(mig)ip核配置中關(guān)于命令序號(hào)選擇和地址映射說明
本篇主要討論Vivado中DDRX控制器(mig)ip核配置中關(guān)于命令序號(hào)選擇和地址映射說明(一) 利用Xilinx 7系列FPGA開發(fā)時(shí),經(jīng)常需要驅(qū)動(dòng)...
隨著現(xiàn)代電子技術(shù)的發(fā)展,F(xiàn)PGA具有系統(tǒng)結(jié)構(gòu)和邏輯單元靈活、集成度高以及適用范圍寬等特點(diǎn),可以很好地解決這個(gè)難題。
2023年全國大學(xué)生集成電路創(chuàng)新競賽紫光同創(chuàng)賽道正式啟動(dòng)
競賽背景? ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? 逐夢芯時(shí)代,青春正當(dāng)燃。由工業(yè)和信息化部人才交流中心主辦,紫...
詳解基于SOPC多波形信號(hào)發(fā)生器設(shè)計(jì)
隨著現(xiàn)代電子技術(shù)和大規(guī)模集成電路的發(fā)展,DDS技術(shù)是一種新穎的頻率合成技術(shù),并得到了飛速的發(fā)展,已成為最重要的頻率合成技術(shù),其具有易于控制、相位連續(xù)、輸...
2021-05-02 標(biāo)簽:fpgasopc信號(hào)發(fā)生器 3583 0
保持FPGA設(shè)計(jì)信號(hào)不被綜合的方法
在一些應(yīng)用中,有些特定的信號(hào)我們需要保留,用于進(jìn)行采集檢測,而綜合器會(huì)自動(dòng)優(yōu)化把它綜合掉,那么,應(yīng)該怎樣告訴綜合器,不讓它優(yōu)化掉我們需要保留的信號(hào)呢?
2020-09-26 標(biāo)簽:fpgaFPGA設(shè)計(jì) 3583 0
在SpinalHDL中如何優(yōu)雅地實(shí)現(xiàn)寄存器總線讀寫
在SpinalHDL里,其Libraries里提供了關(guān)于總線相關(guān)的庫。包含AMBA3、AMBA4、AVALON等總線類型,并提供了bus slave f...
全球半導(dǎo)體市場格局已成三足鼎立之勢,ASIC (Application Specific Integrated Circuits,專用集成電路)、AS...
FPGA 自上世紀(jì) 80 年代進(jìn)入市場以來,就與通用 CPU、ASIC 乃至 GPU 競爭共存。FPGA 的低功耗、可編程、規(guī)格適中等特性,使其在市場中...
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