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      標(biāo)簽　>　fifo

      fifo

      +關(guān)注3人關(guān)注

      First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

      文章：264個 瀏覽：44557次 帖子：776個

      fifo技術(shù)

      FPGA算法技術(shù)交流問答集錦

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      有用過xilinx FIFO的first word fall through模式，然后write data count會少2個計(jì)數(shù)的嗎？

      2023-06-12 標(biāo)簽：fpgaXilinxfifo 961 0

      FIFO漫談之異步FIFO空滿信號的產(chǎn)生位置

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      2024-03-19 標(biāo)簽：fifo格雷碼時鐘域 955 0

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      2023-02-22 標(biāo)簽：芯片接收器FIFO 948 0

      使用IP核創(chuàng)建單時鐘FIFO

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      FIFO，先進(jìn)先出。在FPGA中使用的FIFO一般是指對數(shù)據(jù)的存儲具有先進(jìn)先出的緩沖器，F(xiàn)IFO與普通的存儲器的不同在于它沒有讀寫地址線。舉個例子，當(dāng)F...

      2023-07-23 標(biāo)簽：傳感器fifo時鐘 945 0

      隊(duì)列管理電路-下篇

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      前文聊了隊(duì)列管理的幾種典型電路，硬件邏輯簡單，代碼實(shí)現(xiàn)時容易操作。鏈表也是隊(duì)列管理的常用電路，相比前文的幾種結(jié)構(gòu)，會稍微復(fù)雜一些。

      2023-01-21 標(biāo)簽：管理電路fifo代碼 943 0

      Linux管道和FIFO應(yīng)用筆記

      從上圖可以看出，可以將管道看成是一組水管，它允許數(shù)據(jù)從一個進(jìn)程流向另一個進(jìn)程，這也是管道名稱的由來。

      2023-03-13 標(biāo)簽：Linuxfifo命令 940 0

      分享一個嵌入式通用FIFO環(huán)形緩沖區(qū)實(shí)現(xiàn)庫

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      開源項(xiàng)目ringbuff ，是一款通用FIFO環(huán)形緩沖區(qū)實(shí)現(xiàn)的開源庫，作者M(jìn)aJerle，遵循 MIT 開源許可協(xié)議。

      2024-10-23 標(biāo)簽：緩沖區(qū)嵌入式fifo 938 0

      適用于低功耗信號鏈應(yīng)用的功率優(yōu)化技術(shù)

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      本文介紹用于在低功耗信號鏈應(yīng)用中實(shí)現(xiàn)優(yōu)化能效比的精密低功耗信號鏈解決方案和技術(shù)。本文將介紹功耗調(diào)節(jié)、功率循環(huán)和占空比等用于進(jìn)一步降低系統(tǒng)功耗的技術(shù)（不僅...

      2023-06-13 標(biāo)簽：放大器adcFIFO 901 0

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      為了達(dá)到可靠的數(shù)據(jù)傳輸，借助存儲器來完成跨時鐘域通信也是很常用的手段。在早期的跨時鐘域設(shè)計(jì)中，在兩個處理器間添加一個雙口RAM或者FIFO來完成相互間的...

      2020-03-03 標(biāo)簽：存儲器ramfifo 896 0

      使用SVA的幾個好處

      SVA支持多時鐘域（clock domain crossing (CDC)）邏輯，例如異步FIFO。 2. SVA是一種描述語言，可讀性比較強(qiáng)。

      2023-03-21 標(biāo)簽：fifoCDC異步 893 0

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      Video In to AXI4-Stream IP核用于將視頻源(帶有同步信號的時鐘并行視頻數(shù)據(jù)，即同步sync或消隱blank信號或者而后者皆有)轉(zhuǎn)...

      2025-04-03 標(biāo)簽：接口Xilinxfifo 858 0

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      2023-05-08 標(biāo)簽：cpufifo串口 847 0

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      又到了一年一度的招聘季節(jié)，有粉絲私信問了一個問題，一個關(guān)于以前流傳出來的大廠面試的題目，個人覺得算是比較經(jīng)典的題目，也是工作中經(jīng)常遇到的一個問題，所以準(zhǔn)...

      2023-10-01 標(biāo)簽：fifo信號時鐘域 830 0

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      2024-10-25 標(biāo)簽：FPGAIC設(shè)計(jì)fifo 803 0

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      FIFO_Generator是智多晶設(shè)計(jì)的一款通用型FIFO IP。當(dāng)前發(fā)布的FIFO_Generator IP是2.0版本，相比之前的1.1版本主要新...

      2025-04-25 標(biāo)簽：IPfifo時鐘 802 0

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      我們說這個結(jié)構(gòu)之所以使得FIFO的輸出Q在讀完SRAM之后保持穩(wěn)定，其實(shí)需要SRAM本身可以保持RDATA在讀操作之后的多個周期保持穩(wěn)定。即SRAM本身...

      2023-05-04 標(biāo)簽：sramfifo 789 0

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      AXI接口FIFO是從Native接口FIFO派生而來的。AXI內(nèi)存映射接口提供了三種樣式：AXI4、AXI3和AXI4-Lite。除了Native接口...

      2025-03-17 標(biāo)簽：接口fifo總線 753 0

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        Protues
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        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時鐘源
        時鐘源
        +關(guān)注
        時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英 晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • AD采樣
        AD采樣
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