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門(mén)級(jí)電路

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門(mén)級(jí)電路技術(shù)

什么是數(shù)字后仿？淺談芯片數(shù)字后仿的那些事

這是相對(duì)于數(shù)字前仿來(lái)說(shuō)的。從概念上來(lái)說(shuō)，數(shù)字驗(yàn)證包含兩方面的內(nèi)容，數(shù)字前仿和數(shù)字后仿。

2023-03-15 標(biāo)簽：寄存器 EDA工具 RTL 1.1萬(wàn) 0

多輸入門(mén)、多輸出門(mén)和三態(tài)門(mén)詳解

門(mén)級(jí)建模，是使用基本的邏輯單元，例如與門(mén)，與非門(mén)等，進(jìn)行更低級(jí)抽象層次上的設(shè)計(jì)。與行為級(jí)建模相比，門(mén)級(jí)建模更注重硬件的實(shí)現(xiàn)方法，即通過(guò)連接一些基本門(mén)電路...

2023-03-30 標(biāo)簽：Verilog 三態(tài)門(mén)門(mén)控時(shí)鐘 7609 0

門(mén)級(jí)電路低功耗設(shè)計(jì)優(yōu)化案例分析

門(mén)級(jí)電路的功耗優(yōu)化(Gate Level Power Optimization，簡(jiǎn)稱GLPO)是從已經(jīng)映射的門(mén)級(jí)網(wǎng)表開(kāi)始，對(duì)設(shè)計(jì)進(jìn)行功耗的優(yōu)化以滿足功耗...

2020-07-02 標(biāo)簽：晶體管電壓設(shè)計(jì)門(mén)級(jí)電路 6278 0

門(mén)延遲類型介紹

前兩節(jié)中所介紹的門(mén)級(jí)電路都是沒(méi)有延遲的，實(shí)際門(mén)級(jí)電路都是有延遲的。

2023-03-30 標(biāo)簽：仿真信號(hào)Verilog 3390 0

在計(jì)算機(jī)芯片里面實(shí)現(xiàn)1+1=2的過(guò)程

在計(jì)算機(jī)中，CPU作為中央處理器，內(nèi)部包含了算術(shù)邏輯單元，可以實(shí)現(xiàn)數(shù)學(xué)運(yùn)算。要計(jì)算1+1=2，就需要從微架構(gòu)級(jí)、邏輯門(mén)級(jí)、晶體管級(jí)、物理級(jí)等方面進(jìn)行分析。

2023-04-27 標(biāo)簽：處理器 CMOS 晶體管 2820 0

重點(diǎn)介紹所有綜合編譯器都支持的for和repeat循環(huán)

循環(huán)語(yǔ)句允許多次執(zhí)行編程語(yǔ)句或begin-end語(yǔ)句組。SystemVerilog中的循環(huán)語(yǔ)句有：for、repeat、while、do..while、...

2022-11-03 標(biāo)簽：Verilog 編譯器門(mén)級(jí)電路 2708 0

RTL時(shí)序邏輯的綜合要求

數(shù)字門(mén)級(jí)電路可分為兩大類：組合邏輯和時(shí)序邏輯。鎖存器是組合邏輯和時(shí)序邏輯的一個(gè)交叉點(diǎn)，在后面會(huì)作為單獨(dú)的主題處理。

2023-01-13 標(biāo)簽：RAM RTL 觸發(fā)器 2611 0

認(rèn)識(shí)一下幾個(gè)常用的門(mén)級(jí)電路

標(biāo)準(zhǔn)單元庫(kù)是數(shù)字集成電路的積木，是復(fù)雜電路和系統(tǒng)的基礎(chǔ)。今天我們來(lái)認(rèn)識(shí)一下其中的幾個(gè)常用門(mén)級(jí)電路。

2023-10-09 標(biāo)簽：Verilog語(yǔ)言門(mén)級(jí)電路 2566 0

探討always和always_ff的編碼風(fēng)格

2023-02-03 標(biāo)簽：鎖存器 RTL Verilog語(yǔ)言 2129 0

什么是Logic Synthesis？Synthesis的流程

什么是Logic Synthesis？Logic Synthesis用于將輸入的高級(jí)語(yǔ)言描述（如HDL、verilog）轉(zhuǎn)換為門(mén)級(jí)電路的網(wǎng)絡(luò)表示。

2023-10-24 標(biāo)簽：電源噪聲時(shí)序約束 HDL語(yǔ)言 2004 0

門(mén)級(jí)電路帖子

門(mén)級(jí)電路資料下載

Verilog HDL硬件描述語(yǔ)言_門(mén)電平模型化立即下載

類別：FPGA/ASIC 2016-04-25 標(biāo)簽：建模 Verilog HDL 門(mén)級(jí)電路 672 0

門(mén)級(jí)電路資訊

怎樣分析PLD（可編程器件）邏輯綜合結(jié)果是否正確呢

Quarus Ⅱ工具提供四種手段分析邏輯綜合結(jié)果，包括：RTL Viewer、Technology Viewer、PowerPlay Power Ana...

2022-08-25 標(biāo)簽：PLD RTL 可編程器件 1798 0

門(mén)級(jí)電路數(shù)據(jù)手冊(cè)

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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識(shí)別

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FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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