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簡介：FPGA 異步時鐘設(shè)計中如何避免亞穩(wěn)態(tài)的產(chǎn)生是一個必須考慮的問題。本文介紹了FPGA 異步時鐘設(shè)計中容易產(chǎn)生的亞穩(wěn)態(tài)現(xiàn)象及其可能造成的危害,同時根據(jù)實踐經(jīng)驗給出了解決這些問題的幾種同步策略。
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