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使用轉(zhuǎn)換循環(huán)模塊快速創(chuàng)建低抖動(dòng)、高頻時(shí)鐘

1774288 2022-11-24 | pdf | 331.71KB | 次下載 | 免費(fèi)

資料介紹

儀器儀表和測(cè)量系統(tǒng)的設(shè)計(jì)人員需要低抖動(dòng)、無(wú)雜散的信號(hào)，以便提供滿足日益苛刻的客戶(hù)要求所需的信噪比 (SNR) 或誤差矢量幅度 (EVM)。同時(shí)，他們還面臨著減少電路板占用空間以及設(shè)計(jì)成本和復(fù)雜性的巨大壓力。后者對(duì)于縮短開(kāi)發(fā)時(shí)間以滿足縮短的上市時(shí)間窗口至關(guān)重要。儀器儀表和測(cè)量系統(tǒng)的設(shè)計(jì)人員需要低抖動(dòng)、無(wú)雜散的信號(hào)，以便提供滿足日益苛刻的客戶(hù)要求所需的信噪比 (SNR) 或誤差矢量幅度 (EVM)。同時(shí)，他們還面臨著減少電路板占用空間以及設(shè)計(jì)成本和復(fù)雜性的巨大壓力。后者對(duì)于縮短開(kāi)發(fā)時(shí)間以滿足縮短的上市時(shí)間窗口至關(guān)重要。為了應(yīng)對(duì)眾多應(yīng)用挑戰(zhàn)，工程師需要將他們的儀器儀表和測(cè)量時(shí)鐘解決方案從定制的傳統(tǒng)分立設(shè)計(jì)轉(zhuǎn)變?yōu)楦蛹傻慕鉀Q方案。朝著這個(gè)方向邁出的重要一步是使用集成平移鎖相環(huán) (PLL)。這允許對(duì)傳統(tǒng)壓控振蕩器 (VCO) 信號(hào)進(jìn)行頻率上變頻，同時(shí)基本保持固定外部本地振蕩器 (LO) 的抖動(dòng)和相位噪聲。為了應(yīng)對(duì)眾多應(yīng)用挑戰(zhàn)，工程師需要將他們的儀器儀表和測(cè)量時(shí)鐘解決方案從定制的傳統(tǒng)分立設(shè)計(jì)轉(zhuǎn)變?yōu)楦蛹傻慕鉀Q方案。朝著這個(gè)方向邁出的重要一步是使用集成平移鎖相環(huán) (PLL)。這允許對(duì)傳統(tǒng)壓控振蕩器 (VCO) 信號(hào)進(jìn)行頻率上變頻，同時(shí)基本保持固定外部本地振蕩器 (LO) 的抖動(dòng)和相位噪聲。本文討論了轉(zhuǎn)換環(huán)路在實(shí)現(xiàn)業(yè)界最低集成相位噪聲方面的作用。例如，它介紹了Analog Devices的本文討論了轉(zhuǎn)換環(huán)路在實(shí)現(xiàn)業(yè)界最低集成相位噪聲方面的作用。例如，它介紹了Analog Devices的ADF4401AADF4401A轉(zhuǎn)換環(huán)路系統(tǒng)級(jí)封裝 (TL SiP)，并展示了它如何通過(guò)具有亞 10 飛秒 (fs) rms 寬帶集成抖動(dòng)能力和增強(qiáng)隔離的輸出信號(hào)來(lái)滿足性能要求衰減雜散元件，同時(shí)滿足設(shè)計(jì)人員的集成、成本、復(fù)雜性和上市時(shí)間需求。轉(zhuǎn)換環(huán)路系統(tǒng)級(jí)封裝 (TL SiP)，并展示了它如何通過(guò)具有亞 10 飛秒 (fs) rms 寬帶集成抖動(dòng)能力和增強(qiáng)隔離的輸出信號(hào)來(lái)滿足性能要求衰減雜散元件，同時(shí)滿足設(shè)計(jì)人員的集成、成本、復(fù)雜性和上市時(shí)間需求。傳統(tǒng) PLL 與轉(zhuǎn)換循環(huán)操作傳統(tǒng) PLL 與轉(zhuǎn)換循環(huán)操作轉(zhuǎn)換環(huán)路的主要目的是生成鎖定到輸入?yún)⒖夹盘?hào)的輸出信號(hào)，與傳統(tǒng) PLL 相比，帶內(nèi)相位噪聲顯著降低。轉(zhuǎn)換環(huán)路的主要目的是生成鎖定到輸入?yún)⒖夹盘?hào)的輸出信號(hào)，與傳統(tǒng) PLL 相比，帶內(nèi)相位噪聲顯著降低。標(biāo)準(zhǔn) PLL 由一個(gè)反饋系統(tǒng)組成，該反饋系統(tǒng)包含鑒頻鑒相器 (PFD)、電荷泵、低通濾波器 (LPF)、VCO 和反饋分頻器 N（圖 1）。標(biāo)準(zhǔn) PLL 由一個(gè)反饋系統(tǒng)組成，該反饋系統(tǒng)包含鑒頻鑒相器 (PFD)、電荷泵、低通濾波器 (LPF)、VCO 和反饋分頻器 N（圖 1）。圖 1：標(biāo)準(zhǔn) PLL 鎖定到較低頻率 (F 圖 1：標(biāo)準(zhǔn) PLL 鎖定到較低頻率 (F PFDPFD ) 參考并生成輸出頻率 (F