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如何設(shè)置CTLE模擬以優(yōu)化接收器眼圖開度

Xilinx視頻 ? 來源:郭婷 ? 2018-11-28 06:14 ? 次閱讀

了解UltraScale IO中新的連續(xù)時間線性均衡器(CTLE)如何幫助設(shè)計DDR4和SGMII等高速接口。 您還將學(xué)習(xí)如何設(shè)置CTLE模擬以優(yōu)化接收器眼圖開度。

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