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NVMe IP高速傳輸卻不依賴XDMA設(shè)計(jì)之五:DMA 控制單元設(shè)計(jì)

高速傳輸與存儲(chǔ) ? 2025-07-02 19:47 ? 次閱讀
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DMA 控制單元負(fù)責(zé)控制 DMA 傳輸事務(wù), 該單元承擔(dān)了 DMA 事務(wù)到 NVMe 事務(wù)的轉(zhuǎn)換任務(wù), 使用戶對(duì)數(shù)據(jù)傳輸事務(wù)的控制更加簡(jiǎn)單快捷。 DMA 控制功能由 DMA寄存器組實(shí)現(xiàn)。

DMA 寄存器組包含 DMA 操作寄存器、 DMA 長(zhǎng)度寄存器、 DMA 源目的地址寄存器和 DMA 狀態(tài)寄存器。 DMA 操作寄存器定義了 DMA 請(qǐng)求類(lèi)型, 包括寫(xiě)和讀操作; DMA 長(zhǎng)度寄存器定義了 DMA 請(qǐng)求的數(shù)據(jù)傳輸長(zhǎng)度, 該長(zhǎng)度以 NVMe 設(shè)備邏輯塊大小為單位; DMA 源地址和 DMA 目的地址寄存器定義了 DMA 請(qǐng)求的源數(shù)據(jù)存放的起始地址和數(shù)據(jù)傳輸?shù)哪康牡刂罚?DMA 狀態(tài)寄存器定義了當(dāng)前待運(yùn)行的 DMA請(qǐng)求數(shù)量和 DMA 請(qǐng)求執(zhí)行狀態(tài)信息。 DMA 寄存器組定義如表 1 所示, 其中 DMA

狀態(tài)寄存器定義如表 2 所示。

表 1 DMA 寄存器組定義

表 2 DMA狀態(tài)寄存器定義

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    發(fā)表于 07-05 22:03

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    的頭像 發(fā)表于 04-16 14:57 ?400次閱讀
    <b class='flag-5'>NVMe</b> <b class='flag-5'>IP</b> over PCIe 4.0:擺脫<b class='flag-5'>XDMA</b>,實(shí)現(xiàn)超<b class='flag-5'>高速</b>!

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    的頭像 發(fā)表于 06-09 17:25 ?287次閱讀
    <b class='flag-5'>NVMe</b> <b class='flag-5'>IP</b><b class='flag-5'>高速</b><b class='flag-5'>傳輸</b><b class='flag-5'>卻不依賴</b><b class='flag-5'>XDMA</b>設(shè)計(jì)之二:PCIe讀寫(xiě)邏輯

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    的頭像 發(fā)表于 06-29 17:46 ?586次閱讀
    <b class='flag-5'>NVMe</b> <b class='flag-5'>IP</b><b class='flag-5'>高速</b><b class='flag-5'>傳輸</b><b class='flag-5'>卻不依賴</b><b class='flag-5'>XDMA</b>設(shè)計(jì)之三:系統(tǒng)架構(gòu)

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    的頭像 發(fā)表于 06-29 17:52 ?105次閱讀
    <b class='flag-5'>NVMe</b> <b class='flag-5'>IP</b><b class='flag-5'>高速</b><b class='flag-5'>傳輸</b><b class='flag-5'>卻不依賴</b><b class='flag-5'>XDMA</b>設(shè)計(jì)<b class='flag-5'>之</b>四:系統(tǒng)<b class='flag-5'>控制</b>模塊

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    的頭像 發(fā)表于 07-02 19:49 ?141次閱讀
    <b class='flag-5'>NVMe</b> <b class='flag-5'>IP</b><b class='flag-5'>高速</b><b class='flag-5'>傳輸</b><b class='flag-5'>卻不依賴</b><b class='flag-5'>XDMA</b>設(shè)計(jì)<b class='flag-5'>之</b>六:性能監(jiān)測(cè)<b class='flag-5'>單元</b>設(shè)計(jì)