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DDR4已經(jīng)OUT Cadence宣布DDR5全新進(jìn)展

jXID_bandaotigu ? 來源:未知 ? 作者:胡薇 ? 2018-05-11 11:48 ? 次閱讀

DDR4內(nèi)存目前還是絕對(duì)主流,不斷被深入挖潛,頻率已經(jīng)突破5GHz,不過下一代DDR5也已經(jīng)蠢蠢欲動(dòng)了。Cadence公司今天就宣布了DDR5的全新進(jìn)展,無論工藝還是頻率都相當(dāng)領(lǐng)先。

目前,JEDEC標(biāo)準(zhǔn)組織正在研究下一代DDR5內(nèi)存規(guī)范,已經(jīng)有了初步版本,Cadence此番拿出的就是面向新規(guī)范的第一個(gè)DDR5 IP物理層接口芯片。

該測試芯片采用臺(tái)積電7nm工藝制造,數(shù)據(jù)率可達(dá)4400MT/s,也就是頻率高達(dá)4400MHz,相比目前商用最快的DDR4-3200快了多達(dá)37.5%。

為了支持Cadence DDR5 PHY物理層的驗(yàn)證和協(xié)作,美光也向其提供了DDR5內(nèi)存初步版本的工程原型。

在此之前,Rambus也曾經(jīng)提到過7nm工藝下的DDR5 IP,并預(yù)計(jì)DDR5內(nèi)存要到2020年才會(huì)商用,首批自然還是服務(wù)器和數(shù)據(jù)中心,消費(fèi)級(jí)就更靠后了。

值得一提的是,AMD曾保證說現(xiàn)在的AM4接口會(huì)一直支持到2020年,到時(shí)候極可能就會(huì)更換新接口,加入對(duì)DDR5的支持。

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原文標(biāo)題:飛一般的DDR5內(nèi)存來了!DDR4頓時(shí)泄氣

文章出處:【微信號(hào):bandaotiguancha,微信公眾號(hào):半導(dǎo)體觀察IC】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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