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CKS32F107xx系列時鐘系統(tǒng)具體配置方法講解

中科芯MCU ? 來源:中科芯MCU ? 2024-05-28 10:05 ? 次閱讀

CKS32F107xx系列時鐘系統(tǒng)(二)

上一章節(jié)對CKS32F107xx系列時鐘做了整體介紹,本章節(jié)以使用HSI內(nèi)部高速時鐘為例對時鐘具體配置方法進行講解。

620e8914-1c94-11ef-b74b-92fbcf53809c.png

圖1 SYSCLK生成流程

622d4b38-1c94-11ef-b74b-92fbcf53809c.png

圖2 APB頻率生成流程

根據(jù)圖1,產(chǎn)生SYSCLK時,內(nèi)部HSI時鐘經(jīng)過二分頻,輸入PLLSCR模塊,再通過PLLM倍頻系數(shù)產(chǎn)生PLLCLK,即SYSCLK。

由圖2可知,SYSCLK通過AHB預(yù)分頻產(chǎn)生APB即HCLK等時鐘系統(tǒng)。

配置寄存器

CKS32F107xx系列時鐘配置寄存器

在使用HSI對系統(tǒng)時鐘進行配置時,有兩個較為重要的RCC寄存器,分別為RCC_CR、RCC_CFGR:

6282725c-1c94-11ef-b74b-92fbcf53809c.png

圖3 RCC_CR寄存器

在RCC_CR寄存器中,我們需要關(guān)注如下幾位:

62ac3060-1c94-11ef-b74b-92fbcf53809c.png

圖4 HSI啟動及狀態(tài)寄存器

62cb092c-1c94-11ef-b74b-92fbcf53809c.png

圖5 PLL啟動及狀態(tài)寄存器

62f33f3c-1c94-11ef-b74b-92fbcf53809c.png

圖6 RCC_CFGR寄存器

在RCC_CFGR寄存器中,我們需要關(guān)注如下幾位:

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圖7PLL倍頻系數(shù)位

632e22fa-1c94-11ef-b74b-92fbcf53809c.png

圖8PLL時鐘源位

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圖9 APB2預(yù)分頻位

63abe2b2-1c94-11ef-b74b-92fbcf53809c.png

圖10 其他RCC_CFGR控制位

在對系統(tǒng)時鐘進行初始化過程中,一般也會對閃存訪問時間進行配置,如下為CKS32F107xx系列閃存訪問時間與系統(tǒng)時鐘的對應(yīng)關(guān)系:

63dc5852-1c94-11ef-b74b-92fbcf53809c.png

圖11 閃存訪問時間

CKS32F107xx系列時鐘配置代碼

依據(jù)上一章節(jié)中對寄存器的基本介紹,即可在函數(shù)SetSysClock()中對程序時鐘進行相關(guān)配置,本文以HSI為時鐘源,進行36MHz SYSCLK/HCLK/APB1/APB2配置。

/* SYSCLK, HCLK, PCLK2 and PCLK1 configuration ---------------------------*/

/* Enable HSI */

RCC->CR |= ((uint32_t)RCC_CR_HSION);

/* Wait till HSI is ready and if Time out is reached exit */

while((RCC->CR & RCC_CR_HSIRDY) == 0){}

/* Enable Prefetch Buffer */

FLASH->ACR |= FLASH_ACR_PRFTBE;

/* Flash 1 wait state */

FLASH->ACR &= (uint32_t)((uint32_t)~FLASH_ACR_LATENCY);

FLASH->ACR |= (uint32_t)FLASH_ACR_LATENCY_1;

/*AHB Prescaler set*/

RCC->CFGR |= (uint32_t)RCC_SYSCLK_Div1;

/* HCLK = SYSCLK */

RCC->CFGR |=(uint32_t)RCC_CFGR_HPRE_DIV1;

/* PCLK2 = HCLK */

RCC->CFGR |= (uint32_t)RCC_CFGR_PPRE2_DIV1;

/* PCLK1 = HCLK */

RCC->CFGR |= (uint32_t)RCC_CFGR_PPRE1_DIV1;

/* PLL configuration: PLLCLK = HSI / 2 * 9 = 36 MHz */

RCC->CFGR &= (uint32_t)~(RCC_CFGR_PLLSRC | RCC_CFGR_PLLMULL);

RCC->CFGR |= (uint32_t)(RCC_CFGR_PLLMULL9);

/* Enable PLL */

RCC->CR |= RCC_CR_PLLON;

/* Wait till PLL is ready */

while((RCC->CR & RCC_CR_PLLRDY) == 0){}

/* Select PLL as system clock source */

RCC->CFGR &= (uint32_t)((uint32_t)~(RCC_CFGR_SW));

RCC->CFGR |= (uint32_t)RCC_CFGR_SW_PLL;

/* Wait till PLL is used as system clock source */

while ((RCC->CFGR & (uint32_t)RCC_CFGR_SWS) != (uint32_t)0x08){}



審核編輯:劉清

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原文標題:MCU微課堂|CKS32F107xx系列時鐘系統(tǒng)(二)

文章出處:【微信號:中科芯MCU,微信公眾號:中科芯MCU】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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