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面向下一代數據中心的全新CXL 3.1控制器IP

Rambus 藍鉑世科技 ? 來源:Rambus 藍鉑世科技 ? 2024-03-12 14:41 ? 次閱讀
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人工智能的快速發展正在引發數據中心的深入變革;計算密集型工作負載對CPU、加速器和存儲之間的低延遲、高帶寬連接提出了前所未有的高要求。Compute?Express?Link(CXL)互連技術為數據中心的性能和效率提升開辟了新的途徑。

面對日益復雜的AI工作負載,數據中心各組件之間的高效通信變得至關重要。CXL通過提供低延遲、高帶寬的連接來滿足這一需求,從而提高整體內存和系統性能。

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數據中心內存面臨的挑戰

CXL?3.1的數據傳輸速率高達64?GT/s并提供多層(網絡連接)交換,可實現高度可擴展的內存池和共享。這些特色功能將成為下一代數據中心的關鍵,既能夠減少高昂的內存成本和閑置的內存資源,又能夠根據需要提供更高的內存帶寬和容量。

Rambus?CXL?3.1控制器IP憑借靈活的設計,適用于ASICFPGA的實現。它采用適用于CXL.io協議的Rambus?PCIe?6.1控制器架構,并且增加了CXL特有的CXL.cache和CXL.mem協議。內置的零延遲完整性和數據加密(IDE)模塊可提供最先進的安全性,防止針對CXL和PCIe鏈路的物理攻擊。這款控制器既可以單獨交付,也可以與客戶選擇的CXL?3.1/PCIe?6.1?PHY集成。

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CXL?3.1?控制器模塊圖

Rambus半導體IP總經理Neeraj?Paliwal表示:“生成式AI和其他高工作負載的性能需求需要由CXL支持的新架構解決方案。Rambus?CXL?3.1數字控制器IP擴大了我們在這一關鍵領域的領先地位,為我們客戶的尖端芯片設計提供了CXL最新演進標準中的吞吐量、可擴展性和安全。

CXL是數據中心的關鍵互連技術,可應對數據密集型工作負載所帶來的諸多挑戰。與Lou?Ternullo一起參加我們即將召開的網絡研討會“挖掘CXL?3.1和PCIe?6.1在下一代數據中心中的潛力”,了解CXL和PCIe互連技術如何幫助設計人員優化數據中心內存基礎設施解決方案。

文章轉載自【天極網】



審核編輯:劉清

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原文標題:【媒體報道】面向下一代數據中心的全新CXL 3.1控制器IP

文章出處:【微信號:Rambus 藍鉑世科技,微信公眾號:Rambus 藍鉑世科技】歡迎添加關注!文章轉載請注明出處。

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