今天一位工程師問了我一個問題，“一個模塊有幾個輸入管腳，V+、V-、signal、Gnd，還有金屬外殼，甲方測試驗收的時候，分別打V+對外殼、V-對外殼，Signal對外殼，Gnd對外殼，打的電壓還挺高，至少幾百伏，有的電路板就給打壞了，問這種打法有問題沒有？是不是還是說明了我們設計的模塊有問題？“

類似的問題，在這一兩年間，在一些大型科研單位里也發生過兩三次。甚至后來都找到了某些GB電氣安全標準的制定人，但也是爭論半天，因為很多標準只是國外標準翻譯過來的，也沒說清真正的依據。知其然，知其所以然，才是治學之道。

那到底應該怎么做呢？為什么這樣做呢？

首先說結論，應該把所有管腳接在一起，然后統一對外殼打耐壓，才是正確的方式。

原因是電路中的某些地方確實是有可能存在絕緣強度的隱患的，最常見的部位之二是DIP封裝的器件Pin腳，在電路板固定后，與金屬板之間的間距小；二是電路板固定安裝孔附近的螺絲與電路板的走線或覆銅層的間距小；當然還有很多其他的地方。

萬一模塊中有這種絕緣阻抗不足的情況時，各腳單獨對外殼打高壓，就容易形成如（圖1）的情況，圖中V+對外殼打耐壓，但電路中的某個pin腳對外殼距離很近，則有可能形成如圖紅線的泄放通路，泄放電流如此之大，器件焉能不壞？如果實際工況中不會有任何距離外殼近的情況發生，即使V+加上了高壓，沒有泄放通路，整塊單板也會處于一個高壓等電位，板上沒有壓差形不成電流，板子也不會壞。

總結成一句話：

如果沒隱患，兩種打法都沒問題；

如果有隱患，則單pin分別對外殼打，則有損傷內部電路的風險。

如果采用了所有輸入引腳接在一起后，統一對外殼打的方式，就算是某些pin腳存在了對外殼的絕緣強度不夠的問題，因為所有輸入管腳的等電位，在電路中的器件自身里內部不易形成放電通路，可以有效地保護器件。

總結成一句：

所有輸入管腳接在一起，對外殼打耐壓，可以遇到有隱患的電路板則可以更好的保護，避免損壞。

當然，可能有杠頭會說一個觀點，如果電路中的某個中間電路的引腳對外殼很近，那V+V-雖然等電位，但會不會兩邊包抄通過這個引腳對外殼放電呢？答案是仍有可能的。不過這種情況發生的概率確實會相對比較低得多。

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