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低成本儀表放大器設計及分析

嵌入式應用開發 ? 來源:嵌入式應用開發 ? 作者:嵌入式應用開發 ? 2023-06-10 20:36 ? 次閱讀

使用儀表放大器的另一好處是,用戶無需構建自己的差分放大器,因此省去了很多高成本的分立器件。本文將提出一種簡單的方法來構建一個低成本儀表放大器并優化其性能。此外,該解決方案的成本和性能與單芯片儀表放大器不相上下。

圖1詳細介紹了所提出的精密系統設計,該設計允許用戶在存在高共模電壓的情況下測量差分信號。該電路包括一個輸入緩沖器、一個ADC驅動器和一個基準電壓源。緩沖器驅動儀表放 大器的參考引腳,并將單端輸出轉換為差分輸出。該電路具有非常高的輸入共模電壓范圍。它可以處理高達±270 V的共模電壓(采用±15 V電源供電),在正負方向幾乎達到電源電壓的20倍,這是電機控制應用的關鍵。此外,還對輸入提供高達±500 V的共?;虿钅K沧儽Wo。

圖1 單端輸入充分輸出放大電路

此應用使用±5 V電源,這樣輸入電壓才能具有±80 V共模范圍。差分輸出由如下公式確定:

共模輸出由如下公式設置:

這個電路的好處是直流差分精度取決于AD629差動放大器和 AD8421儀表放大器,而不是運算放大器或者外部10 kΩ電阻。此外,這個電路充分利用了儀表放大器對其基準電壓相關的輸出電壓的精確控制。雖然運算放大器的直流性能和電阻匹配會影響直流共模輸出精度,但是這些誤差很可能會被信號鏈路上的下一個器件抑制,因此它對整個系統精度的影響將會很小。

為了避免寄生電容使ADA4807不穩定,電阻至反相輸入端之間的走線長度應盡可能短。如果必須使用較長的走線,需使用阻值較低的電阻。高性能ADC通常采用5 V單電源,并具有自身的基準電壓。該基準電壓用作差分輸出的共模電壓,從而無需使用基準電壓源。因此,其輸出與ADC成比例,這意味著ADC的VREF任何變化都不會影響系統的性能。

此差動放大器抑制共模電壓的能力取決于AD629差動放大器內部微調電阻的比例匹配。因此,它比采用分立式放大器的儀表放大器更好。

對于采用0.1%外部電阻的分立式放大器,CMR限制為54 dB。儀表放大器集成了精密的激光微調電阻,使系統的CMR可達到80 dB或更高。這些電阻均采用相同的低漂移薄膜材料制成,因此在一定溫度范圍內可提供出色的比例匹配。

ADC可采用5V單電源供電,參考引腳上有2.5V低阻抗電壓源。這樣可將輸出設為中間電源,并升高ADC輸入端呈現的共模電壓。

示波器輸出波形曲線如圖2所示。兩個儀表放大器的增益均為1。VIN是一個大共模電壓上的1 V pp 10 kHz正弦波。VOUT+和VOUT–分別是±0.5 V pp正弦波和余弦波。VOUT_diff是1 V pp差分輸出電壓,也就是消除共模信號后的VIN。

編輯:黃飛

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