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      基于Vivado下怎么找到關(guān)鍵路徑？

      FPGA技術(shù)驛站 ? 來(lái)源：TeacherGaoFPGAHub ? 作者：TeacherGaoFPGAHub ? 2021-07-06 17:22 ? 次閱讀
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      什么是關(guān)鍵路徑？

      關(guān)鍵路徑分為兩類：一類是時(shí)序違例的路徑，主要是建立時(shí)間違例；

      另一類是時(shí)序沒(méi)有違例，但邏輯級(jí)數(shù)較高的路徑。當(dāng)然，第一類路徑中可能會(huì)包含第二類路徑。

      對(duì)于第一類路徑，其違例的原因無(wú)外乎邏輯延遲太大、線延遲太大或者時(shí)鐘Skew太大等。可以根據(jù)具體原因?qū)ΠY下藥。對(duì)于第二類路徑，其“副作用”比較明顯：

      工具犧牲了其他路徑換取了這類路徑的收斂，最終我們可能會(huì)看到時(shí)序違例的路徑反倒是那些邏輯級(jí)數(shù)很低甚至為0的路徑，而這類路徑通常已經(jīng)沒(méi)有什么優(yōu)化空間了。此時(shí)，要實(shí)現(xiàn)整個(gè)設(shè)計(jì)的時(shí)序收斂就變得捉襟見(jiàn)肘了。

      因此，在設(shè)計(jì)早期找到這類路徑至關(guān)重要。

      編輯：jq

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      原文標(biāo)題：Vivado下如何找關(guān)鍵路徑？

      文章出處：【微信號(hào)：Lauren_FPGA，微信公眾號(hào)：FPGA技術(shù)驛站】歡迎添加關(guān)注！文章轉(zhuǎn)載請(qǐng)注明出處。

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