Vivado下頭文件使用注意事項
本文轉載自： OpenFPGA微信公眾號
頭文件主要使用“文件包括”處理，所謂"文件包含"處理是一個源文件可以將另外一個源文件的全部內容包含進來，即將另外的文件包含到本文件之中。Verilog語言提供了`include命令用來實現"文件包含"的操作。
我在頭文件中定義了一個全局變量如下：
我在使用這個全局變量時，始終提示找不到這個全局變量：
出現這個問題，主要有兩方面原因：
1、頭文件類型需要注意：
其中箭頭部分可以修改類型。
2、引用錯誤：
output reg [WIDTH-1:0] LED;
上面是錯誤的，正確如下：
output reg ['WIDTH-1:0] LED;
其中第一個引起出錯的可能比較小，試過用其他類型（Verilog源文件類型）也不會有問題。
關于文件包含的使用注意以下幾點：
審核編輯：何安
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發表于 07-26 07:21
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