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一款針對Soc開發的硬件仿真進行優化的軟件VARON

電子工程師 ? 來源:FPGA技術支持 ? 作者:FPGA技術支持 ? 2020-09-28 11:03 ? 次閱讀
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VARON是一款針對Soc開發的硬件仿真進行優化的軟件,運行于Cent OS Linux系統,需要有一定的VCS使用基礎,適用于集成度偏高的Soc開發。VARON通過自主研發的IP連接到開發系統,并監視AXI總線上的多種屬性和性能,從而使開發者能夠更直觀的觀測系統的運行情況,從而有針對性的進行優化調整。

背景

1.芯片現狀:

1)許多IP嵌入

2)更復雜的交互

3)準確的性能分析至關重要

2.開發會遇到的問題

1)需要驗證IP用于模擬和仿真,以及豐富的調試工具 2)學習如何使用驗證IP和調試工具是一個很大的挑戰 3)沒有性能分析方面的專業知識,也不知道從哪里開始 4)想用運行軟件調試FPGAASIC芯片的性能,但主要廠商不提供 5)處理大量信號級數據的速度慢 6)用于性能分析工具和工作的總成本很高

3.市面上大多數分析儀

1)性能低下: ①需要驗證IP用于模擬和仿真,以及豐富的調試工具 ②不支持FPGA和ASIC ③處理大量信號級數據的耗時 ④勞動力成本高 2)難以使用: ①手動實施驗證IP ②需要性能分析方面的專業知識,使用有限類型的圖表和使用工具的訣竅

VARON分析儀

1.高性能:

1)一個完整的產品,帶有可配置的片上驗證IP和專有圖形用戶界面 2)支持模擬仿真、FPGA和ASIC

3)專用于事務級數據的性能分析非??焖?/p>

4)勞動成本低,實現時間短

2.易于使用:

1)自動引導驗證IP的配置

2)通過豐富的圖表和工具提示引導分析

VARON的優勢

1.涵蓋LSI設計驗證的整個過程

2.完全可配置的驗證IP滿足用戶需求

1)按端口組進行獨立配置 2)易于分析系統中跨總線級聯的事務

3.針對硬件仿真器進行了優化,以最大限度地提高速度

1)硬件IP將AXI數據緩沖到模擬器 2)監視器和緩沖區都是可綜合的

4.分析時間短,數據處理速度快

1)在事務級別監視AXI 2)快速顯示所有性能圖表,不依賴于設計尺寸

AXI周期 1,000,000 10,000,000
分析時間(秒) 8 95
文件大?。ㄗ止潱?/td> 47,955,968 480,460,800
處理數量 377,007 3,776,145
381,075 3,820,338
數據傳輸總量(字節) 9,186,842 92,111,540
9,291,924 93,326,480

5.通過豐富的性能圖表組合進行非常簡單的分析

1)每個端口組20個圖表 2)通過6種圖表類型了解2個分析目標的5個關鍵設計標準

目標 設計準則 圖表類型 備注
響應時間 按端口或ID列出的延遲 直方圖 延遲分布
最大值/最小值/均值
按端口或ID列出的事務 時間圖 隨著時間的推移,循環準確地映射事務
總線使用效率 按端口或ID列出的數據傳輸總量 圓形分格統計圖表 空閑周期—>總線利用率
條形圖 端口或ID之間的比較
按端口或ID的突發長度 直方圖 突發長度分布
按端口或ID列出的單位時間的數據傳輸量 堆疊時序圖 一段時間內所有端口或所有ID的總數據傳輸量
條形時序圖 每個端口或ID隨時間的數據傳輸量
最大值/最小值/均值
直方圖 數據傳輸量分布

6.工具幫助用戶進行詳細的調試

1)放大/縮小以驗證整體趨勢 2)放大/正常大小,跳轉到時間和工具提示來檢查本地數據

單位時間的數據傳輸量:正常大小(左)、放大(右)

3)水平能夠同步顯示3個時序圖,以在一個時間窗口內驗證相關數據

按條形圖顯示單位時間的數據傳輸量(上)
堆疊視圖顯示單位時間的數據傳輸量(中)
事務時間表(下)

4)找出超出范圍來突出顯示5個圖表中超出預期的數據

延遲直方圖、事務時序圖、堆疊/條形圖時序圖和單位時間數據傳輸周期直方圖

事務時間表(上)
延遲直方圖(下)

5)由圖表設計的工具提示,用于感興趣的詳細數據 ①左鍵單擊出現,右鍵單擊鎖定/移動/刪除 ②上圖例子:

延遲直方圖:在端口0有35個事務,延遲為138–143

事務時序圖:端口0: ID 01事務開始于時間12和145,具有0等待、131訪問(延遲)和8字傳輸

介紹完功能后,下篇文章我們根據實際案例來具體分析。

責任編輯:xj

原文標題:AXI總線高性能分析儀——VARON(一)

文章出處:【微信公眾號:FPGA技術支持】歡迎添加關注!文章轉載請注明出處。

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