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Xilinx公司推出的CoolRunner-II系列中的XC2C128-7V0100。該器件采用第二代快速零功率（FZP）技術，以便在盡可能低的功耗情況下提供最佳的性能，如：采用1．8 V的內核電壓，可提供300 MHz的性能，且耗功小于100μA。另外，該器件還具有體積小，價格低和穩定度高等優點，...
數字下變頻DDC（digital down lonvwrsionl作為系統前端A／D轉換器與后端通用DSP器件間的橋梁，通過降低數據流的速率，將低速數據送給后端通用DSP器件處理，其性能的優劣將對整個軟件無線電系統的穩定性產生直接影響。采用專用DDC器件完成數字下變頻，雖具有抽取比大、性能穩定等優點...
在導彈型號的研制過程中，匹配裝置是用于遙測系統中信號變換的關鍵部件，是彈上所有關鍵部件的信息送到遙測設備的咽喉。匹配裝置的精度和可靠性是影響遙測結果的重要因素。本課題是為遙測匹配裝置自動測試系統提供高精度的信號，用于檢驗匹配裝置自動測試系統的工作情況。...
在數據采集系統中， 常需要進行異步串行數據傳輸，目前廣泛使用的RS232異步串行接口，如8250、NS16450等專用集成芯片，雖然使用簡單，卻有占用電路體積、引腳連接復雜等缺點。SoC（System on Chip，片上系統）是ASIC設計中的新技術，是以嵌入式系統為核心，以IP 復用技術為基礎，...
嵌入式系統是以應用為中心、以計算機技術為基礎、軟件硬件可裁剪、適應應用系統對功能、可靠性、成本、體積、功耗嚴格要求的專用計算機系統，是計算機技術、通信技術、半導體技術、微電子技術、語音圖像數據傳輸技術等先進技術和具體應用對象相結合后的更新換代產品，具有可靠性高，成本低，體積小，功耗少的特點，可廣泛應...
對于國內而言，正如DSP在20年前出現的情形一樣，如今，FPGA正處于數字信號處理技術的前沿。而DSP都是基于一種精簡指令集的計算機體系架構，其固定的硬件結構和數據總線寬度已不適合許多面向用戶型（可重配置型）的DSP應用系統；其速度也受制于CPU的指令順序執行的基本工作模式，這已成為DSP處理器一個...
中壓變頻系統要求產生與分配多路SPWM脈沖，控制實時性要求較高，應用軟件功能復雜，另外還需要控制多路A/D、D/A轉換以及與上位機進行串口通訊輸出控制等外圍器件工作，即使性能最好的單片DSP也難以滿足要求，而片外專用處理器引腳I/O口有限，如果用多片DSP協同工作，都需要與DSP交換數據，這必然會大...
FPGA是新型的可編程邏輯器件，能夠將大量的邏輯功能集成于單個器件中，它所提供的門數從幾百門到上百萬門，符合系統芯片（SOC—System On Chip）的發展要求，具有高度集成、低功耗、硬件升級等優點，可以滿足不同的需要。...
IEEE 802.11標準定義了能夠統籌所有基于以太網的無線通信的協議。它是迄今為止最流行的無線局域網的標準。這個標準還細分了一些子標準， 如802.11a， 802.11b和802.11g。這其中有些協議可使用直接序列擴頻技術（DSSS）來發送無線信號， 如802.11b。 無線局域網帶寬窄，終端...
傳統的測控網是將具有各種功能的儀器通過諸如VXI、CAN等專用總線連接起來構成一套完整的測控系統。現在看來，傳統的測控網主要具有四個方面的不足：一、數據傳輸速率有限；二、傳輸距離有限；三、設備數量有限；四、成本高昂。傳統的測控網已經很難滿足人們對大數據量，遠距離和低成本的要求。...
在科研和工程中，數據采集系統具有很廣泛的應用，針對各類電壓型傳感器輸出的信號伏值不同這種情況，本文提出了一種能夠控制增益的數據采集系統。該系統以FPGA作為邏輯控制核心，選用儀表運算放大器AD623作放大電路，ADG704作為模擬開關，通過對FPGA進行編程配置，控制模擬開關選通不同的電阻，選通電阻...
近年來，可編程邏輯器件在高密度、高速度、低功耗等方面發展很快。在CPLD方面，Xilinx公司推出了高性能、低成本的XC9500［tm］系列，以及在單個器件內結合了極低功耗和高速度、高密度和多I/O引腳特點的CoolRunner［tm］系列。此系列CPLD器件需要的功耗極低，并且價格低廉，從而使其對...
相控陣是通過波控系統控制陣列天線各單元通道的相位、幅度以形成空間波束并控制其方位角和俯仰角。早期的波控系統一般采用硬件電路來實現，這種實現方法的缺點是設備量大，不靈活，很難實現波束的復雜計算，不易滿足特殊要求。后來采用單片機、DSP芯片來設計波控系統，單片機通常不計算波控碼，僅僅是根據接收到的波控碼...
在現代數字通信中， 數據傳輸，時鐘校時等問題中很重要的一個方面是信號的同步。而同步系統中的核心技術就是鎖相環。通常商用的全數字鎖相環（DPLL）的關鍵部件是電荷泵和數字延遲線。電荷泵將數字鑒相器得到的相位差信息以電荷的方式累積起來，并根據積累的電荷量控制數字延遲線的反饋環，從而獲得相應的本地估算時鐘...
本文提出的基于CPLD和單片機相結合的設計方案不僅能較好地解決誤差問題，誤差僅小于等于 0.1HZ，同時還通過對軟硬件界面的科學劃分，在保證性能的基礎上，盡最大可能地簡化了硬件設計的難度。該方法原理圖如圖1所示。其中測頻模塊采用CPLD（Xilinx XC95144）設計完成，其余功能主要由單片機來...
TL_IPC是廣州創龍獨立開發的一種雙核通訊協議，這種開發方式適用于通信邏輯相對簡單的雙核程序的的開發。相較于syslink，它更簡單、直接，依賴更少。DSP端程序運行時可以不再依賴于SYS/BIOS和IPC，ARM端程序運行時不再依賴于syslink。但DSP端程序的燒寫依然借助于syslink提...
本文采用的是ALTERA公司的EP1C6Q240C8型號的FPGA，整個體統采用模塊化設計的思想，將各個模塊用VHDL語言描述出來再進行連接。...
FPGA/CPLD技術是近年來計算機與電子技術領域的又一場新的革命，為了保護知識產權，出現了各種層次的針對FPGA的安全加密技術。常用的方法有：硬件加密法，軟件加密法，可重構加密法等。然而在傳統的許多加密技術中，人們通常能夠通過對代碼的跟蹤、分析和PCB板的復制，而實現硬件和軟件的非法拷貝。為了進一...
近些年來，各種電路功能，包括模擬電路和數字電路，越來越多地用單片集成電路來實現。采用單片集成電路不僅可以有效地提高電路可靠性和其它性能，而且也大大地降低了使用難度。許多單片集成電路的信息輸入和工作控制是通過數字信號實現的。常用的控制器件為微控制器和可編程邏輯器件。...
隨著數字電路技術的發展，特別FPGA技術的普遍應用，采用FPGA實現全數字鎖相環（ADPLL）的應用越來越多。ADPLL設計簡單、應用方便。本文介紹一種采用FPGA實現的ADPLL，該ADPLL用于產生SDH設備的外同步輸出時鐘。該鎖相環具備傳統的APLL的俘獲時間短、有穩定的相差的優點，同時也具備...
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