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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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當(dāng)采用現(xiàn)場(chǎng)可編程門陣列 (FPGA) 進(jìn)行設(shè)計(jì)時(shí),電源排序是需要考慮的一個(gè)重要的方面。通常情況下,F(xiàn)PGA 供應(yīng)商都規(guī)定了電源排序要求,因?yàn)橐粋€(gè)FPGA...
跨時(shí)鐘域之間不能存在組合邏輯。 跨時(shí)鐘域本身就容易產(chǎn)生亞穩(wěn)態(tài),如果在跨時(shí)鐘域之間存在組合邏輯會(huì)大大增加競(jìng)爭(zhēng)冒險(xiǎn)出現(xiàn)的概率。 這一點(diǎn)在實(shí)際設(shè)計(jì)中通常會(huì)因?yàn)?..
FPGA中最常用的還是定點(diǎn)化數(shù)據(jù)處理方法,本文對(duì)定點(diǎn)化數(shù)據(jù)處理方法進(jìn)行簡(jiǎn)要探討,并給出必要的代碼例子。
2023-05-24 標(biāo)簽:FPGA除法運(yùn)算數(shù)據(jù)處理 3760 0
FPGA AXI4協(xié)議學(xué)習(xí)筆記(三)
上文FPGA IP之AXI4協(xié)議1_信號(hào)說(shuō)明把AXI協(xié)議5個(gè)通道的接口信息做了說(shuō)明,本文對(duì)上文說(shuō)的信號(hào)進(jìn)行詳細(xì)說(shuō)明。
FPGA AXI4協(xié)議學(xué)習(xí)筆記(二)
上文FPGA IP之AXI4協(xié)議1_協(xié)議構(gòu)架對(duì)協(xié)議框架進(jìn)行了說(shuō)明,本文對(duì)AXI4接口的信號(hào)進(jìn)行說(shuō)明。
并行FIR濾波器MATLAB與FPGA實(shí)現(xiàn)
本文介紹了設(shè)計(jì)濾波器的FPGA實(shí)現(xiàn)步驟,并結(jié)合杜勇老師的書籍中的并行FIR濾波器部分進(jìn)行一步步實(shí)現(xiàn)硬件設(shè)計(jì),對(duì)書中的架構(gòu)做了復(fù)現(xiàn)以及解讀,并進(jìn)行了仿真驗(yàn)證。
串行FIR濾波器MATLAB與FPGA實(shí)現(xiàn)
本文介紹了設(shè)計(jì)濾波器的FPGA實(shí)現(xiàn)步驟,并結(jié)合杜勇老師的書籍中的串行FIR濾波器部分進(jìn)行一步步實(shí)現(xiàn)硬件設(shè)計(jì),對(duì)書中的架構(gòu)做了簡(jiǎn)單的優(yōu)化,并進(jìn)行了仿真驗(yàn)證。
FPGA常用運(yùn)算模塊-DDS信號(hào)發(fā)生器
本文是本系列的第六篇,本文主要介紹FPGA常用運(yùn)算模塊-DDS信號(hào)發(fā)生器,xilinx提供了相關(guān)的IP以便于用戶進(jìn)行開(kāi)發(fā)使用。
在推斷更大的網(wǎng)絡(luò)時(shí)如何解決計(jì)算復(fù)雜性增加的問(wèn)題
量化是權(quán)重或激活(每層的輸入和輸出)中比特的減少,通常在 fp32 中構(gòu)建。眾所周知,深度學(xué)習(xí)在推理過(guò)程中能夠以比訓(xùn)練過(guò)程更低的位精度進(jìn)行處理
淺析FPGA原型驗(yàn)證系統(tǒng)的時(shí)鐘資源
如果SoC設(shè)計(jì)規(guī)模小,在單個(gè)FPGA內(nèi)可以容納,那么只要系統(tǒng)中的FPGA具有所SoC所設(shè)計(jì)需要時(shí)鐘的數(shù)量
2023-05-23 標(biāo)簽:fpgapllSoC設(shè)計(jì) 1170 0
時(shí)序邏輯電路設(shè)計(jì)之計(jì)數(shù)器
前面已經(jīng)學(xué)習(xí)了時(shí)序邏輯電路中的基本單元:觸發(fā)器,這次就用其來(lái)整點(diǎn)活,實(shí)現(xiàn)計(jì)數(shù)器的設(shè)計(jì),計(jì)數(shù)器可以說(shuō)是任何和時(shí)序有關(guān)的設(shè)計(jì)都會(huì)用到他。
2023-05-22 標(biāo)簽:fpgaled計(jì)數(shù)器 6466 0
FPGA 即 Field Programmable Gate Arrays,現(xiàn)場(chǎng)可編程門陣列。如果邏輯代數(shù)為數(shù)字世界的理論指導(dǎo),那么邏輯門電路就是蓋起座...
FPGA常用運(yùn)算模塊-復(fù)數(shù)乘法器
本文是本系列的第五篇,本文主要介紹FPGA常用運(yùn)算模塊-復(fù)數(shù)乘法器,xilinx提供了相關(guān)的IP以便于用戶進(jìn)行開(kāi)發(fā)使用。
基于FPGA的量子通信系統(tǒng)偏振態(tài)制備及控制集成化研究
在以偏振編碼為基礎(chǔ)的量子保密通信中,由于外界溫度、應(yīng)力以及光纖制造缺陷等因素,使得偏振態(tài)無(wú)法保持長(zhǎng)期穩(wěn)定,增加了系統(tǒng)誤碼率
2023-05-22 標(biāo)簽:fpga控制系統(tǒng)示波器 1188 0
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