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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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關(guān)于FFT硬件實(shí)現(xiàn),設(shè)計(jì)中RAM輸出端為何沒有使用REG
以2048點(diǎn)為例,根據(jù)理論值計(jì)算,計(jì)算一次2048點(diǎn)的IFFT的時(shí)間應(yīng)為130us。在采用流水線的方式下,實(shí)部計(jì)算和虛部計(jì)算均采用兩塊RAM實(shí)現(xiàn)流水線。
SoC FPGA的DSP能力應(yīng)對(duì)新興的小型基站需求
雖然推動(dòng)業(yè)界向小型基站轉(zhuǎn)變的因素眾多,但可能最重要的是,消費(fèi)者想要隨時(shí)隨地都能快速有效地連接到服務(wù)提供商,而服務(wù)提供商需要做的就是找到更具成本效益的方法...
FPGA時(shí)序的基本概念,RTL項(xiàng)目的設(shè)計(jì)探索
盡管工程師們很清楚已有 FPGA 工具的參數(shù)設(shè)置,但是很多時(shí)候并沒有完全把這些設(shè)置的功能發(fā)揮出來。一般而言,這些設(shè)置只有在設(shè)計(jì)無法達(dá)到時(shí)序要求的時(shí)候才會(huì)...
關(guān)于基于FPGA的可消除高頻非線性的動(dòng)態(tài)分頻鑒相器設(shè)計(jì)
鑒相技術(shù)是電力電子系統(tǒng)和測(cè)試控制中的關(guān)鍵技術(shù)之一,在儀器儀表、通信、導(dǎo)航定位、研究網(wǎng)絡(luò)相頻特性和鎖相環(huán)等測(cè)試中,經(jīng)常需要測(cè)量兩列同頻信號(hào)的相位差。相較于...
介紹使用IBERT調(diào)試FPGA芯片高速串行接口性能的步驟
隨著高速數(shù)字系統(tǒng)的發(fā)展,高速串行數(shù)據(jù)被廣泛使用,內(nèi)嵌高速串行接口的FPGA也得到大量應(yīng)用,相應(yīng)的高速串行信號(hào)質(zhì)量的測(cè)試也越來越頻繁和重要。通常用示波器觀...
基于FPGA的圖像處理算子/卷積核實(shí)現(xiàn)方法
FPGA最大的優(yōu)勢(shì)體現(xiàn)在其低功耗和并行運(yùn)算的特點(diǎn)上,數(shù)字圖像蘊(yùn)含數(shù)據(jù)量大,采用FPGA可以在保證低功率運(yùn)算的情況下,有效提高圖像算法的實(shí)時(shí)性。
2023-04-07 標(biāo)簽:fpga濾波器數(shù)字圖像處理 6492 1
基于FPGA的DMA技術(shù)實(shí)現(xiàn)多路并行數(shù)字信號(hào)的高速同步采集
本系統(tǒng)采用基于FPGA的DMA技術(shù)高速緩存多路并行數(shù)據(jù),通過數(shù)據(jù)重組將數(shù)據(jù)有序發(fā)送給處理系統(tǒng),用于數(shù)據(jù)的顯示與分析。系統(tǒng)采用了嵌入式技術(shù),達(dá)到了便攜效果...
PCI總線的特點(diǎn)及如何采用FPGA器件進(jìn)行的PCI接口設(shè)計(jì)
在現(xiàn)代雷達(dá)數(shù)據(jù)處理系統(tǒng)和其他應(yīng)用系統(tǒng)中,傳統(tǒng)的ISA、EISA等總線已逐漸無法適應(yīng)高速數(shù)據(jù)傳輸?shù)囊蟆6鳳CI局部總線以其高性能、低成本、使用方便和適應(yīng)...
Flash讀寫控制方案 Altera似乎“沒有”開放配置Flash的Pin的控制
自行設(shè)計(jì)Flash讀寫控制器的優(yōu)點(diǎn)在于可控性很高,缺點(diǎn)在于需要花費(fèi)時(shí)間設(shè)計(jì)并進(jìn)行穩(wěn)定性測(cè)試。相應(yīng)的,使用提供的Flash讀寫控制器IP,優(yōu)點(diǎn)是免去設(shè)計(jì)和...
一種基于仿真測(cè)試平臺(tái)的實(shí)物自動(dòng)化測(cè)試環(huán)境
動(dòng)態(tài)測(cè)試因測(cè)試實(shí)施過程中被測(cè)系統(tǒng)處于運(yùn)行狀態(tài),能夠較為準(zhǔn)確地反映系統(tǒng)實(shí)際運(yùn)行時(shí)的行為,因此在測(cè)試技術(shù)中成為最重要的測(cè)試手段之一。FPGA動(dòng)態(tài)測(cè)試過程通常...
基于FPGA的高速高精度聲源定位系統(tǒng)技術(shù)特點(diǎn)
第一部分 設(shè)計(jì)概述 / Design Introduction 1.1 設(shè)計(jì)目的 頻繁雜亂的鳴笛聲,不但給周邊居民的生活質(zhì)量造成很大影響,而且增加了駕駛...
利用FPGA DIY開發(fā)板實(shí)現(xiàn)數(shù)字時(shí)鐘數(shù)碼管顯示
本視頻展示的是用Verilog硬件描述語言設(shè)計(jì)的一個(gè)具有時(shí)、分、秒計(jì)數(shù)顯示功能,以24小時(shí)循環(huán)計(jì)時(shí)的時(shí)鐘電路。 使用三個(gè)按鍵分別是清零鍵(clr)、模...
當(dāng)今 FPGA 和高性能處理器的多個(gè)電源軌必須按照嚴(yán)格的順序上電和斷電。通常連接到電源軌的去耦電容必須主動(dòng)放電,以確保正確控制斷電順序并在可接受的時(shí)間內(nèi)...
關(guān)于帶通采樣星載AIS非相干接收機(jī)的FPGA實(shí)現(xiàn)
AIS系統(tǒng)是一種船舶交通信息交換系統(tǒng),船載AIS設(shè)備不斷發(fā)送自身信息,如航向、噸位等,用以領(lǐng)航調(diào)度、避免碰撞。隨著海運(yùn)貿(mào)易的高速增長,迫切需要建立對(duì)大片...
基于FPGA的SPI Flash控制器的設(shè)計(jì)方案
傳統(tǒng)的Flash讀寫是通過CPU軟件編程實(shí)現(xiàn),其讀寫速度較慢,且占用CPU資源,另外由于Flash芯片本身功能指令較多,使得對(duì)芯片進(jìn)行直接操作變得非常困...
基于ADS1298與FPGA的高性能腦電信號(hào)采集系統(tǒng)
本文利用ADS1298芯片的高精度,以FPGA為主控制芯片,通過將工頻陷波、帶通濾波等模擬部分轉(zhuǎn)移到數(shù)字側(cè),在保證性能的前提下簡化腦電信號(hào)放大與調(diào)理的模...
2014-01-25 標(biāo)簽:FPGA信號(hào)采集系統(tǒng) 6436 0
賽靈思 ISE所涉及的一些命令以及Command Line的使用
所有的Commandline都可以在ISE的help->User Manuals里查到,在User Manuals中
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