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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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現(xiàn)在的FPGA向引腳分配信號的任務(wù)曾經(jīng)很簡單,現(xiàn)在也變得相當繁復。
利用FPGA系列的DDR能力解決DDR存儲器的接口設(shè)計
目前存儲器接口經(jīng)常要求時鐘速度超過200MHz以滿足線卡和交換卡的吞吐量要求,這是FPGA架構(gòu)的主要挑戰(zhàn)。PLL是基本的允許控制時鐘數(shù)據(jù)關(guān)系的部件。
簡評FPGA——Arduino MKR Vidor 4000
Arduino MKR Vidor 4000的出現(xiàn)確實讓我挺意外的,為何?因為它是一款FPGA開發(fā)板。眾所周知,Arduino最深入人心的東西就是其簡單...
2018-12-19 標簽:fpgaFPGA開發(fā)板 7181 0
與傳統(tǒng)計時工具如鐘表日歷等相比,數(shù)字萬年歷具備精確度高、成本低廉、運行穩(wěn)定、功能多樣等眾多優(yōu)點,因此國內(nèi)外許多設(shè)計人員先后進行了相關(guān)設(shè)計開發(fā)。其中,基于...
基于FPGA芯片實現(xiàn)數(shù)據(jù)時鐘同步設(shè)計方案
對于一個設(shè)計項目來說,全局時鐘(或同步時鐘)是最簡單和最可預測的時鐘。只要可能就應(yīng)盡量在設(shè)計項目中采用全局時鐘。FPGA都具有專門的全局時鐘引腳,它直接...
一種基于FPGA的帶死區(qū)的SPWM波形產(chǎn)生的設(shè)計與實現(xiàn)詳解
PWM(Pulse Width Modulation)是通過調(diào)節(jié)輸出波形的脈沖寬度來改變輸出電壓大小的一種調(diào)制方法,在交流傳動、電力拖動系統(tǒng)和控制領(lǐng)域有...
數(shù)字信號處理技術(shù)和大規(guī)模集成電路技術(shù)的迅猛發(fā)展,為我們設(shè)計數(shù)字電路提供了新思路和新方法。當前數(shù)字系統(tǒng)設(shè)計正朝著速度快、容量大、體積小、重量輕的方向發(fā)展。...
關(guān)于ADC應(yīng)用100Msps的數(shù)字示波器的案例分析
經(jīng)過高速ADC以后的數(shù)據(jù)通過FPGA(當時就用Lattice的FPGA)進行處理以后送到后面的Cortex M4控制器,再在LCD顯示屏上顯示出來,觸發(fā)...
2021-04-08 標簽:fpga數(shù)字示波器信號發(fā)生器 7160 0
xilinx的axi4-stream-slave接收數(shù)據(jù)模式
xilinx官方實例代碼如下,其實大概意思就是一個高電平之后,變成低電平。然后再高電平,等待tlast信號再拉低。這樣做的為了時序緊湊型,xilinx為...
最近幾年,F(xiàn)PGA這個概念越來越多地出現(xiàn)。例如,比特幣挖礦,就有使用基于FPGA的礦機。還有,之前微軟表示,將在數(shù)據(jù)中心里,使用FPGA“代替”CPU,等等。
基于Cyclone IV GX系列的FPGA的PCIe接口設(shè)計詳解
PCI Express(PCIe)是一種高性能互連協(xié)議,可應(yīng)用于網(wǎng)絡(luò)適配、圖形加速、服務(wù)器、大數(shù)據(jù)傳輸、嵌入式系統(tǒng)等領(lǐng)域。PCIe協(xié)議在軟件層上可兼容于...
卷積神經(jīng)網(wǎng)絡(luò)介紹 基于LeNet5實現(xiàn)的手寫字符識別
前文中,我們介紹了一些傳統(tǒng)計算機視覺的算法,包括降噪濾波、二值化、縮放、銳化等,最終我們在FPGA上實現(xiàn)了實時的運動目標跟蹤算法。近些年基于神經(jīng)網(wǎng)絡(luò)的機...
2022-05-16 標簽:fpgamatlab卷積神經(jīng)網(wǎng)絡(luò) 7145 0
什么是數(shù)字中頻?FPGA怎么實現(xiàn)數(shù)字中頻?
數(shù)字中頻顧名思義,是指一種中間頻率的信號形式。中頻是相對于基帶信號和射頻信號來講的,中頻可以有一級或多級,它是基帶和射頻之間過渡的橋梁。 如圖1所示,中...
2012年電子發(fā)燒友網(wǎng)發(fā)表和整合了很多FPGA相關(guān)的文章。關(guān)于FPGA核心知識詳解、FPGA芯片設(shè)計、FPGA解決方案、FPGA工程師經(jīng)驗傳授,甚至FP...
FPGA配置方式靈活多樣,根據(jù)芯片是否能夠自己主動加載配置數(shù)據(jù)分為主模式、從模式以及JTAG模式。典型的主模式都是加載片外非易失(斷電不丟數(shù)據(jù))性存儲器...
verilog實現(xiàn)反相器,2輸入與門、2輸入或門、2輸入與非門、2輸入或非門、2輸入異或門、2輸入同或門;
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十九章PL端AXI GPIO的使用
使用zynq最大的疑問就是如何把PS和PL結(jié)合起來使用,在其他的SOC芯片中一般都會有GPIO,本實驗使用一個AXI GPIO的IP核,讓PS端通過AX...
Xilinx Kintex UltraScale+ FPGA KCU116評估套件主要性能和優(yōu)勢
Kintex? UltraScale+? FPGA KCU116 評估套件是評估重要 Kintex UltraScale+ 特性的理想選擇,特別是 28...
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