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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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在數(shù)字接收機(jī)的各種參數(shù)中,頻率是最重要的參數(shù)之一,它能反映接收機(jī)的功能和用途、以及頻譜寬度等重要指標(biāo)。傳統(tǒng)的順序測(cè)頻技術(shù)一般通過對(duì)接收機(jī)頻帶的掃描,對(duì)頻...
針對(duì)大容量固態(tài)存儲(chǔ)器中數(shù)據(jù)錯(cuò)“位”的問題,目前大多采用軟件ECC 模型進(jìn)行檢錯(cuò)和糾錯(cuò),但這勢(shì)必會(huì)極大地影響存儲(chǔ)系統(tǒng)的讀寫性能。基于ECC校驗(yàn)原理,提出一...
高精度三維成像聲吶的實(shí)現(xiàn)需要完成大規(guī)模信號(hào)同步采集和海量數(shù)據(jù)并行計(jì)算,為此,提出基于現(xiàn)場(chǎng)可編程邏輯門陣列的并行計(jì)算系統(tǒng)。在使用同源時(shí)鐘的前提下,利用Sp...
基于聲納探測(cè)技術(shù)的水下三維場(chǎng)景實(shí)時(shí)成像系統(tǒng)
針對(duì)目前水下三維聲納實(shí)時(shí)成像系統(tǒng)前端信號(hào)通道多、波束形成計(jì)算量大的問題,提出一種基于現(xiàn)場(chǎng)可編程門陣列(FPGA)的水下三維場(chǎng)景實(shí)時(shí)成像系統(tǒng)。采用FPGA...
驗(yàn)證設(shè)計(jì)和創(chuàng)建可實(shí)現(xiàn)的設(shè)計(jì)
驗(yàn)證RTL模塊或FPGA是否滿足要求可能頗具挑戰(zhàn)。但有些方法可用來優(yōu)化驗(yàn)證流程,以確保驗(yàn)證成功。驗(yàn)證FPGA或RTL模塊可能是一個(gè)非常耗時(shí)的過程,因?yàn)楣?..
2017-11-18 標(biāo)簽:fpga 833 0
基于LabVIEW和CompactRIO開發(fā)的EDM過程控制器
FPGA硬件平臺(tái)均采用統(tǒng)一圖形語言LabVIEW編程,僅用兩個(gè)多月的時(shí)間就完成了整個(gè)系統(tǒng)的開發(fā),功能強(qiáng)大。挑戰(zhàn):快速開發(fā)一種分布式的電火花放電加工EDM...
2017-11-18 標(biāo)簽:fpgalabviewcompactrio 1672 0
基于FPGA的多相濾波結(jié)構(gòu)的信道化設(shè)計(jì)
隨著現(xiàn)代電子戰(zhàn)中電磁環(huán)境的日益復(fù)雜,軍用接收機(jī)需具備同時(shí)處理多個(gè)信道信號(hào)的能力,即具備全概率截獲能力。信道化接收機(jī)可將一個(gè)復(fù)雜信號(hào)分成多個(gè)信道,從而方便...
基于FPGA多波束成像的聲納系統(tǒng)設(shè)計(jì)
給出了一種基于FPGA的多波束成像聲納整機(jī)的硬件電路設(shè)計(jì)方案,介紹了該方案中各分系統(tǒng)的具體電路實(shí)現(xiàn),以Xilinx公司的FPGA芯片作為核心器件,根據(jù)干...
2017-11-18 標(biāo)簽:fpgaxc6vlx550t 4460 0
FPGA(現(xiàn)場(chǎng)可編程門陣列)的基礎(chǔ)知識(shí)及其工作原理
高端設(shè)計(jì)工具為少有甚是沒有硬件設(shè)計(jì)技術(shù)的工程師和科學(xué)家提供現(xiàn)場(chǎng)可編程門陣列(FPGA)。無論你使用圖形化設(shè)計(jì)程序,ANSI C語言還是VHDL語言,如此...
抖動(dòng)的產(chǎn)生,通常的按鍵所用開關(guān)為機(jī)械彈性開關(guān),當(dāng)機(jī)械觸點(diǎn)斷開、閉合時(shí),由于機(jī)械觸點(diǎn)的彈性作用,一個(gè)按鍵開關(guān)在閉合時(shí)不會(huì)馬上穩(wěn)定地接通,在斷開時(shí)也不會(huì)一下...
2017-11-18 標(biāo)簽:fpga 1.1萬 0
基于FPGA時(shí)序優(yōu)化設(shè)計(jì)
現(xiàn)有的工具和技術(shù)可幫助您有效地實(shí)現(xiàn)時(shí)序性能目標(biāo)。當(dāng)您的FPGA 設(shè)計(jì)無法滿足時(shí)序性能目標(biāo)時(shí),其原因可能并不明顯。解決方案不僅取決于FPGA 實(shí)現(xiàn)工具為滿...
無論您的終端應(yīng)用是什么,可靠性都將是設(shè)計(jì)的主要考慮因素之一。實(shí)現(xiàn)可靠性的方法多種多樣。在考慮設(shè)計(jì)可靠性時(shí),大部分工程師都將注意力集中在一個(gè)綜合性度量標(biāo)準(zhǔn)...
Virtex UltraScale器件的優(yōu)點(diǎn)
賽靈思Virtex? UltraScale ? All Programmable FPGA 是高端FPGA 系列的擴(kuò)展,可支持1Tbps 系統(tǒng)的實(shí)現(xiàn)。V...
2017-11-18 標(biāo)簽:fpgaultrascale 2151 0
一個(gè)南極多學(xué)科科學(xué)家小組最近窺到了宇宙大爆炸的余暉。3月17日該小組宣布BICEP2試驗(yàn)在宇宙微波背景輻射(CMB)的B模偏振中找到了引力波的第一個(gè)證據(jù)...
在使用我們的最新模數(shù)轉(zhuǎn)換器(ADC)和數(shù)模轉(zhuǎn)換器(DAC)設(shè)計(jì)系統(tǒng)時(shí),我已知道了很多有關(guān) JESD204B接口標(biāo)準(zhǔn)的信息,這些器件使用該協(xié)議與FPGA 通信。
我們知道XDC與UCF的根本區(qū)別之一就是對(duì)跨時(shí)鐘域路徑(CDC)的缺省認(rèn)識(shí)不同,那么碰到FPGA設(shè)計(jì)中常見的CDC路徑,到底應(yīng)該怎么約束,在設(shè)計(jì)上又要注...
基于FPGA的圖形生成與視頻處理系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
本文對(duì)基于FPGA的機(jī)載視頻圖形顯示系統(tǒng)架構(gòu)進(jìn)行設(shè)計(jì)和優(yōu)化。從實(shí)時(shí)性、BRAM資源占用和DDR3吞吐量三方面進(jìn)行分析,改進(jìn)幀速率提升算法來提高實(shí)時(shí)性;改...
基于FPGA+DSP的海德漢編碼器結(jié)構(gòu)及設(shè)計(jì)
在現(xiàn)代工業(yè)控制系統(tǒng)中,對(duì)電機(jī)的控制是其重要組成部分。編碼器作為電機(jī)角位移的檢測(cè)裝置,為系統(tǒng)提供重要反饋信號(hào)。本文介紹了一個(gè)適合嵌入式系統(tǒng)的基于DSP和F...
具有并行處理架構(gòu)的平臺(tái),例如FPGA和GPU,在快速分析大型數(shù)據(jù)集方面得到了廣泛應(yīng)用。這兩項(xiàng)技術(shù)可以減輕運(yùn)算密集型算法對(duì)CPU造成的負(fù)擔(dān),在高度并行的平...
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)
本文設(shè)計(jì)一種基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu),能夠?qū)崿F(xiàn)2D圖形繪制,構(gòu)成各種飛行參數(shù)畫面,同時(shí)疊加外景視頻圖像。BRAM資源占用方面,視頻旋轉(zhuǎn)算法需要27...
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