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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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基于VHDL、FPGA實(shí)現(xiàn)智能控制器的設(shè)計(jì)與開環(huán)測(cè)試
隨著市場(chǎng)需求的增長(zhǎng),超大規(guī)模集成電路的集成度和工藝水平不斷提高,在一個(gè)芯片上完成系統(tǒng)級(jí)的設(shè)計(jì)已成為可能。FPGA固有的并行運(yùn)算處理能力,使得它能夠提供各...
EDA技術(shù)特征與FPGA設(shè)計(jì)應(yīng)用及優(yōu)化策略分析
集成電路發(fā)展經(jīng)歷了電路集成、功能集成、技術(shù)集成,直至今天基于計(jì)算機(jī)軟硬件的知識(shí)集成,這標(biāo)志著傳統(tǒng)電子系統(tǒng)已全面進(jìn)入現(xiàn)代電子系統(tǒng)階段,這也被譽(yù)為進(jìn)入3G時(shí)...
2018-11-19 標(biāo)簽:fpga計(jì)算機(jī)eda 2570 0
通過Verilog事件處理機(jī)制實(shí)現(xiàn)阻塞與非阻塞賦值的區(qū)分
層積事件列(The Stratified Event Queue)是一個(gè)事件管理概念模型,而非硬件邏輯。模型內(nèi)事件的具體實(shí)現(xiàn)與EDA軟件生產(chǎn)商的算法策略...
基于Quartus II的綜合仿真實(shí)現(xiàn)FFT IP核的FFT算法
數(shù)字信號(hào)處理領(lǐng)域中FFT算法有著廣泛的應(yīng)用。目前現(xiàn)有的文獻(xiàn)大多致力于研究利用FFT算法做有關(guān)信號(hào)處理、參數(shù)估計(jì)、F+FT蝶形運(yùn)算單元與地址單元設(shè)計(jì)、不同...
高速實(shí)時(shí)數(shù)據(jù)傳輸?shù)慕邮铡⒋鎯?chǔ)、處理系統(tǒng)設(shè)計(jì)
信息時(shí)代的日新月異,催促著各種各樣的數(shù)據(jù)信息快馬加鞭,人們?cè)谝笮畔鬏數(shù)迷絹碓娇斓耐瑫r(shí),還要求信息要來得更加及時(shí),于是高速實(shí)時(shí)的數(shù)據(jù)傳輸就成為了電子信...
基于FPGA與PLL頻率合成技術(shù)設(shè)計(jì)的整數(shù)/半整數(shù)頻率合成器
頻率合成器主要有直接式、鎖相式、直接數(shù)字式和混合式4種。目前,鎖相式和數(shù)字式容易實(shí)現(xiàn)系列化、小型化、模塊化和工程化,性能也越來越好,已逐步成為最為典型和...
采用VHDL語言與FPGA芯片實(shí)現(xiàn)平均值相位差計(jì)的設(shè)計(jì)
相位差的測(cè)量在研究網(wǎng)絡(luò)特性中具有重要作用,如何快速、精確地測(cè)量相位差已成為生產(chǎn)科研中的重要課題。測(cè)量相位差的方法很多,有集成電路設(shè)計(jì)的,也有采用數(shù)字信號(hào)...
采用TPS6211X電源轉(zhuǎn)換器件的手持式電子設(shè)備設(shè)計(jì)
在手持設(shè)備中,為了獲得較高的總功率,很多系統(tǒng)的電池電壓都在7 V之上,如7.2 V,9 V,12 V等。基于此,德州儀器(TI)推出了支持3.1~17 ...
實(shí)現(xiàn)PCM碼解調(diào)系統(tǒng)的VHDL程序模塊設(shè)計(jì)
圖1給出基于FPGA的硬件電路。其中,圖1(a)為FPGA配置模塊;圖1(b)為信號(hào)收發(fā)模塊及PCM碼接收模塊。
基于FPGA的串口通訊設(shè)計(jì)與仿真驗(yàn)證
FPGA(Field Pmgrammable Gate Array)現(xiàn)場(chǎng)可編程門陣列在數(shù)字電路的設(shè)計(jì)中已經(jīng)被廣泛使用。這種設(shè)計(jì)方式可以將以前需要多塊集成...
基于FPGA實(shí)現(xiàn)AES算法數(shù)據(jù)加密方案
隨著我國(guó)空間技術(shù)的快速發(fā)展,未來需要考慮空間數(shù)據(jù)安全性設(shè)計(jì)。傳統(tǒng)的星上加密 需要一個(gè)專門的裝置,占用的體積、功耗等資源均較大。AES 算法適用于軟硬件資...
Profibus-DP主站通信平臺(tái)的設(shè)計(jì)方案
Profibus協(xié)議的結(jié)構(gòu)以O(shè)SI為參考模型,DP使用第1層、第2層和用戶接口,第3層到第7層未加以描述。一個(gè)DP系統(tǒng)既可以是一個(gè)單主站結(jié)構(gòu),也可以是一...
基于FPGA與USB2.O控制器的IP-BX電話應(yīng)用系統(tǒng)設(shè)計(jì)
通用串行總線USB(Universal Serial Bus)是應(yīng)用于PC領(lǐng)域的接口技術(shù),已得到廣泛應(yīng)用。USB2.0已成為目前電腦中的標(biāo)準(zhǔn)擴(kuò)展接口。本...
基于FPGA芯片的雷達(dá)信號(hào)處理高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
在高速數(shù)據(jù)采集方面,F(xiàn)PGA有單片機(jī)和DSP無法比擬的優(yōu)勢(shì)。FPGA的時(shí)鐘頻率高,內(nèi)部時(shí)延小,全部控制邏輯都可由硬件完成,而且速度快,組成形式靈活,并可...
2018-12-30 標(biāo)簽:fpga芯片數(shù)據(jù)采集 6108 0
基于FPGA和EPlK30TCl44-3d實(shí)現(xiàn)超聲波氣體流量計(jì)中全數(shù)字AGC的設(shè)計(jì)
超聲波流量計(jì)是一種新興的工業(yè)產(chǎn)品,具有無阻擋體,無可動(dòng)件,無壓損,無示值漂移,適用于大口徑管道測(cè)量,測(cè)量精確度高,重復(fù)性強(qiáng),量程比寬,可承受工作壓力高,...
FPGA原型調(diào)試環(huán)境局限性的解決方案分析
采用基于現(xiàn)場(chǎng)可編程門陣列(FPGA)的原型的驗(yàn)證團(tuán)隊(duì)面臨的最大挑戰(zhàn)之一在于當(dāng)原型系統(tǒng)未能發(fā)揮期望的性能時(shí)了解原型系統(tǒng)的內(nèi)部行為。分析和調(diào)試這些設(shè)計(jì)的一個(gè)...
采用高速FPGA進(jìn)行PCB設(shè)計(jì)是需要注意哪些問題
隨著現(xiàn)場(chǎng)可編程門陣列(FPGA)已發(fā)展成為真正的可編程系統(tǒng)級(jí)芯片,利用這些芯片設(shè)計(jì)印制電路板(PCB)的任務(wù)變得愈加復(fù)雜。目前動(dòng)輒數(shù)百萬門的電路密度和6...
-越來越多的消費(fèi)應(yīng)用開始在設(shè)計(jì)中集成流式視頻,結(jié)果引入了許多標(biāo)準(zhǔn)和專有的加密算法。但是加密方案以及實(shí)現(xiàn)方法不統(tǒng)一導(dǎo)致視頻接收設(shè)備在設(shè)計(jì)和支持方面存在巨大...
2019-01-08 標(biāo)簽:fpga視頻計(jì)算機(jī) 1553 0
采用VHDL語言與FPGA實(shí)現(xiàn)衛(wèi)星同步數(shù)字復(fù)接系統(tǒng)的設(shè)計(jì)
便攜式衛(wèi)星通信,要求實(shí)現(xiàn)平臺(tái)集成度高、速度快、功耗小、體積小和成本低。現(xiàn)場(chǎng)可編程門陣列(FPGA) 在結(jié)構(gòu)上由邏輯功能塊排列為陣列,并由可編程的內(nèi)部連線...
在FPGA+DSP結(jié)構(gòu)的雷達(dá)導(dǎo)引頭信號(hào)處理系統(tǒng)中FPGA的問題解決方案
FPGA+DSP的數(shù)字硬件系統(tǒng)正好結(jié)合了兩者的優(yōu)點(diǎn),兼顧了速度和靈活性。本文以導(dǎo)引頭信號(hào)處理系統(tǒng)為例說明FPGA+DSP系統(tǒng)中FPGA的關(guān)鍵技術(shù)。
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