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標(biāo)簽 > 賽靈思
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該演示展示了Prodrive引導(dǎo)的vechile如何使用Xilinx Spartan-6為倉(cāng)庫(kù)和生產(chǎn)提供靈活的物流解決方案,從而實(shí)現(xiàn)功能安全。
利用DSP48E2 Slice中的寬MUX產(chǎn)品反饋
了解如何為UltraScale +設(shè)計(jì)添加額外的安全級(jí)別。 該視頻演示了如何防止差分功耗分析(DPA),以在比特流配置之上增加額外的安全性。
2018-11-27 標(biāo)簽:賽靈思功耗設(shè)計(jì) 3039 0
通過(guò)SDSoC開(kāi)發(fā)環(huán)境加速OpenCV功能
通過(guò)SDSoC開(kāi)發(fā)環(huán)境僅使用C / C ++和硬件優(yōu)化庫(kù),在硬件中加速OpenCV功能
2018-11-27 標(biāo)簽:賽靈思soc開(kāi)發(fā)環(huán)境 3248 0
ARTY Board與Xilinx MicroBlaze的配合使用演示
觀看此視頻,請(qǐng)參閱ARTY Board與Xilinx MicroBlaze軟核處理器的配合使用。 ARTY是一款基于Xilinx Artix-7 3...
基于Artix-7 35T的評(píng)估套件的ARTY介紹
當(dāng)我們開(kāi)啟ARTY板時(shí),觀看此視頻。 ARTY完全關(guān)注Artix-7 FPGA的適應(yīng)性和每瓦特性能以及降低成本的優(yōu)勢(shì)。
Zynq UltraScale+ MPSoC的ZCU102開(kāi)發(fā)套件的開(kāi)發(fā)流程
使用Zynq UltraScale + MPSoC的ZCU102開(kāi)發(fā)套件,該視頻展示了使用SDSoC開(kāi)發(fā)環(huán)境的開(kāi)發(fā)流程。
2018-11-27 標(biāo)簽:賽靈思開(kāi)發(fā)套件mpsoc 5160 0
7系列產(chǎn)品系列及其所有設(shè)備功能的高級(jí)介紹。
Zynq UltraScale+ MPSoC器件的收發(fā)器技術(shù)演示
該視頻重點(diǎn)介紹了UltraScale +產(chǎn)品組合的第一個(gè)成員,Zynq?UltraScale+?MPSoC,以及其多樣化收發(fā)器技術(shù)的穩(wěn)健性。
Linux設(shè)備驅(qū)動(dòng)程序的平臺(tái)驅(qū)動(dòng)程序和字符驅(qū)動(dòng)程序介紹
了解Linux設(shè)備驅(qū)動(dòng)程序的基礎(chǔ)知識(shí),重點(diǎn)介紹平臺(tái)驅(qū)動(dòng)程序和字符驅(qū)動(dòng)程序。 提出了簡(jiǎn)單的平臺(tái)驅(qū)動(dòng)程序?qū)崿F(xiàn)和簡(jiǎn)單的字符驅(qū)動(dòng)程序?qū)崿F(xiàn)。
2018-11-27 標(biāo)簽:賽靈思linux驅(qū)動(dòng)程序 4631 0
可編程器件上運(yùn)行的56G PAM4收發(fā)器技術(shù)演示
在這段視頻中,我們將向您展示業(yè)界首款可編程器件上運(yùn)行的56G收發(fā)器。
Virtex UltraScale VU440 FPGA的功能演示
查看世界上最大的新型Virtex Ultrascale VU440,用于制造10個(gè)ARM?Cortex-A9 CPU原型
如何使用Xilinx SDK調(diào)試u-boot代碼
了解如何使用Xilinx SDK調(diào)試u-boot代碼。 概述了技術(shù)以獲得重定位偏移量,以便可以在SDK中應(yīng)用它。
了解如何為UltraScale +設(shè)計(jì)添加額外的安全級(jí)別。 該視頻演示了如何防止差分功耗分析(DPA),以在比特流配置之上增加額外的安全性。
2018-11-27 標(biāo)簽:賽靈思功耗設(shè)計(jì) 2141 0
本課程將回顧高性能以太網(wǎng)解決方案所需的系統(tǒng)功能。 將審查Xilinx以太網(wǎng)IP內(nèi)核和相關(guān)設(shè)備驅(qū)動(dòng)程序,包括設(shè)備樹(shù)綁定。 還討論了與Petalinux的聯(lián)網(wǎng)。
本視頻介紹了7系列CLB架構(gòu),包括:LUT,觸發(fā)器,專用多路復(fù)用器,進(jìn)位鏈和其他資源。
了解如何配置和使用Linux內(nèi)核printk功能,包括其動(dòng)態(tài)調(diào)試功能。 這樣可以選擇性地打印調(diào)試消息,而無(wú)需重新編譯內(nèi)核。
基于Xilinx FPGA的Memcached硬件加速器的介紹
本教程討論基于Xilinx FPGA的Memcached硬件加速器的技術(shù)細(xì)節(jié),該硬件加速器可為10G以太網(wǎng)端口提供線速M(fèi)emcached服務(wù)。
如何在System Generator中使用多個(gè)時(shí)鐘域?qū)崿F(xiàn)復(fù)雜的DSP系統(tǒng)
了解如何在System Generator中使用多個(gè)時(shí)鐘域,從而可以實(shí)現(xiàn)復(fù)雜的DSP系統(tǒng)。
Vivado HLS深入技術(shù)助于降低整體系統(tǒng)功耗,提高系統(tǒng)性能
Vivado HLS有助于降低整體系統(tǒng)功耗,降低材料成本,提高系統(tǒng)性能并加快設(shè)計(jì)生產(chǎn)率。 我們將向您展示如何使用C,C ++或SystemC創(chuàng)建更高效...
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