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標(biāo)簽 > 全局復(fù)位
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隨著FPGA設(shè)計(jì)越來越復(fù)雜,芯片內(nèi)部的時(shí)鐘域也越來越多,使全局復(fù)位已不能夠適應(yīng)FPGA設(shè)計(jì)的需求,更多的設(shè)計(jì)趨向于使用局部的復(fù)位。本節(jié)將會從FPGA內(nèi)部...
在FPGA開發(fā)中盡量避免全局復(fù)位的使用?(3)
好消息是,在絕大多數(shù)設(shè)計(jì)中(白皮書說是超過99.99%?應(yīng)該是老外寫文檔的習(xí)慣吧),復(fù)位信號的時(shí)序是無關(guān)緊要的——通常情況下,大部分電路都能夠正常工作。
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