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      電子發燒友網>電子資料下載>電子論文>模擬數字論文>JESD204B中自同步加擾及解擾電路設計（AD/DA傳輸協議）

      JESD204B中自同步加擾及解擾電路設計（AD/DA傳輸協議）

      2017-10-31 | rar | 0.86 MB | 次下載 | 免費

      資料介紹

      　　JESD204B 作為JEDEC 國際組織于2011年修訂的AD/DA 采樣數據傳輸協議叫，實現了多鏈路多通道串行傳輸的同步傳輸，單通道的數據傳輸速率達到12.5 Gbps，顯著提升了數據轉換器（ADC/DAC ）與邏輯設備（ASIC/FPGA）之間的數據吞吐率。JESD204B 協議將加擾處理作為發送端數據鏈路層的首個環節，對傳輸層輸人的幀數據進行隨機化處理;在接收端方面，將解擾作為數據鏈路層的最后一個處理環節，還原數據。擾碼的作用主要分為兩個方面：其一，數據經過加擾的隨機化處理，打亂連續相同字節間的相關性，避免物理層轉換后的模擬信號出現雜散頻譜，防止雜散頻譜引起的電磁干擾，減少誤碼發生的概率，增加數據傳輸的準確性;其經過隨機化的數據，其比特流中0.1分布更均勻，抑制了信號傳輸的直流分量，提高了接收端鎖相環提取信號進行時鐘恢復的效率。

      JESD204B中自同步加擾及解擾電路設計（AD/DA傳輸協議）

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