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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>ZYNALOG徴格半導體|ZGAD125D12技術(shù)參數(shù)書

      ZYNALOG徴格半導體|ZGAD125D12技術(shù)參數(shù)書

      2025-07-16 | pdf | 926.13 KB | 次下載 | 免費

      資料介紹

      1 、特性
      ? 采樣率10Msps 至125Msps
      ? 1.8V 單電壓供電
      ? 輸出: DDR LVDS
      ? 輸入范圍：1.5Vpp
      ? 信噪比（SNR）：68dB
      ? 無雜散動態(tài)范圍（SFDR）：85dB
      ? 信道隔離度：90dB
      ? 全功率帶寬：600MHz
      ? 全速率運行功耗：400mW
      ? 雙通道采樣
      ? 可選時鐘占空比穩(wěn)定器
      ? 節(jié)能的低功耗模式和休眠模式
      ? 可配置的SPI 串行口（支持1.8V 到3.3V）
      ? 封裝：QFN64
      ? 工作溫度：-40°C 至85°C
      2 、應用領域
      ? 信號鏈
      ? 測試測量儀器
      ? 醫(yī)療設備
      ? 視頻設備
      ? 蜂窩基站
      ? 激光雷達
      3 、綜述
      ZGAD125D12 是雙通道12 位125Msps 的模數(shù)轉(zhuǎn)換器（ADC）。設計應用于高頻率，寬動態(tài)范圍信號的數(shù)字化。系列具有包括68dB 信噪比（SNR）和85dB 無雜散動態(tài)范圍（SFDR）的性能，完美適用于高要求的信號鏈應用。600MHz 的輸入帶寬允許ADC 在高頻下采樣的同時保持良好性能。延遲只有六個時鐘周期。靜態(tài)特性包括+/- 0.6LSB 積分非線性誤差（INL）(典型值), +/- 0.25LSB 微分非線性誤差（DNL）(典型值)。時鐘輸入可以用正弦波、PECL、LVDS、TTL 或CMOS 輸入差分驅(qū)動?？蛇x時鐘占空比穩(wěn)定器允許在很寬的時鐘占空比范圍內(nèi)全速工作的高性能表現(xiàn)。

      adc 模數(shù)轉(zhuǎn)換器
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