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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>Vitis高級(jí)綜合用戶指南

      Vitis高級(jí)綜合用戶指南

      2023-09-14 | pdf | 9.76 MB | 次下載 | 免費(fèi)

      資料介紹

      Xilinx? 文檔圍繞一組標(biāo)準(zhǔn)設(shè)計(jì)流程進(jìn)行組織，可幫助您找到當(dāng)前開(kāi)發(fā)任務(wù)的相關(guān)內(nèi)容。所有 Versal? ACAP 設(shè)計(jì)流程 設(shè)計(jì)中心可以在 Xilinx.com 網(wǎng)站上找到。本文檔涵蓋以下設(shè)計(jì)過(guò)程：
      ? 硬件、IP 和平臺(tái)開(kāi)發(fā)：為硬件創(chuàng)建 PL IP 模塊平臺(tái)，創(chuàng)建 PL 內(nèi)核、功能仿真和評(píng)估 Vivado? 時(shí)序，資源使用和電源關(guān)閉。還涉及為系統(tǒng)開(kāi)發(fā)硬件平臺(tái)集成。本文檔中適用于此設(shè)計(jì)過(guò)程的主題包括：
      ? 推出 Vitis HLS
      ? 使用 C 模擬驗(yàn)證代碼
      ? 合成代碼
      ? 分析合成結(jié)果
      ? 優(yōu)化HLS項(xiàng)目
      本主題適用于希望了解從用 C/C++ 編寫的軟件算法合成加速硬件。本文檔向開(kāi)發(fā)人員介紹需要理解的基本概念，以便設(shè)計(jì)和創(chuàng)建良好的可合成軟件，使其能夠成功使用高級(jí)綜合 （HLS） 工具轉(zhuǎn)換為硬件。本文檔中的討論將與工具無(wú)關(guān)，引入的概念對(duì)于大多數(shù) HLS 工具都是通用的。主要具有 RTL 設(shè)計(jì)經(jīng)驗(yàn)的人員應(yīng)該熟悉此處介紹的概念。然而審查這些材料可以有效地加強(qiáng)這些概念的重要性;幫助您了解如何使用 HLS，特別是如何構(gòu)建 HLS 代碼實(shí)現(xiàn)高性能設(shè)計(jì)。

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