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高速數(shù)模轉(zhuǎn)換器 (DAC) 的建立時(shí)間和保持時(shí)間揭秘

2077738 2022-11-18 | pdf | 94.53KB | 次下載 | 免費(fèi)

資料介紹

介紹介紹滿足高速數(shù)模轉(zhuǎn)換器 (DAC) 的數(shù)字時(shí)序要求對(duì)于實(shí)現(xiàn)最佳性能至關(guān)重要。隨著時(shí)鐘頻率的增加，數(shù)據(jù)接口的設(shè)置和保持時(shí)間成為系統(tǒng)設(shè)計(jì)人員的重要關(guān)注點(diǎn)。本應(yīng)用筆記旨在全面解釋與 Maxim 高性能轉(zhuǎn)換器解決方案相關(guān)的建立和保持時(shí)間。滿足高速數(shù)模轉(zhuǎn)換器 (DAC) 的數(shù)字時(shí)序要求對(duì)于實(shí)現(xiàn)最佳性能至關(guān)重要。隨著時(shí)鐘頻率的增加，數(shù)據(jù)接口的設(shè)置和保持時(shí)間成為系統(tǒng)設(shè)計(jì)人員的重要關(guān)注點(diǎn)。本應(yīng)用筆記旨在全面解釋與 Maxim 高性能轉(zhuǎn)換器解決方案相關(guān)的建立和保持時(shí)間。定義建立時(shí)間和保持時(shí)間定義建立時(shí)間和保持時(shí)間建立時(shí)間 (t 建立時(shí)間 (t SS ) 描述了數(shù)據(jù)必須處于相對(duì)于 DAC 時(shí)鐘轉(zhuǎn)換的有效邏輯電平的時(shí)間點(diǎn)。另一方面，保持時(shí)間 (t ) 描述了數(shù)據(jù)必須處于相對(duì)于 DAC 時(shí)鐘轉(zhuǎn)換的有效邏輯電平的時(shí)間點(diǎn)。另一方面，保持時(shí)間 (t H ) 指定數(shù)據(jù)在被設(shè)備捕獲/采樣后何時(shí)可以更改。H ) 指定數(shù)據(jù)在被設(shè)備捕獲/采樣后何時(shí)可以更改。圖 1圖 1顯示了參考上升沿時(shí)鐘信號(hào)的建立和保持時(shí)間。特定器件時(shí)鐘信號(hào)的有效邊沿可以是上升沿/下降沿，也可以是用戶(hù)可選的，如 MAX5895 16 位、500Msps 內(nèi)插和調(diào)制雙通道 DAC，具有 CMOS 輸入。顯示了參考上升沿時(shí)鐘信號(hào)的建立和保持時(shí)間。特定器件時(shí)鐘信號(hào)的有效邊沿可以是上升沿/下降沿，也可以是用戶(hù)可選的，如 MAX5895 16 位、500Msps 內(nèi)插和調(diào)制雙通道 DAC，具有 CMOS 輸入。圖 1. 參考上升沿時(shí)鐘信號(hào)的建立和保持時(shí)間。圖 1. 參考上升沿時(shí)鐘信號(hào)的建立和保持時(shí)間。采用 CMOS 技術(shù)設(shè)計(jì)的數(shù)字電路通常在電源軌之間的電壓中間切換。因此，時(shí)間參考標(biāo)記位于信號(hào)邊緣的中點(diǎn)。圖 1 中波形的位置展示了這種建立和保持時(shí)間的典型條件。請(qǐng)注意，此設(shè)置的兩個(gè)參數(shù)均為正值。當(dāng)設(shè)置時(shí)間或保持時(shí)間的指定值為負(fù)時(shí)，可能會(huì)出現(xiàn)混淆。采用 CMOS 技術(shù)設(shè)計(jì)的數(shù)字電路通常在電源軌之間的電壓中間切換。