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      電子發燒友網>電子資料下載>電源技術>AN1451 - 采用可配置邏輯單元（CLC）實現無毛刺設計

      AN1451 - 采用可配置邏輯單元（CLC）實現無毛刺設計

      2018-03-27 | rar | 1.63 MB | 次下載 | 2積分

      資料介紹

      　　數字電路設計人員經常面臨的挑戰之一是要消除所設計電路的毛刺信號。為此，通常需要確保數據鎖存期間具有足夠的建立時間以及保持時間。

      　　“毛刺”是不能在整個時鐘周期內都保持有效的信號。帶毛刺的信號如果饋送至多個鎖存器的時鐘線，部分鎖存器可能無法更新。這無疑是設計人員要避免的情況。還應當注意傳播延時會隨溫度而變化，因此，開發期間未產生毛刺的設計電路在其他情況下仍有可能產生毛刺。

      AN1451 - 采用可配置邏輯單元（CLC）實現無毛刺設計

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