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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用Cyclone器件中的PLL

      如何使用Cyclone器件中的PLL

      2021-01-15 | rar | 0.93 MB | 次下載 | 免費

      資料介紹

      　　介紹

      　　Cyclone FPGA 具有鎖相環（PLL）和全局時鐘網絡，提供完整的時鐘管理方案。Cyclone PLL 具有時鐘倍頻和分頻、相位偏移、可編程 占空比和外部時鐘輸出，進行系統級的時鐘管理和偏移控制。Altera? Quartus? II 軟件無需任何外部器件，就可以啟用Cyclone PLL 和 相關功能。本文將介紹如何設計和使用Cyclone PLL 功能。

      　　PLL 常用于同步內部器件時鐘和外部時鐘，使內部工作的時鐘頻率比外部時鐘更高，時鐘延遲和時鐘偏移最小，減小或調整時鐘到輸出（TCO）和建立（TSU）時間。

      　　硬件結構

      　　每個 Cyclone FPGA 包括具有多達兩個PLL。表1 為種型號Cyclone FPGA 內可用的PLL 數量。

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