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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Zedboard板使用SOC的Adau1761測(cè)試項(xiàng)目資料說(shuō)明

      Zedboard板使用SOC的Adau1761測(cè)試項(xiàng)目資料說(shuō)明

      2019-02-14 | rar | 0.19 MB | 次下載 | 免費(fèi)

      資料介紹

      　　項(xiàng)目模板來(lái)自：Lab4

      　　1、在vivado下執(zhí)行TCL腳本可以生成SOC模型。

      　　2、直接創(chuàng)建SDK項(xiàng)目。

      　　3、將Line In輸入的音頻處理后送Line Out。

      　　4、通過(guò)SW0可以選擇是否濾波處理音頻，還是直通。

      　　主要問(wèn)題是提供的TCL腳本與vivado2015.2不兼容，按網(wǎng)上“ vivado + zedboard之a(chǎn)udio驅(qū)動(dòng)”的步驟運(yùn)行TCL失敗。其二是adau1761.h adau1761.c、iic.h、iic.c沒(méi)用（實(shí)際上模板中也沒(méi)有）。其三是testapp.c中的xfir_hw.h不存在（實(shí)際上不做濾波處理時(shí)可以刪除）。

      　　說(shuō)明一下如何修改TCL腳本。

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