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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA 的新的DDS+PLL時鐘發生器

      基于FPGA 的新的DDS+PLL時鐘發生器

      2009-12-14 | rar | 344 | 次下載 | 5積分

      資料介紹

      針對直接數字頻率合成（DDS）和集成鎖相環（PLL）技術的特性，提出了一種新的
      DDS 激勵PLL 系統頻率合成時鐘發生器方案。且DDS 避免正弦查找表，即避免使用ROM，采用濾波的方法得到正弦波。
      關鍵字：DDS；PLL；正弦波查找表；ROM；相位控制字；頻率控制字
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