資料介紹
在SAR 圖像中檢測艦船本身或其尾跡時,往往運算量非常大,為了滿足未來業務
化操作中高速和實時性的要求,本文提出了一種基于FPGA 的硬件實現方法,提出了應
用VHDL 在ALTERA StratixII ep2s30 芯片上實現檢測中復雜的并行運算。內容包括軟件
仿真和硬件實現。
關鍵詞:FPGA、VHDL、雙參檢測
由于 SAR 圖像檢測算法的復雜度往往很高,需要大量的乘-加操作甚至是乘-累加操
作,因此在軟件上進行處理很難達到高速甚至實時。在硬件上實現SAR 圖像檢測算法已成為一個很迫切的工作。
本文針對有效的艦船擾動檢測方法——峰--斜雙參檢測法,詳細描述了其軟件仿真和硬
件實現的方法,并在后面給出了實際結果和精度分析。文中提出的VLSI 架構,其結構復雜度低,并行處理能力強,適合在軟硬件上繼續擴展以組建業務化的SAR 水上運動目標成像檢測系統。
化操作中高速和實時性的要求,本文提出了一種基于FPGA 的硬件實現方法,提出了應
用VHDL 在ALTERA StratixII ep2s30 芯片上實現檢測中復雜的并行運算。內容包括軟件
仿真和硬件實現。
關鍵詞:FPGA、VHDL、雙參檢測
由于 SAR 圖像檢測算法的復雜度往往很高,需要大量的乘-加操作甚至是乘-累加操
作,因此在軟件上進行處理很難達到高速甚至實時。在硬件上實現SAR 圖像檢測算法已成為一個很迫切的工作。
本文針對有效的艦船擾動檢測方法——峰--斜雙參檢測法,詳細描述了其軟件仿真和硬
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