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      簡(jiǎn)述ESD與PCB布局

      2014-08-21 | pdf | 168KB | 次下載 | 2積分

      資料介紹

      靜電洩放(electrostatic discharge, ESD)測(cè)試是電源調(diào)整器(power adapter)安全規(guī)範(fàn)測(cè)試中的重要項(xiàng)目，經(jīng)由在電路板上適當(dāng)?shù)卦O(shè)計(jì)電荷疏導(dǎo)路徑，可以大幅提昇電源供應(yīng)器系統(tǒng)的靜電洩放耐受力。
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