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      電子發燒友網>電子資料下載>通信網絡>基于FPGA的10M/100M以太網控制器的設計

      基于FPGA的10M/100M以太網控制器的設計

      2010-09-22 | rar | 433 | 次下載 | 10積分

      資料介紹

      介紹了一種10M/ 100M 以太網控制器的實現方法,該控制器以FIFO 作為幀緩存,通
      過程序設計實現10M/ 100M 自適應,設計中采用WS 接口,提高了設計的靈活行,可以實現與其他SOC 的互連[1 ] ,該設計采用VerilogHDL 硬件描述語言編程,基于ISE 開發環境,在Xilinx 公司的Spartan2 Ⅲ系列FPGA XC3S1000242FT256C 上實現。
      關鍵詞:以太網MAC;10M/ 100M; FPGA ;VerilogHDL
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