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演講題目

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開(kāi)源硬件系列02期：

從PyTorch到RTL - 基于MLIR的高層次綜合技術(shù)

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演講時(shí)間

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2022年11月27日 上午10:00

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內(nèi)容簡(jiǎn)介

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為了解決FPGA的可編程性問(wèn)題，實(shí)現(xiàn)從算法到RTL設(shè)計(jì)的快速編譯，我們引入了基于MLIR（多級(jí)別中間表示）的高層次綜合框架ScaleHLS，對(duì)算法的高層次描述進(jìn)行多級(jí)別的抽象和優(yōu)化，并生成高性能的RTL實(shí)現(xiàn)。

本次直播將會(huì)詳細(xì)講述MLIR和ScaleHLS框架，并對(duì)未來(lái)基于MLIR的硬件編譯技術(shù)進(jìn)行展望。

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本期重點(diǎn)

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① LLVM和MLIR框架簡(jiǎn)介

② ScaleHLS簡(jiǎn)介

③ 高層次綜合的表示和優(yōu)化

④ 實(shí)驗(yàn)結(jié)果和案例研究

⑤ 結(jié)論和問(wèn)答交流

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觀看直播

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嘉賓介紹

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葉漢辰，伊利諾伊大學(xué)香檳分校博士生

伊利諾伊大學(xué)香檳分校博士生，分別于2017年和2019年獲得復(fù)旦大學(xué)本科和碩士學(xué)位，于2015年赴新加坡國(guó)立大學(xué)交流學(xué)習(xí)。主要研究方向?yàn)楦邔哟尉C合、硬件編譯技術(shù)、深度學(xué)習(xí)的硬件加速。他曾在HPCA、DAC、ICCAD、FPGA、TRETS等期刊和會(huì)議發(fā)表多篇學(xué)術(shù)論文，曾擔(dān)任TCAD、NEPL、FPGA、FCCM等期刊和會(huì)議的審稿人。他曾獲得2018年全國(guó)大學(xué)生集成電路創(chuàng)新創(chuàng)業(yè)大賽特等獎(jiǎng)、2019年上海市優(yōu)秀畢業(yè)生。他曾在Xilinx（AMD）、SiFive、Intel實(shí)習(xí)，推動(dòng)硬件編譯技術(shù)相關(guān)的開(kāi)發(fā)和研究。他曾領(lǐng)導(dǎo)或參與多個(gè)開(kāi)源項(xiàng)目的開(kāi)發(fā)，包括ScaleHLS、ScaleFlow、CIRCT、MLIR-AIE等。

擅長(zhǎng)語(yǔ)言：Verilog HDL、C++、Python、Cuda、Tcl；擅長(zhǎng)工具：Vivado/Vitis、Vivado/Vitis HLS、PyTorch、LLVM、MLIR

張洪濱，中國(guó)科學(xué)院軟件研究所直博生

主要研究方向?yàn)轭I(lǐng)域特定編譯器及其相關(guān)優(yōu)化技術(shù)；作為 MLIR 社區(qū)開(kāi)發(fā)者，曾發(fā)起 MLIR Python Binding 項(xiàng)目，目前聚焦于 MLIR 向量化方向；發(fā)起 Buddy Compiler 開(kāi)源社區(qū)，在 LFX RISC-V Mentorship，OSPP 開(kāi)源之夏活動(dòng)中擔(dān)任社區(qū)項(xiàng)目導(dǎo)師。

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一群熱愛(ài)技術(shù)的開(kāi)源人

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