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CMOS的NOR門和NAND門

加油射頻工程師 ? 來源:加油射頻工程師 ? 作者:加油射頻工程師 ? 2022-11-02 12:57 ? 次閱讀

NOR gate

OR操作,即是

C=A+B

NOR操作,即是

9199aeae-5a6a-11ed-a3b6-dac502259ad0.png

那怎么對CMOS反相器的結構,進行修改,使其變為NOR門呢?

首先,

需要兩個NMOS器件或者PMOS器件,而且由兩個輸入控制

再者,

首先考慮NMOS部分,如果其中一個NMOS門是高電平,輸出必須保持低電平。如下圖所示。

91ad3726-5a6a-11ed-a3b6-dac502259ad0.png

其次,

PMOS部分,如果A為高,B為高,或者A、B均為高時,PMOS部分必須處于關斷的狀態。而且,如果A和B均為低時,PMOS部分必須為ON的狀態。

如下圖所示,即滿足以上的要求。

91bf2f4e-5a6a-11ed-a3b6-dac502259ad0.png

把PMOS部分和NMOS部分,結合起來,就成為一個完整的CMOS NOR gate.

91cba3d2-5a6a-11ed-a3b6-dac502259ad0.png

從CMOS反相器來構建電路時,天生就帶著反相屬性,所以,當想要獲得OR 門時,則是在NOR門的后面再加一個反相器。

那M1,M2,M3,M4之間的寬度關系是怎么樣的呢?

91d57aba-5a6a-11ed-a3b6-dac502259ad0.png

NAND Gate

NAND操作即是,

91edc174-5a6a-11ed-a3b6-dac502259ad0.png

只有輸入A和B都為高的時候,C才是低。

所以,在NMOS部分,應該是,只有A和B都為高的時候,才打通,使得Vout連接到地上。

如下圖所示。

91fb3d68-5a6a-11ed-a3b6-dac502259ad0.png

而PMOS部分,當A為低,B為低,或者A、B均為低時,PMOS能夠將Vout與VDD連接。

92081d94-5a6a-11ed-a3b6-dac502259ad0.png

將NMOS和PMOS部分合并,即稱為一個完整的CMOS NAND gate,如下圖所示。

923847e4-5a6a-11ed-a3b6-dac502259ad0.png

至于M3,M4,M1,M2之間的寬度關系,推導與NOR gate類似,這邊應該都為W。

審核編輯 :李倩

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原文標題:CMOS的NOR門和NAND門

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