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DVB-T解調器的數據傳輸和前FFT同步系統的設計
摘要：介紹了DVB-T解調器的整體結構，并設計了一種多模塊間進行數據傳輸的機制，同時還設計了前FFT同步系統，其中包括了基帶變換、粗符號同步和分數頻率同步。
關鍵詞：DVB-T 同步 多路交叉開關
圖1
1 系統整體結構
2 數據傳輸
可以看出1bit地址信號的交叉開關需要5個四輸入與門和1個五輸入或門，總線按照32bit數據（雙向）和12bit地址計算，則需要380個四輸入與門和76個五輸入或門，而且沒有一路信號只經過兩經門延遲。因此從實現規模和信號延遲上看，這個多路交叉開關都是容易實現的。這個模塊在Altera Stratisx1S25 FPGA上驗證，其存取速度可以達到100MHz以上。
復數乘法器采用Cordic算法實現，相位累加器根據輸入的振蕩頻率調整相位累加的步長，其輸出為本地載波的相位。Cordic乘法器的一個乘數為采樣數據，另一個乘數就是本地載波的相位，其兩個輸出分別為輸入數據與cos和sin相乘的結果。乘法器的輸出進入上面所描述的74階FIR低通，然后直接進行3倍抽取從而獲得速率為9.14MS/s的數據基帶信號。
2．2．2 FFT窗位置調整
- 解調器(25576)
- 數據(87428)
- DVB(34500)
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