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• 一文解析模擬芯片設(shè)計全流程分析圖

  數(shù)字IC設(shè)計工程師的設(shè)計目標(biāo)是 在PPA（Power、Performance、Area）三個指標(biāo)上追求完美的平衡。 怎么玩轉(zhuǎn)這門科學(xué)？詳情戳這篇： 芯片設(shè)計五部曲之二 | 圖靈藝術(shù)家——數(shù)字IC 以及第三集算法仿真，搶先收看： 芯片設(shè)計五部曲之三 | 戰(zhàn)略規(guī)劃家——算法仿真 如果說數(shù)字IC像科學(xué)，那...

  3747次閱讀 · 0評論 模擬ICcpugpueda射頻電路
  

• 閑聊芯片封裝

  芯片產(chǎn)業(yè)是一個分工很細的產(chǎn)業(yè)。設(shè)計公司做完邏輯和物理設(shè)計，將最終設(shè)計結(jié)果交給芯片生產(chǎn)廠。...

  4778次閱讀 · 0評論 NAND芯片設(shè)計芯片封裝3D封裝
  

• 淺析芯片功耗的控制方法與驗證方式

  隨著移動設(shè)備的興起和芯片工藝的提升，功耗成為近年來芯片設(shè)計越來越關(guān)注的話題。對功耗關(guān)注度的提升大致可以從兩方面進行分析，用戶角度和芯片設(shè)計者角度。...

  6762次閱讀 · 0評論 芯片設(shè)計CMOS電路預(yù)分頻器芯片功耗PMOS管
  

• 回顧下功耗的定義及其組成部分并總結(jié)降低功耗的常用方案

  隨著工藝節(jié)點的不斷發(fā)展（現(xiàn)在普遍是28nm,22nm,16nm,14nm,甚至有的都在做7nm）,芯片的性能需求越來越高，規(guī)模也越來越大...

  3370次閱讀 · 0評論 CMOS寄存器IC設(shè)計電容充電PMOS管
  

• IC設(shè)計中的功耗挑戰(zhàn)和低功耗設(shè)計

  在早期的IC設(shè)計中，關(guān)注的參數(shù)主要是性能(timing)和面積(area)。EDA工具在滿足性能要求的情況下，最小化面積。...

  818次閱讀 · 0評論 CMOSIC設(shè)計EDA工具電源電壓NMOS管
  

• 什么是ic設(shè)計 ic設(shè)計和芯片設(shè)計區(qū)別

  IC設(shè)計指的是集成電路設(shè)計（Integrated Circuit Design），它是指將電子元器件、電路和功能集成到單個芯片中的過程。IC設(shè)計涉及到將電路功能進行邏輯設(shè)計、布局布線、驗證仿真等多個階段，以及與層次化方式相結(jié)合的物理設(shè)計、封裝設(shè)計、測試設(shè)計等相關(guān)工作。...

  9436次閱讀 · 0評論 集成電路電子元器件IC設(shè)計

• 驗證—當(dāng)前SoC芯片設(shè)計難以承受之重

  芯片設(shè)計被譽為人類歷史上最細微也是最宏大的工程，芯片研發(fā)工作者需要把上千億顆晶體管集成在面積最小至指甲大小的芯片上。...

  783次閱讀 · 0評論 寄存器芯片設(shè)計晶體管SoC芯片硬件加速器
  

• 低功耗技術(shù)在IC設(shè)計中的應(yīng)用 IC設(shè)計流程解析

  IC設(shè)計流程從設(shè)計到驗證是一個復(fù)雜而精細的過程，需要多個設(shè)計工具和驗證手段的支持。不同的設(shè)計流程可能會有所差異，具體的設(shè)計流程也會根據(jù)項目需求和技術(shù)發(fā)展的變化而有所調(diào)整。...

  640次閱讀 · 0評論 放大器濾波器電源管理IC設(shè)計

• 芯片性能小談—時間并行

  眾所周知，評估一顆芯片的好壞，PPA(performance，power，area)是最重要的指標(biāo)之一。...

  2261次閱讀 · 1評論 以太網(wǎng)多核處理器AXI總線FIFO存儲DRAM控制器
  

• 總結(jié)一下pipeline流水線設(shè)計的關(guān)鍵點

  pipeline流水線設(shè)計是一種典型的面積換性能的設(shè)計。一方面通過對長功能路徑的合理劃分，在同一時間內(nèi)同時并行多個該功能請求，大大提高了某個功能的吞吐率...

  2612次閱讀 · 0評論 處理器芯片設(shè)計乘法器Pipeline選擇器
  

• 從處理單bit跨時鐘域信號同步問題來入手

  在數(shù)字電路中，跨時鐘域處理是個很龐大的問題，因此將會作為一個專題來陸續(xù)分享。今天先來從處理單bit跨時鐘域信號同步問題來入手。...

  2066次閱讀 · 0評論 FPGA設(shè)計IC設(shè)計仿真器數(shù)字電路SRC
  

• 數(shù)字IC前端設(shè)計流程及工具

  以門級網(wǎng)表（Netlist）生成為分界線，之前稱為前端，之后稱為后端。...

  2381次閱讀 · 0評論 IC設(shè)計RTLDFT
  

• eda綜合有哪些類型 邏輯綜合的原理

  　EDA（Electronic Design Automation，電子設(shè)計自動化）綜合是指在集成電路設(shè)計過程中將高級描述語言（HDL）代碼轉(zhuǎn)換為邏輯網(wǎng)表的過程。...

  2519次閱讀 · 0評論 集成電路EDAHDL

• 制造集成電路的版圖基本知識

  在光刻膠工藝過程中，涂層曝光、顯影后，曝光部分被溶解，未曝光部分留下來，該涂層材料為正性光刻膠。...

  10922次閱讀 · 0評論 集成電路CMOSMOSFET光刻膠寄生二極管
  

• 數(shù)字IC驗證之基本的TLM通信

  提高驗證生產(chǎn)力的關(guān)鍵之一就是在合適的**抽象層次**思考問題和完成驗證工作，為此UVM提供了 **事務(wù)級別（transaction level）** 的通信接口 **（Transaction-Level Modeling，TLM）** 。...

  811次閱讀 · 0評論 IC設(shè)計UVMTLM
  

• 數(shù)字IC驗證之UVM概述

  UVM提供了實現(xiàn) **覆蓋驅(qū)動驗證（coverage-driven verification ，CDV）** 的框架。 CDV結(jié)合了自動測試向量生成，自檢查和覆蓋率收集，顯著地縮短了用于驗證設(shè)計時間。...

  2701次閱讀 · 0評論 IC設(shè)計UVMVerilog語言DUT
  

• 芯片設(shè)計進階之路—低功耗深入理解

  低功耗芯片設(shè)計是本世紀(jì)以來最重要的新興設(shè)計方法?？梢哉f沒有低功耗設(shè)計，就沒有今天的智能手機，移動設(shè)備，物聯(lián)網(wǎng)，及高性能計算等產(chǎn)業(yè)。...

  3837次閱讀 · 0評論 處理器SOC設(shè)計晶體管低功耗芯片CMOS反相器
  

• 芯片設(shè)計進階之路—亞穩(wěn)態(tài)和同步器

  隨著芯片設(shè)計越來越復(fù)雜，功耗問題越來越成為首要問題，單純的單時鐘芯片已經(jīng)是一種奢望，大部分芯片都會由多個甚至幾十上百個異步時鐘驅(qū)動。...

  2817次閱讀 · 0評論 鎖存器信號處理器時鐘芯片同步器CMOS反相器
  

• 芯片設(shè)計進階之路—SpyGlass CDC流程深入理解

  隨著技術(shù)的發(fā)展，數(shù)字電路的集成度越來越高，設(shè)計也越來越復(fù)雜。很少有系統(tǒng)會只工作在同一個時鐘頻率。一個系統(tǒng)中往往會存在多個時鐘，這些時鐘之間有可能是同步的，也有可能是異步的。如果一個系統(tǒng)中，異步時鐘之間存在信號通道，則就會存在CDC（clock domain crossing）問題。...

  20368次閱讀 · 0評論 鎖存器RTLGUI同步器CDC技術(shù)
  

• 芯片設(shè)計進階之路—從CMOS到建立時間和保持時間

  建立時間(setup time)和保持時間(hold time)是時序分析中最重要的概念之一，深入理解建立時間和保持時間是進行時序分析的基礎(chǔ)。...

  2168次閱讀 · 0評論 CMOSMOS管反相器晶體管觸發(fā)器
  
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