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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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采用SDR技術(shù)將會加速LTE行動裝置上市開發(fā)時程,并實(shí)現(xiàn)全球漫游。而在基地臺端的進(jìn)展,以目前最熱門的Cloud RAN或是稱作Centralized-R...
軟件設(shè)計(jì)測量系統(tǒng)在RF設(shè)計(jì)和測試的未來展望
軟件已經(jīng)成為儀器本身的核心 - 使得儀器能夠解決測量和系統(tǒng)設(shè)計(jì)中更高難度的挑戰(zhàn)。 實(shí)際上,自動化已經(jīng)成為工程師應(yīng)對復(fù)雜測量需求時一項(xiàng)必不可少的功能。 當(dāng)...
控制算法與工業(yè)網(wǎng)絡(luò)的結(jié)合FPGA SoC加速馬達(dá)開發(fā)
工業(yè)設(shè)計(jì)人員可望借助快速建立原形技術(shù)和模塊基礎(chǔ)設(shè)計(jì),將馬達(dá)控制算法移至FPGA SoC環(huán)境中,藉此開發(fā)出以FPGA SoC為核心的馬達(dá)驅(qū)動系統(tǒng),從而大幅...
2017-11-17 標(biāo)簽:fpgasoc馬達(dá)驅(qū)動 1123 0
Cadence OrCAD FPGA System Planner為在PCB板的FPGA設(shè)計(jì)提供支持
Cadence OrCADFPGA System Planner為FPGA和PCB之間的協(xié)同設(shè)計(jì)提供了一種全面的、可擴(kuò)展的解決方案,它能使用戶創(chuàng)建一個正...
2017-11-17 標(biāo)簽:fpgapcbFPGA設(shè)計(jì) 6491 0
PicoBlaze處理器軟核中的KCPSM6應(yīng)用技巧與案例
PicoBlaze是8位微處理器,在Xilinx公司的Virtex、Spartan-II系列以上FPGA與CoolRunner-II系列以上的CPLD器...
JESD204B發(fā)射器的PHY性能的三個關(guān)鍵性能指標(biāo)詳解
若要評估JESD204B發(fā)射器的PHY性能,則需評估一些性能指標(biāo)。這些指標(biāo)包括共模電壓、差分峰峰值電壓、差分阻抗、差分輸出回?fù)p、共模回?fù)p、發(fā)射器短路電流...
基于NI FPGA 8733R板卡開發(fā)一套電機(jī)系統(tǒng)
開發(fā)低成本且可擴(kuò)展的系統(tǒng)架構(gòu),該架構(gòu)應(yīng)能夠運(yùn)行類似于測試配置文件的電機(jī),以進(jìn)行電子控制單元(ECU)可靠性篩選評估。 為提高電子控制單元(ECU)的可靠...
利用LabVIEW和CompactRIO開發(fā)液壓系統(tǒng)的仿真系統(tǒng)
對駕駛過程中轉(zhuǎn)向反作用力的仿真一直是動態(tài)變化的,因?yàn)樗Q于車速、轉(zhuǎn)向角度以及道路狀況。另外,對于產(chǎn)生反作用力的部件,此仿真系統(tǒng)還必須具備快速響應(yīng)時間。...
2017-11-17 標(biāo)簽:fpgalabview液壓系統(tǒng) 2272 0
dds通過增加幅度控制等配合依托MCU的交互界面和功放實(shí)現(xiàn)所需要的波形
dds通過增加幅度控制、正交調(diào)制、載波相乘、觸發(fā)控制等配合依托MCU的交互界面和功放,就變成了一個復(fù)雜的信號源了。
FPGA模塊里的Xilinx Vivado選項(xiàng)頁包括哪些項(xiàng)目
兩種方式可顯示該頁面: 右鍵單擊項(xiàng)目瀏覽器窗口中FPGA終端下的程序生成規(guī)范,從快捷菜單中選擇新建?編譯,打開編譯屬性對話框。在類別列表中選擇Xilin...
FPGA設(shè)計(jì)約束技巧之XDC約束之I/O篇(下)
XDC中的I/O約束雖然形式簡單,但整體思路和約束方法卻與UCF大相徑庭。加之FPGA的應(yīng)用特性決定了其在接口上有多種構(gòu)建和實(shí)現(xiàn)方式,所以從UCF到XD...
2017-11-17 標(biāo)簽:fpgaFPGA設(shè)計(jì)xdc 7832 0
FPGA設(shè)計(jì)約束技巧之XDC約束之I/O篇 (上)
從UCF到XDC的轉(zhuǎn)換過程中,最具挑戰(zhàn)的可以說便是本文將要討論的I/O約束了。 I/O 約束的語法 XDC 中可以用于 I/O 約束的命令包括 set_...
2017-11-17 標(biāo)簽:fpgaFPGA設(shè)計(jì)xdc 1.3萬 0
NI視覺開發(fā)模塊加速嵌入式視覺應(yīng)用的開發(fā)
NI CompactRIO平臺提供了業(yè)界第一批可編程自動化控制器(PAC)以實(shí)現(xiàn)內(nèi)置視覺功能,并提供一個完全集成的高效設(shè)計(jì)來縮短產(chǎn)品上市時間和減小系統(tǒng)尺...
MACsec綜合FPGA的IP內(nèi)核提升數(shù)據(jù)中心安全性
數(shù)據(jù)中心設(shè)備設(shè)計(jì)人員將結(jié)合采用基于FPGA的內(nèi)核來提供安全的高性能以太網(wǎng)鏈路。 云存儲和IT服務(wù)包對IT 經(jīng)理而言極富吸引力,因?yàn)檫@不僅能降低成本,而且...
Zynq SoC的完整60GHz雙向數(shù)據(jù)通信方案詳解
賽靈思毫米波調(diào)制解調(diào)器解決方案可幫助基礎(chǔ)架構(gòu)廠商為其無線回程網(wǎng)絡(luò)開發(fā)成本優(yōu)化的高度靈活的可定制鏈路。該解決方案主要面向賽靈思Zynq?7000全可編程S...
算法重構(gòu)和Vivado HLS在FPGA上快速實(shí)現(xiàn)高吞吐量的處理引擎
如果您正在努力開發(fā)計(jì)算內(nèi)核,而且采用常規(guī)內(nèi)存訪問模式,并且循環(huán)迭代間的并行性比較容易提取,這時,Vivado? 設(shè)計(jì)套件高層次綜合(HLS) 工具是創(chuàng)建...
如何使用Zynq SoC和賽靈思IP核簡化高速光學(xué)收發(fā)器模塊熱測試
本文介紹一種使用Zynq SoC和賽靈思IP 核簡化高速光學(xué)收發(fā)器模塊熱測試的方法。 隨著數(shù)據(jù)中心內(nèi)部光學(xué)收發(fā)器模塊的傳輸速度提高到前所未有的高度,數(shù)據(jù)...
從最初不起眼的膠合邏輯開始,F(xiàn)PGA已經(jīng)歷了漫長的發(fā)展道路。當(dāng)前FPGA的邏輯容量和靈活性已將其帶入了嵌入式設(shè)計(jì)的中心位置。目前,在單個可編程芯片上可實(shí)...
2017-11-17 標(biāo)簽:fpga 9848 0
利用FPGA完成VGA顯示控制使其脫離PC機(jī)的控制分析和實(shí)驗(yàn)
設(shè)計(jì)中采用了Verilog HDL語言對賽靈思Basys開發(fā)板進(jìn)行編程設(shè)計(jì)。首先通過Image2Lcd軟件分別提取兩幅圖片的色彩信息數(shù)據(jù),將得到的數(shù)據(jù)存...
蘋果買了相機(jī)傳感器公司,下一步目標(biāo)是儲存設(shè)備和傳感器
蘋果(US-AAPL) 近來為了熱門芯片事業(yè)體,瞄準(zhǔn)并購以色列新創(chuàng)公司,認(rèn)為他們擁有快閃儲存設(shè)備和傳感器的先進(jìn)科技,但并未明確列出口袋名單。
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